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Cadence去年?duì)I收增長23%

　　Cadence設(shè)計(jì)系統(tǒng)公司長期以來一直強(qiáng)調(diào)為當(dāng)?shù)乜蛻艉秃献骰锇榉?wù)的承諾，公司今日宣布其擴(kuò)大后的上海辦事處正式啟用，該辦事處包括300多名銷售、研發(fā)及技術(shù)支持員工。格科微、芯原微電子等到場祝賀。　　Cadence總裁兼CEO陳立武說，“我們進(jìn)入中國已經(jīng)有20多年，從中獲得的經(jīng)驗(yàn)是Cadence公司獨(dú)一無二的優(yōu)勢，通過與客戶和合作伙伴的密切合作，Cadence將為上海的半導(dǎo)體和系統(tǒng)公司加速發(fā)展提供支持?！标惲⑽渫嘎?，通過近1-2年的調(diào)整，公司已重新步入收獲期，2011年銷售收
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基于Cadence的高速PCB設(shè)計(jì)方案

1引言人們對于通信的要去總是朝著“快”的方向發(fā)展，要求信號的傳輸和處理的速度越來越快，相應(yīng)的，高速PC...
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Cadence的Virtuoso平臺的高級定制化設(shè)計(jì)介紹

大型多領(lǐng)域模擬混合信號(AMS)系統(tǒng)在電子行業(yè)中越來越常見，此類設(shè)計(jì)必須同時(shí)滿足進(jìn)度和準(zhǔn)確度要求，從而給設(shè)計(jì)工程師帶來了極大的挑戰(zhàn)。本文介紹了一種結(jié)合自上而下和自下而上的方法來實(shí)現(xiàn) “中間相遇”，
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Cadence推出新一代Encounter RTL-to-GDSII流程

全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS)，日前宣布推出最新版Cadence? Encounter? RTL-to-GDSII流程，面向高性能千兆級設(shè)計(jì)，包括在20納米最新技術(shù)節(jié)點(diǎn)上的新設(shè)計(jì)。這種最新的RTL-to-GDSII設(shè)計(jì)、實(shí)現(xiàn)與簽收流程是與領(lǐng)先的IP與晶圓廠合作伙伴及客戶合作開發(fā)的，能更有效地進(jìn)行SoC開發(fā)，滿足并超越當(dāng)今市場所需的功耗、性能與面積需求。
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IEEE 802.15.4協(xié)議的性能研究

摘要：本文重點(diǎn)研究了802．15．4 MAC協(xié)議的網(wǎng)絡(luò)性能，并仿真分析802．11和802．15．4在不同流量負(fù)載下數(shù)據(jù)吞吐量和時(shí)延的變化情況。結(jié)果表明在傳輸數(shù)據(jù)包長度較小的應(yīng)用環(huán)境下，802．15．4的帶寬效率比802．11高，說
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用1進(jìn)制數(shù)據(jù)選定0~15倍增益的編程放大器電路及功能

電路的功能音響及通信電路中使用的放大器的增益以分貝為單位這有其合理的一面，但在測量電路中，則用*1，*2，*5，*5，......這樣的倍數(shù)表示。示波器和記錄儀用的放大器就是其代表。在記錄紙上記錄數(shù)據(jù)時(shí)，增益量如不
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設(shè)計(jì)仿真技術(shù)Cadence PCB介紹

Cadence PCB設(shè)計(jì)仿真技術(shù)提供了一個(gè)全功能的模擬仿真器，并支持?jǐn)?shù)字元件幫助解決幾乎所有的設(shè)計(jì)挑戰(zhàn)，從高頻系統(tǒng)到低功耗IC設(shè)計(jì)，這個(gè)強(qiáng)大的仿真引擎可以容易地同各個(gè)Cadence PCB原理圖輸入工具結(jié)合，加速了上市時(shí)間
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Cadence混合信號解決方案獲TowerJazz認(rèn)證

全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司，今天宣布全球集成電路頂尖專業(yè)晶圓廠TowerJazz已認(rèn)證Cadence混合信號解決方案，用于其TowerJazz參考設(shè)計(jì)流程2.0。新參考設(shè)計(jì)流程采用混合信號電源管理技術(shù)，應(yīng)用了Cadence Encounter Digital Implementation System及Virtuoso技術(shù)，將統(tǒng)一的定制/模擬與數(shù)字流程應(yīng)用于TowerJazz的TS018PM 180納米及TS035PM 350納米Bipolar-CMOS-DMOS(BCD)電源管理
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TowerJazz參考設(shè)計(jì)流程2.0全面認(rèn)證Cadence混合信號解決方案及工藝設(shè)計(jì)包

全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司 (NASDAQ: CDNS)，今天宣布全球集成電路頂尖專業(yè)晶圓廠TowerJazz已認(rèn)證Cadence混合信號解決方案，用于其TowerJazz參考設(shè)計(jì)流程2.0。新參考設(shè)計(jì)流程采用混合信號電源管理技術(shù)，應(yīng)用了Cadence Encounter? Digital Implementation System及Virtuoso?技術(shù)，將統(tǒng)一的定制/模擬與數(shù)字流程應(yīng)用于TowerJazz的TS018PM 180納米及TS035PM 350納米Bipolar-C
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芯邦采用Cadence Incisive Xtreme II

芯邦采用Cadence Incisive Xtreme III系統(tǒng)提升SoC驗(yàn)證實(shí)效　全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司 ...
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Cadence Palladium XP助力QLogic

全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司日前宣布 QLogic 已采用 Cadence Palladium XP 驗(yàn)證計(jì)算平臺以便加快復(fù)雜網(wǎng)絡(luò)交換機(jī)的設(shè)計(jì)。QLogic制造光纖通道、10Gb以太網(wǎng)融合網(wǎng)絡(luò)和面向存儲和高性能計(jì)算 (HPC) 應(yīng)用的InfiniBand交換機(jī)。這些交換機(jī)提供了推動全球領(lǐng)先OEM和最終用戶的存儲、數(shù)據(jù)和HPC網(wǎng)絡(luò)向前發(fā)展所需的端口密度和性能。
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Cadence Palladium XP支持QLogic快速開發(fā)先進(jìn)的網(wǎng)絡(luò)交換機(jī)

全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè) Cadence設(shè)計(jì)系統(tǒng)公司 (NASDAQ:CDNS) 日前宣布 QLogic 已采用 Cadence Palladium XP 驗(yàn)證計(jì)算平臺以便加快復(fù)雜網(wǎng)絡(luò)交換機(jī)的設(shè)計(jì)。QLogic制造光纖通道、10Gb以太網(wǎng)融合網(wǎng)絡(luò)和面向存儲和高性能計(jì)算 (HPC) 應(yīng)用的InfiniBand交換機(jī)。這些交換機(jī)提供了推動全球領(lǐng)先OEM和最終用戶的存儲、數(shù)據(jù)和HPC網(wǎng)絡(luò)向前發(fā)展所需的端口密度和性能。使用Palladium XP系統(tǒng)，QLogic大幅縮短了與開發(fā)復(fù)雜的數(shù)百萬門 (multi-mi
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Xilinx與Cadence推出可擴(kuò)展虛擬平臺用于嵌入式軟件開發(fā)

Xilinx, Inc. (NASDAQ: XLNX)與 Cadence 設(shè)計(jì)系統(tǒng)公司 (NASDAQ: CDNS) 今天宣布共同合作開發(fā)了業(yè)界首個(gè)用于在硬件成型之前對基于Xilinx Zynq?-7000可擴(kuò)展式處理平臺(EPP)系統(tǒng)進(jìn)行系統(tǒng)設(shè)計(jì)、軟件開發(fā)與測試的虛擬平臺。
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ARM與Cadence簽署了新的EDA技術(shù)應(yīng)用長期協(xié)議

　　ARM與Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS)日前宣布成功流片了業(yè)界首款基于ARM CortexTM-A15 MPCoreTM 處理器的20納米設(shè)計(jì)。該測試芯片面向TSMC的20納米工藝，由來自ARM、Cadence與TSMC的工程師使用Cadence RTL-to-signoff流程共同開發(fā)完成。今天的聲明是ARM和Cadence在優(yōu)化Cortex-A15處理器設(shè)計(jì)流程方面合作18個(gè)月的成果。　　“Cortex-A15是我們迄今為止最高級的ARM處理器。ARM一直致力
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ARM與Cadence實(shí)現(xiàn)行業(yè)里程碑

ARM與Cadence設(shè)計(jì)系統(tǒng)公司今天宣布成功流片了業(yè)界首款基于ARM CortexTM-A15 MPCoreTM 處理器的20納米設(shè)計(jì)。該測試芯片面向TSMC的20納米工藝，由來自ARM、Cadence與TSMC的工程師使用Cadence RTL-to-signoff流程共同開發(fā)完成。今天的聲明是ARM和Cadence在優(yōu)化Cortex-A15處理器設(shè)計(jì)流程方面合作18個(gè)月的成果。
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