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智原發(fā)表PowerSlash(TM)硅智財于聯(lián)電55奈米超低功耗製程支援物聯(lián)網(wǎng)應(yīng)用開發(fā)

  • 　　聯(lián)華電子今(12日)與ASIC設(shè)計服務(wù)暨IP研發(fā)銷售廠商智原科技(Faraday Technology Corporation，TWSE：3035)共同發(fā)表智原科技于聯(lián)電55奈米超低功耗製程(55ULP)的PowerSlash™基礎(chǔ)IP方案。智原PowerSlash™與聯(lián)電製程技術(shù)相互結(jié)合設(shè)計，為超低功耗的無線應(yīng)用需求技術(shù)進行優(yōu)化，滿足無線物聯(lián)網(wǎng)產(chǎn)品的電池長期壽命需求。 　　智原科技行銷暨投資副總于德旬表示：「物聯(lián)網(wǎng)應(yīng)用建構(gòu)過程中，效能往往受制于低功耗技術(shù)。而今透過聯(lián)電55奈
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基于FPGA IP核的FFT實現(xiàn)與改進

  • 摘要 利用FPGA IP核設(shè)計了一種快速、高效的傅里葉變換系統(tǒng)。針對非整數(shù)倍信號周期截斷所導(dǎo)致的頻譜泄露問題，提出了一種通過時輸入信號加窗處理來抑制頻譜泄露的方法。利用Modelsim和Matlab對設(shè)計方案進行了仿真，同
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基于Avalon總線SHT11溫濕度傳感器自定義IP核的開發(fā)

  • SOPC(System On a Programmable Chip,可編程芯片系統(tǒng))就是在一個可編程芯片上實現(xiàn)一個電子系統(tǒng)的技術(shù)。SOPC是可編程邏輯器件技術(shù)和SoC(System on Chip)技術(shù)發(fā)展與
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基于EDA技術(shù)的電子設(shè)計要點

  • 數(shù)字化是電子設(shè)計發(fā)展的必然趨勢，EDA 技術(shù)綜合了計算機技術(shù)、集成電路等在不斷向前發(fā)展，給電子設(shè)計領(lǐng)域帶來了一種全新的理念。本文筆者首先簡
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一種CORDIC協(xié)處理器核的設(shè)計與實現(xiàn)

  • 一種CORDIC協(xié)處理器核的設(shè)計與實現(xiàn), 隨著航天技術(shù)的發(fā)展，航天任務(wù)對于導(dǎo)航計算機的性能要求越來越高。導(dǎo)航計算機除了要對傳感器數(shù)據(jù)進行采集，與控制系統(tǒng)進行實時通訊，還要能進行實時的計算。盡管目前航天任務(wù)中使用的處理器芯片性能越來越強，但大多
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適用于FPGA、GPU和ASIC系統(tǒng)的電源管理

  • 本文通過列舉Altera 公司的 20nm Arria 10 FPGA 和 Arria 10 SoC (片上系統(tǒng)) 開發(fā)電路板的電源管理解決方案，分析了對于FPGA、GPU 或 ASIC 控制的系統(tǒng)中電源管理帶來的挑戰(zhàn)，并指出通過使用 LTPowerCAD 和 LTPowerPlanner 這類工具，可以大大簡化對負載點穩(wěn)壓器以及各部分分析結(jié)果的映射任務(wù)。
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智原榮獲ISO9001 Plus品質(zhì)知識典范獎，高經(jīng)營品質(zhì)打造設(shè)計服務(wù)

  • 　　ASIC 設(shè)計服務(wù)暨 IP 研發(fā)銷售領(lǐng)導(dǎo)廠商-智原科技(Faraday Technology, TAIEX: 3035)于日前獲頒 ISO9001 Plus 典范獎項。ISO9001:2015是ISO 15年來最大改版，能成為首批獲得SGS專業(yè)驗證的廠商，是對智原在品質(zhì)承諾、經(jīng)營與職能發(fā)展表現(xiàn)上的高度肯定和最具體驗證。 　　智原科技成立于1993年，累積20余年在 IP (矽智財)與 ASIC 設(shè)計服務(wù)的豐富經(jīng)驗，不但自主產(chǎn)出了3,000多支的 IP，更有2,000多個專案的成功量產(chǎn)經(jīng)驗，客戶遍及臺
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智原和聯(lián)電發(fā)表28HPC(U) 12.5G SerDes PHY IP解決方案

  • 　　聯(lián)華電子今(3日) 與 ASIC 設(shè)計服務(wù)暨 IP 研發(fā)銷售廠商智原科技共同發(fā)表智原科技于聯(lián)電28奈米 HPCU 工藝的可編程12.5Gbps SerDes PHY IP 方案。此次智原成功推出的 SerDes PHY，為聯(lián)電28奈米 High-K / Metal Gate 后閘極技術(shù)工藝平臺中一系列高速 I/O 解決方案的第一步。 　　藉由采用涵蓋1.25Gbps 到12.5Gbps 的可編程架構(gòu)技術(shù)，此 SerDes PHY 能夠輕易支持10G/1G xPON 被動光纖網(wǎng)絡(luò)通訊設(shè)備。結(jié)合不同的
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Arasan推出支持TSMC 28納米HPC工藝的DPHY IP核

  • 　　Arasan今日宣布，其MIPI DPHY IP核Ver1.2版本即刻開始供貨，該版本在TSMC 28納米HPC工藝之上可支持高達2.5Gbps的速度。該IP產(chǎn)品將很快被移植到TSMC最新的HPC Plus工藝上。Arasan的MIPI DPHY IP核向下兼容以前的標準版本，需要時能夠以1.5Gbps或更低的速度運行。 　　Arasan提供的最新DPHY IP產(chǎn)品使用了全新的、正在申請專利的DPHY架構(gòu)，該架構(gòu)為實現(xiàn)超低功耗和超小面積而優(yōu)化了DPHY設(shè)計。 　　“我們利用自己在DPH
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數(shù)字電路(fpga/asic)設(shè)計入門之靜態(tài)時序分析

  • 　　靜態(tài)時序分析簡稱STA(Static Timming Analysis)，它提供了一種針對大規(guī)模門級電路進行時序驗證的有效方法。它指需要更具電路網(wǎng)表的拓撲，就可以檢查電路設(shè)計中所有路徑的時序特性，測試電路的覆蓋率理論上可以達到100%，從而保證時序驗證的完備性;同時由于不需要測試向量，所以STA驗證所需時間遠小于門級仿真時間。但是，靜態(tài)時序分析也有自己的弱點，它無法驗證電路功能的正確性，所以這一點必須由RTL級的功能仿真來保證，門級網(wǎng)表功能的正確性可以用門級仿真技術(shù)，也可以用后面講到的形式驗證技術(shù)。值
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關(guān)于除法電路

  • 　　除法，這個小學4年紀就開始學習和使用的方法卻一直是我這個ASIC工程師心中的痛。我一直在思考如何能找到一個簡單(硬件資源少)而快捷(時鐘排數(shù)少)的通用除法電路?！　∑鋵嵑唵蔚恼f除法可以用迭代的減法來實現(xiàn)，但是對于硬件，這恐怕要花很多時間。我也一直沒有找到實現(xiàn)任意除法的好方法。但是對于某些除數(shù)固定的除法還是有一些辦法的?！　?)最容易想到的就是ROM查找表，但是ROM畢竟不是我們的目標，雖然ROM有時是不錯的方法?！　?)我開始仔細考慮這個問題是在做264解碼時必須要處理QP的問題。這是一個除以6的計算
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Mentor Graphics Veloce VirtuaLAB增加針對領(lǐng)先網(wǎng)絡(luò)設(shè)計的下一代協(xié)議

  • 　　2015年10月19日，Mentor Graphics公司今天宣布，推出支持25G、50G和100G以太網(wǎng)的Veloce® VirtuaLAB Ethernet環(huán)境。這種支持有助于實現(xiàn)今天正在創(chuàng)建的基于大規(guī)模以太網(wǎng)設(shè)計的高效的、基于仿真的驗證。 　　連接需求的激增對交換機和路由器設(shè)計的尺寸有著深遠的影響，使之成為了今天開發(fā)的最大的IC設(shè)計。設(shè)計的絕對尺寸、早期發(fā)布的壓力，以及需要驗證所有路徑，都推動著將驗證從模擬轉(zhuǎn)向基于仿真流程方法的轉(zhuǎn)變。 　　Juniper Networks硅和系統(tǒng)工程
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揭秘：北斗衛(wèi)星國產(chǎn)芯片是怎樣煉成的

  • 西昌發(fā)射的兩顆新一代北斗導(dǎo)航衛(wèi)星近日來成為國內(nèi)各方關(guān)注的焦點，在這兩顆衛(wèi)星和“遠征一號”火箭上，不僅100%使用了中國自主開發(fā)的宇航CPU芯片，還承載著數(shù)據(jù)總線電路、轉(zhuǎn)換器、存儲器等大量其他國產(chǎn)芯片。據(jù)了解，這是中國衛(wèi)星第一次成體系地批量使用國產(chǎn)芯片。
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零基礎(chǔ)學FPGA （二十一）SOPC進階，自定義AD轉(zhuǎn)換IP核設(shè)計全流程

  • 　　今天帶大家來設(shè)計一個自定義的IP核，我們從最基本的做起，包括datasheet 的理解，設(shè)計的整體框架，AD轉(zhuǎn)換代碼的編寫，仿真，Avalon-MM總線接口的編寫，硬件系統(tǒng)還是基于上次的硬件系統(tǒng)，不過我們不再用altera給我們提供的IP核了，我們要自己做一個，有時候我們找不到他們提供的IP核，或者有些IP核是收費的，這個時候我們就可以自己來編寫自己的IP，雖然沒有官方的那么標準，但是用來做一些實驗還是沒什么問題的。 　　這次實驗我用的是原來我那塊板子，因為那塊板子上有AD轉(zhuǎn)換芯片，而我們上次搭建的
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FPGA實戰(zhàn)演練邏輯篇：FPGA與ASIC

  • 　　拋開FPGA不提，大家一定都很熟悉ASIC。所謂ASIC，即專用集成電路(Application Specific Integrated Circuit)的簡稱，電子產(chǎn)品中，它無所不在，還真是比FPGA普及得多得多。但是ASIC的功能相對固定，它是為了專一功能而生，希望對它進行任何的功能和性能的改善往往是無濟于事的。打個淺顯的比喻，如圖1.2所示，如果說ASIC是布滿鉛字的印刷品，那么FPGA就是可以自由發(fā)揮的白紙一張。(特權(quán)同學版權(quán)所有) 　　 ? 　　圖1.2 ASIC和FPG
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