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Altera交付14.0版Quartus II軟件，其編譯時間業(yè)界最快
- Altera公司(Nasdaq: ALTR)今天發(fā)布Quartus® II軟件14.0版——FPGA業(yè)界性能和效能首屈一指的軟件。Altera的這一最新版軟件編譯時間比競爭設(shè)計工具套裝平均快出2倍，保持了FPGA和SoC設(shè)計的軟件領(lǐng)先優(yōu)勢。 Quartus II軟件14.0版支持用戶更高效的迅速實(shí)現(xiàn)FPGA和SoC設(shè)計。最新版包括新的快速重新編譯特性，對設(shè)計進(jìn)行小改動后，編譯時間縮短了4倍;以及同類最佳的PCI Express (PCIe) IP解決方案，性能達(dá)到
- 關(guān)鍵字： Altera Quartus II FPGA SoC
一種通用的FPGA網(wǎng)絡(luò)下載器硬件設(shè)計
- 摘要 網(wǎng)絡(luò)下載器作為航天計算機(jī)地面檢測系統(tǒng)的重要組成部分，發(fā)揮著重要的作用。文中主要介紹了網(wǎng)絡(luò)下栽器的總體設(shè)計思路，給出了硬件模塊的設(shè)計原理圖。并在PCB設(shè)計中，對于LVDS接口、高速總線以及疊層的設(shè)計中給出了應(yīng)用參考，保證了系統(tǒng)硬件的可靠性，且在實(shí)際應(yīng)用中取得了穩(wěn)定的性能表現(xiàn)。 關(guān)鍵詞 LVDS;通用下載器;FPGA 隨著航天技術(shù)的發(fā)展，地面檢測設(shè)備作為大系統(tǒng)的重要組成部分，發(fā)揮著重要作用。通用下載器作為測試指令和測試數(shù)據(jù)上傳下發(fā)的重要通道，其可靠性和穩(wěn)定性備受關(guān)注，本文介紹了通用下載器
- 關(guān)鍵字： LVDS 通用下載器 FPGA
采用MEMS麥克風(fēng)實(shí)現(xiàn)復(fù)雜環(huán)境下對特定語音的提取與放大
- 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
- 關(guān)鍵字： MEMS麥克風(fēng) 語音提取 ADMP421 FPGA
基于SRAM/DRAM的大容量FIFO的設(shè)計與實(shí)現(xiàn)
- 1 引言 FIFO(First In First Out)是一種具有先進(jìn)先出存儲功能的部件。在高速數(shù)字系統(tǒng)當(dāng)中通常用作數(shù)據(jù)緩存。在高速數(shù)據(jù)采集、傳輸和實(shí)時顯示控制領(lǐng)域中.往往需要對大量數(shù)據(jù)進(jìn)行快速存儲和讀取，而這種先進(jìn)先出的結(jié)構(gòu)特點(diǎn)很好地適應(yīng)了這些要求，是傳統(tǒng)RAM無法達(dá)到的。 許多系統(tǒng)都需要大容量FIFO作為緩存，但是由于成本和容量限制，常采用多個FIFO芯片級聯(lián)擴(kuò)展，這往往導(dǎo)致系統(tǒng)結(jié)構(gòu)復(fù)雜，成本高。本文分別針對Hynix公司的兩款SRAM和DRAM器件，介紹了使用CPLD進(jìn)行接口連接和編程控制，來
- 關(guān)鍵字： FIFO SRAM DRAM CPLD
分布式網(wǎng)絡(luò)化視頻監(jiān)控系統(tǒng)的設(shè)計實(shí)現(xiàn)，系統(tǒng)框圖、硬件原理
- 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
- 關(guān)鍵字： 視頻監(jiān)控 FPGA ZigBee VirtexII
基于FPGA/CPLD的半整數(shù)分頻器設(shè)計及仿真
- 1引言 CPLD(ComplexprogrammableLogicDevice，復(fù)雜可編程邏輯器件)和FPGA(FieldprogrammableGatesArray，現(xiàn)場可編程門陣列)都是可編程邏輯器件，它們是在PAL、GAL等邏輯器件基礎(chǔ)上發(fā)展起來的。同以往的PAL、GAL相比，F(xiàn)PGA/CPLD的規(guī)模比較大，適合于時序、組合等邏輯電路的應(yīng)用。它可以替代幾十甚至上百塊通用IC芯片。這種芯片具有可編程和實(shí)現(xiàn)方案容易改動等特點(diǎn)。由于芯片內(nèi)部硬件連接關(guān)系的描述可以存放在磁盤、ROM、PROM、或E
- 關(guān)鍵字： FPGA CPLD 分頻器
基于FPGA的高分辨率視頻圖像處理的SDRAM控制器設(shè)計
- 本文介紹了一種基于FPGA的用于高分辨率視頻圖像處理的SDRAM控制器的設(shè)計方法。通過設(shè)置SDRAM的工作狀態(tài)，使其工作在猝發(fā)模式。在視頻時序信號控制下，用多行連續(xù)的SDRAM存儲空間，存取視頻數(shù)據(jù)。并在數(shù)據(jù)接口部分增加FIFO，緩存一行視頻，在像素時鐘控制下，實(shí)現(xiàn)視頻數(shù)據(jù)實(shí)時的存儲和讀取。通過改變相關(guān)參數(shù)，能對所有VESA分辨率視頻流進(jìn)行操作。具有通用性強(qiáng)、系統(tǒng)復(fù)雜度低、可靠性高、可擴(kuò)展等特點(diǎn)。在某型號的機(jī)載大屏顯示器系統(tǒng)中，用該SDRAM控制器實(shí)現(xiàn)了圖像的翻轉(zhuǎn)等功能，也驗證了該控制器的實(shí)用性。
- 關(guān)鍵字： FPGA SDRAM 高分辨率
一種基于CPLD的電梯運(yùn)行控制器設(shè)計
- 1引言 隨著社會的發(fā)展。使用電梯越來越普遍，已從原來只在商業(yè)大廈、賓館過渡到在辦公室、居民樓等多種建筑中，并且對電梯功能的要求也不斷提高，其相應(yīng)控制方式也在不斷發(fā)生變化。電梯的微機(jī)化控制主要有：PLC控制、單板機(jī)控制、單片機(jī)控制、單微機(jī)控制、多微機(jī)控制和人工智能控制等。隨著EDA技術(shù)的快速發(fā)展，PLD器件已廣泛應(yīng)用于電子設(shè)計與控制的各個方面。這里使用CPLD器件，采用VHDL語言設(shè)計一個16樓層單個載客箱的電梯控制系統(tǒng)，此控制系統(tǒng)具有使用安全可靠，功能全面的特點(diǎn)，方便人們生活。 2系統(tǒng)總體
- 關(guān)鍵字： CPLD VHDL 電梯
基于CPLD的LED點(diǎn)陣顯示控制器設(shè)計
- 場可編程器件(FPGA和CPLD)等ISP器件無須編程器，利用器件廠商提供的編程套件，采用自頂而下的模塊化設(shè)計方法，使用原理圖或硬件描述語言(VHDL)等方法來描述電路邏輯關(guān)系，可直接對安裝在目標(biāo)板上的器件編程。它易學(xué)、易用、簡化了系統(tǒng)設(shè)計，減小了系統(tǒng)規(guī)模，縮短設(shè)計周期，降低了生產(chǎn)設(shè)計成本，從而給電子產(chǎn)品的設(shè)計和生產(chǎn)帶來了革命性的變化。 1、系統(tǒng)結(jié)構(gòu)及工作原理 LED點(diǎn)陣顯示控制的傳統(tǒng)方式是采用單片機(jī)或系統(tǒng)機(jī)作為CPU來實(shí)現(xiàn)，當(dāng)系統(tǒng)顯示的信息比較多時，由于單片機(jī)的輸入/輸出端口(I/O)有
- 關(guān)鍵字： CPLD LED 點(diǎn)陣
基于FPGA狀態(tài)機(jī)和片上總線的CompactPCI異步串口板設(shè)計方案
- 摘要：首先簡要介紹了CompactPCI異步串口板的通常設(shè)計方法，并且提出了這些方法的不足之處，重點(diǎn)闡述了基于FPGA狀態(tài)機(jī)和片上總線的新設(shè)計方案，以及該方案的技術(shù)優(yōu)勢，隨后公布了基于該方案的異步串口板達(dá)到的性能指標(biāo)。通過比較有關(guān)應(yīng)答延遲的試驗數(shù)據(jù)，提出了基于FPGA狀態(tài)機(jī)和基于DSP處理器的異步串口板卡存在明顯的處理速度差異問題，并基于兩種設(shè)計方案，解釋了形成差異的原因。最后提出了FPGA狀態(tài)機(jī)對外部總線存儲器或端口的訪問管理性能大幅超越了任何一款DSP處理器的觀點(diǎn)，并對同行提出了類似研發(fā)項目的設(shè)計建議
- 關(guān)鍵字： FPGA DSP 片上總線 CompactPCI 異步串口板 201407
基于CPLD的數(shù)據(jù)采集與顯示接口設(shè)計及實(shí)現(xiàn)
- 0 引 言 CPLD稱為復(fù)雜可編程邏輯設(shè)計芯片，它是大規(guī)模可編程器件，具有高集成度、高可靠性、高速度的特點(diǎn)。CPLD是利用EDA技術(shù)進(jìn)行電子系統(tǒng)設(shè)計的載體。硬件描述語言是EDA技術(shù)進(jìn)行電子系統(tǒng)設(shè)計的主要表達(dá)手段，VHDL語言是常用的硬件描述語言之一;軟件開發(fā)工具是利用EDA技術(shù)進(jìn)行電子系統(tǒng)設(shè)計的智能化的自動化設(shè)計工具，常用開發(fā)工具有QuartusII，Ispexpert，F(xiàn)oundation等。CPLD以高速、高可靠性、串并行工作方式等特點(diǎn)在電子設(shè)計中廣泛應(yīng)用。它打破了軟硬件之間的界限，加速了產(chǎn)
- 關(guān)鍵字： CPLD MCS-51 數(shù)據(jù)采集
基于ARM+CPLD的實(shí)時圖像采集模塊設(shè)計
- 摘要：介紹了32位嵌入式系統(tǒng)及應(yīng)用現(xiàn)狀，指出了在嵌入式實(shí)時圖像采集的重要性和存在問題，提出了一種基于嵌入式系統(tǒng)總線接口的實(shí)時圖像采集模塊的實(shí)現(xiàn)方法。 關(guān)鍵詞：32位嵌入式系統(tǒng) CMOS攝像 實(shí)時圖像采集 1 32位嵌入式系統(tǒng)及其應(yīng)用現(xiàn)狀 1.1 32位嵌入式系統(tǒng)概述 嵌入式系統(tǒng)是后PC時代的主導(dǎo)，當(dāng)?shù)投说那度胧较到y(tǒng)無法滿足信息化、智能化、網(wǎng)絡(luò)化時代的更高要求時，32位嵌入式系統(tǒng)應(yīng)運(yùn)而生。32位嵌入式系統(tǒng)是電腦硬件與軟件的有機(jī)結(jié)合。嵌入式設(shè)計的目的在于滿足某種特殊的功能。嵌入式系
- 關(guān)鍵字： ARM CPLD CMOS攝像
基于MicroBlaze的嵌入式串口服務(wù)器的設(shè)計實(shí)現(xiàn)，提供軟硬件架構(gòu)、原理
- 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
- 關(guān)鍵字： MicroBlaze 嵌入式串口服務(wù)器 FPGA Spartan-3
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