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fpga+mpu+mcu 文章 最新資訊

采用EEPROM對大容量FPGA芯片數(shù)據(jù)實現(xiàn)串行加載

  •   自大規(guī)模現(xiàn)場可編程邏輯器件問世以來,先后出現(xiàn)了兩類器件,一類是基于SRAM體系結(jié)構(gòu)的FPGA系列,如XILINX公司的4000系列和最新的Virtex系列;另一類是基于faxtFLASH技術(shù)的CPLD器件,如XILINX公司的9500系列和Lattice公司的ispLSxx系列芯片。FPGA具有容量大、設(shè)計資源豐富、片內(nèi)ROM及RAM設(shè)計靈活等特點1,但是它們需要在每次上電時進(jìn)行數(shù)據(jù)加載。目前實現(xiàn)加載的方法有以下三種:①采用PROM并行加載;②采用專用SROM串行加載;③采用單片機控制實現(xiàn)加載。  
  • 關(guān)鍵字: FPGA  XILINX  CPLD  數(shù)據(jù)加載  EEPROM  

客車電控空氣懸架系統(tǒng)研究及其發(fā)展趨勢

基于USB的ARINC429總線接口模塊設(shè)計

  •   引言    ARINC429總線由美國航天無線電設(shè)備公司所資助,是廣泛應(yīng)用于當(dāng)前航空電子設(shè)備中的一種數(shù)據(jù)總線傳輸標(biāo)準(zhǔn)。與傳統(tǒng)的航空電子設(shè)備間的模擬傳輸相比,ARINC429總線具有抗干擾能力強、傳輸精度高、傳輸線路少以及成本低等優(yōu)點。ARINC數(shù)據(jù)總線協(xié)議規(guī)定一個數(shù)據(jù)由32位組成,采用雙極性歸零碼,以12.5Kb/s或100Kb/s碼速率傳輸。本設(shè)計利用USB即插即用、FPGA可靈活配置等特點,設(shè)計了基于USB總線的ARINC429總線接口模塊。   接口模塊總體設(shè)計結(jié)構(gòu)   接口
  • 關(guān)鍵字: 接口  FPGA  USB  總線  

基于AD9957的USB側(cè)音測距信號發(fā)生器設(shè)計

  •   0 引言   隨著我國航天技術(shù)的不斷進(jìn)步,深空測距技術(shù)受到越來越多的關(guān)注。在深空測距系統(tǒng)中,中頻信號發(fā)生器對系統(tǒng)性能有著重要的意義。在USB(統(tǒng)一S頻段)系統(tǒng)中,原有的模擬電路實現(xiàn)的發(fā)射模塊存在性能不完善、輸入動態(tài)范圍小、可控性能差、不能適應(yīng)中心頻率大范圍變化、體積大等問題,為了解決上述問題,可在一個標(biāo)準(zhǔn)化通用數(shù)字調(diào)制信號發(fā)生器的平臺上,通過外圍的控制電路,實現(xiàn)對載波中心頻率、輸出功率、調(diào)相指數(shù)、測距音通/斷控制等參數(shù)的改變。   以軟件無線電思想為核心,基于PLD(可編程邏輯器件)的通用調(diào)制信號
  • 關(guān)鍵字: 測距  PLD  USB  D/A  FPGA  

飛思卡爾動力總成微控制器提供排放控制 抗擊全球變暖

  •   為了減少引發(fā)溫室效應(yīng)及全球變暖的汽車排放問題,飛思卡爾半導(dǎo)體現(xiàn)已在32位汽車微控制器(MCU)系列中引入集成的排放控制技術(shù)。與飛思卡爾其它動力總成微控制器類似,這些MCU幫助減少二氧化碳廢氣,為新興市場提供經(jīng)濟(jì)高效且精密的引擎控制設(shè)計。   飛思卡爾是汽車半導(dǎo)體領(lǐng)域排名第一的供應(yīng)商,擁有30多年的汽車行業(yè)經(jīng)驗。飛思卡爾技術(shù)在絕大多數(shù)新型汽車中得到了應(yīng)用。飛思卡爾的傳感器、模擬產(chǎn)品及8位、16位和32位微控制器系列為先進(jìn)的汽車安全、車身電子、底盤、引擎控制、動力總成、駕駛員信息和遠(yuǎn)程通訊提供智能和互聯(lián)
  • 關(guān)鍵字: 飛思卡爾  半導(dǎo)體  MCU  排放控制  200809  200808  

基于FPGA的自然對數(shù)變換器的設(shè)計與實現(xiàn)

  • 本文利用CORD IC算法在FPGA上實現(xiàn)了自然對數(shù)運算器。實驗結(jié)果表明該對數(shù)運算器的輸出誤差為10-4數(shù)量級,最高頻率可達(dá)到80MHz。該運算器適用于高速大數(shù)據(jù)量的數(shù)據(jù)處理。
  • 關(guān)鍵字: FPGA  對數(shù)運算  CORD IC算法  對數(shù)變換器  200808  

IC業(yè)在拐點生存

  • 分析了IC業(yè)的眾多特點,例如從90nm向65nm、45nm、32nm、22nm等拐點演進(jìn)的困難,以及ESL、DFM拐點,制造是設(shè)計的拐點,F(xiàn)PGA與ASIC之間的拐點等熱門問題。
  • 關(guān)鍵字: EDA  65nm  45nm  22nm  光刻  處理器  FPGA  ASIC  200808  

TI推出具有MCU存儲器收發(fā)器以及USB 控制器的2.4-GHz 片上系統(tǒng)

  •   CC2511x(CC2510x 產(chǎn)品系列的姐妹產(chǎn)品)具有全速 USB 控制器。CC2511x 器件分為 3 個版本(8/16/32kB 快閃存儲器和1/2/4kB RAM 存儲器),除了支持強制端點 0 外,其還可支持 5 個 USB 端點。DMA 控制器可用于在主存儲器和沒有 MCU 干擾的 USB 控制器之間進(jìn)行數(shù)據(jù)傳輸。由于 2.4-GHz 收發(fā)器可支持高達(dá) 500kSPS 的數(shù)據(jù)速率,因此,對于USB 適配器(無線耳機、鍵盤、鼠標(biāo)、Presenter)以及需要與 USB 連接以進(jìn)行固件升級的其
  • 關(guān)鍵字: TI  片上系統(tǒng)  MCU  存儲器  

基于FPGA和AD1836的I2S接口設(shè)計

  • 本文以FPGA為控制單元,完成了AD1836中D/A部分的I2S接口設(shè)計,它在數(shù)字音頻系統(tǒng)的設(shè)計中有一定的參考和實用價值。該設(shè)計已經(jīng)成功運用在某話路特性綜合測試系統(tǒng)中,性能良好。
  • 關(guān)鍵字: FPGA  1836  I2S  AD    

Altera FPGA開發(fā)板為XLoom提供誤碼率測試環(huán)境

  •   進(jìn)一步展示其FPGA靈活性和通用性,Altera公司宣布,XLoom通信公司采用Stratix® II GX FPGA信號完整性開發(fā)套件來提供獨特的誤碼率(BER)測試環(huán)境。和傳統(tǒng)的BER測試設(shè)備相比,Altera基于FPGA的開發(fā)板支持XLoom以更高的性價比來測試芯片級光電互聯(lián)模塊。這一獨特的測試環(huán)境更貼近實際的客戶狀態(tài),同時進(jìn)一步節(jié)省了空間,降低了功耗。   傳統(tǒng)的BER測試儀成本高達(dá)100,000美元,而Stratix II GX FPGA信號完整性開發(fā)套件在這方面的成本節(jié)省了90%
  • 關(guān)鍵字: Altera  FPGA  開發(fā)套件  XLoom  

基于FPGA的空間存儲器的糾錯系統(tǒng)

  •   1、引言   阿爾法磁譜儀(Alpha Magnetic Spectrometer,AMS)實驗室是丁肇中博士領(lǐng)導(dǎo)的由美、俄、德、法、中等16個國家和地區(qū)共300多名科學(xué)家參加的大型國際合作項目。它是國際空間站上唯一大型物理實驗,是人類第一次在太空中精密地測量高能量帶電原子核粒子的實驗。其目的是為尋找反物質(zhì)所組成的宇宙和暗物質(zhì)的來源以及測量宇宙線的來源。   但是對于AMS實驗的空間電子系統(tǒng),同樣會受到高能粒子的襲擊,導(dǎo)致存儲器的內(nèi)容發(fā)生變化,改寫半導(dǎo)體存儲器件的邏輯狀態(tài),導(dǎo)致存儲單元在邏輯&ls
  • 關(guān)鍵字: FPGA  存儲器  AMS  編碼  譯碼  

Actel推出Libero集成開發(fā)環(huán)境 8.4

  •   Actel公司宣布其Libero® 集成開發(fā)環(huán)境 (IDE) 增添全新的功耗優(yōu)化和增強的設(shè)計創(chuàng)建功能。全新的Libero IDE 8.4針對基于 Flash的IGLOO®、IGLOO PLUS和 ProASIC®3L現(xiàn)場可編程門陣列 (FPGA),提供由1.14V至 1.575V的FPGA內(nèi)核工作電壓范圍,為設(shè)計人員提供額外的內(nèi)核電壓選擇,以實現(xiàn)更低的功耗。新版本Libero IDE改進(jìn)了SmartPower功耗分析工具,便于比較同一設(shè)計的多種設(shè)計實現(xiàn)和器件不同工作條件下的狀況
  • 關(guān)鍵字: Actel  IDE  Libero  FPGA  集成開發(fā)環(huán)境  

靈活的MCU架構(gòu)實現(xiàn)產(chǎn)品的輕松升級

  •   隨著市場競爭的日益激烈,如何使新產(chǎn)品更快投入市場,成為工程設(shè)計人員越來越關(guān)注的問題。在推出滿足更高性能需求的升級產(chǎn)品時,原有設(shè)計的靈活性成為了關(guān)鍵。高度靈活的設(shè)計可以有效縮短設(shè)計周期,使新產(chǎn)品快速進(jìn)入市場,還可以實現(xiàn)投入最小化,從而獲得更高的利潤。   兼容性降低升級投入   升級產(chǎn)品往往應(yīng)具有更高的性能、集成度、更低的功耗和更豐富的外設(shè)。如何以最少的投入滿足這些新的需求呢?如果新產(chǎn)品的設(shè)計可以充分利用現(xiàn)有外圍設(shè)備的知識產(chǎn)權(quán)(IP),那么在現(xiàn)有產(chǎn)品上的投資在移植時就會得到保持,外圍設(shè)備驅(qū)動軟件仍可
  • 關(guān)鍵字: MCU  升級  架構(gòu)  內(nèi)核  

Altera在40nm:抖動、信號完整性、功耗和工藝達(dá)到最佳的收發(fā)器

  •   1. 引言   在摩爾定律的推動下,半導(dǎo)體行業(yè)技術(shù)發(fā)展非常迅速,集成電路晶體管數(shù)量每兩年翻倍,對器件或者系統(tǒng)之間的通信鏈路數(shù)據(jù)速率要求越來越高。而工藝節(jié)點的減小又促進(jìn)了摩爾定律。減小體積可以在單位邏輯中容納更多的功能,提高工作速率、邏輯密度和集成度,同時降低了。通常采用高級設(shè)計方法和工藝技術(shù)來提高數(shù)據(jù)速率,支持固網(wǎng)和無線通信、計算機、存儲、軍事應(yīng)用以及廣播電子系統(tǒng)發(fā)送接收大量數(shù)據(jù),以滿足不斷增長的數(shù)據(jù)傳輸和帶寬要求。   微處理器和FPGA等前沿產(chǎn)品采用了65-nm工藝技術(shù)。這些產(chǎn)品的后續(xù)型號將采
  • 關(guān)鍵字: 半導(dǎo)體  FPGA  微處理器  I/O  

微控制器發(fā)展、過去和將來

  •   對于選擇微控制器進(jìn)行設(shè)計的系統(tǒng)設(shè)計師來說,可獲得的大量的不同型號的MCU會讓選型工作變得復(fù)雜。SiliconLabs已經(jīng)發(fā)布了工作電壓低至0.9V的一款8位MCU,德州儀器有許多款針對16位MSP430的低功耗應(yīng)用,英飛凌和飛思卡爾有針對汽車應(yīng)用的多款MCU方案,而Atmel的AVR單片機和Microchip的PIC系列單片機一直在推陳出新,新的32位ARM核Cortex-M3處理器已經(jīng)發(fā)布,古老的8位8051核還是在不同微控制器中占領(lǐng)主流地位,而市場老大瑞薩可以針對多種應(yīng)用領(lǐng)域提供方案。  
  • 關(guān)鍵字: 微控制器  MCU  低功耗  SoC  flash  
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