begin

if(clk1event andclk1=1)then

page=page+1;

endif;

a(6downto3)=conv_s td_logic_vector(page,4);

endproces s;

ad= ZZZZZZZZ;oe = 0;

memcs = 0;rd= 0;

wr= 1;selmled=1;cs0809= 1;

a(15downto7)=100000000;

endled_arch;

3 實驗驗證

通過使用EDA工具軟件MAX+PLUSⅡ中的仿真器， 對通過編譯的字符滾動顯示器的VHDL設(shè)計進行了模擬仿真驗證， 證明FPGA的內(nèi)核硬件工作良好。此外， 將VHDL 程序下載到由上海航虹高科技公司生產(chǎn)的EDA實驗箱上后， 能正確顯示存放于EPROM 中的字符。從而說明了在硬件系統(tǒng)中字符滾動和顯示掃描情況也均正常， 驗證了設(shè)計的正確性。

4 結(jié)束語

本設(shè)計為顯示單個字符系統(tǒng)， 若要同時顯示多個字符時， 可以加入多個LED 點陣即可。同時采用外部譯碼器時， 可以控制的字符數(shù)將大大增加， 但須注意時鐘CLK的頻率需要提高， 以眼睛看到整個字符的不閃爍為基準。此外， 由于FPGA的驅(qū)動能力有限， 當點陣LED 顯示亮度不夠時， 需要為LED 點陣添加驅(qū)動電路( 如高壓大電流達林頓陣列集成電路) 以提高的LED顯示亮度。