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fsp:fpga-pcb 文章 最新資訊

Altera Stratix II FPGA達到軍用溫度級標(biāo)準(zhǔn)

  • 　　Altera公司宣布，其90nm高性能Stratix®II FPGA器件系列所有封裝型號均達到軍用溫度級標(biāo)準(zhǔn)。 　　Altera的Stratix和Stratix®II器件能夠可靠地工作在商用、工業(yè)和軍用溫度級范圍內(nèi)，符合嚴(yán)格的規(guī)范標(biāo)準(zhǔn)。公司將工業(yè)級Stratix®II器件的工作范圍擴展到-55
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pcb電路抗干擾

  • 在電子系統(tǒng)設(shè)計中，為了少走彎路和節(jié)省時間，應(yīng)充分考慮并滿足抗干擾性 的要求，避免在設(shè)計完成后再去進行抗干擾的補救措施。形成干擾的基本要素有三個： （1）干擾源，指產(chǎn)生干擾的元件、設(shè)備或信號，用數(shù)學(xué)語言描述如下：du/dt， di/dt大的地方就是干擾源。如：雷電、繼電器、可控硅、電機、高頻時鐘等都可 能成為干擾源。 （2）傳播路徑，指干擾從干擾源傳播到敏感器件的通路或媒介。典型的干擾傳 播路徑是通過導(dǎo)線的傳導(dǎo)和空間的輻射。 （3）敏感器件，指容易被干擾的對象。如：A/D、D/A變換器，單片機，數(shù)字IC，
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Cadence的Global Route Environment技術(shù)為PCB設(shè)計制訂新標(biāo)準(zhǔn)

  • 　　Cadence設(shè)計系統(tǒng)公司發(fā)布了面向Cadence® Allegro® PCB設(shè)計的Global Route Environment技術(shù)。這一革命性的技術(shù)結(jié)合了圖形化的互連流規(guī)劃架構(gòu)和層次化全局布線引擎，為PCB設(shè)計人員提供了自動、智能的規(guī)劃和布線環(huán)境。作為首個將智能自動化引入前所未有領(lǐng)域的自動布線解決方案，Global Route Environment 技術(shù)代表了一次意義重大的飛躍，并建立了一種全新的PCB設(shè)計規(guī)
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Cadence為PCB設(shè)計制訂新標(biāo)準(zhǔn)Global Route Environment

  • 　　Cadence設(shè)計系統(tǒng)公司今日發(fā)布了面向Cadence® Allegro® PCB設(shè)計的Global Route Environment技術(shù)。這一革命性的技術(shù)結(jié)合了圖形化的互連流規(guī)劃架構(gòu)和層次化全局布線引擎，為PCB設(shè)計人員提供了自動、智能的規(guī)劃和布線環(huán)境。作為首個將智能自動化引入前所未有領(lǐng)域的自動布線解決方案，Global Route Environment 技術(shù)代表了一次意義重大的飛躍，并建立了一種全新的PCB設(shè)計規(guī)范。 　　該技術(shù)問世之前，PCB設(shè)計人員要花費幾周或幾個月的時間
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基于FPGA的雷達脈沖壓縮系統(tǒng)設(shè)計

  • 脈沖壓縮技術(shù)是指對雷達發(fā)射的寬脈沖信號進行調(diào)制(如線性調(diào)頻、非線性調(diào)頻、相位編碼)，并在接收端對回波寬脈沖信號進行脈沖壓縮處理后得到窄脈沖的實現(xiàn)過程。脈沖壓縮有效地解決了雷達作用距離與距離分辨率之間的矛盾，可以在保證雷達在一定作用距離下提高距離分辨率。 線性調(diào)頻信號的脈沖壓縮 脈沖壓縮的過程是通過對接收信號s(t)與匹配濾波器的脈沖響應(yīng)h(t)求卷積的方法實現(xiàn)的。而處理數(shù)字信號時，脈壓過程是通過對回波序列s(n)與匹配濾波器的脈沖響應(yīng)序列h(n)求卷積來實現(xiàn)的。匹配濾波器的輸出為： &nbs
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設(shè)計靈活、高性能的嵌入式系統(tǒng)

  • 您的下一個嵌入式系統(tǒng)設(shè)計項目需要的是什么：是可以讓您輕松地定制設(shè)計的靈活的系統(tǒng)元件，還是額外的性能空間，以便您在設(shè)計周期中加入更多的功能？為什么要讓自己承受過度的開發(fā)壓力，并且只能舍此取彼呢？軟處理和IP定制能夠為同時確保靈活性和高性能提供了最佳的解決方案，將定制設(shè)計的概念和協(xié)處理帶來的性能加速結(jié)合起來。 分立處理器只能提供固定的外設(shè)選擇，并且一些性能受到時鐘頻率的限制。在嵌入式 FPGA所提供的平臺上，您可以創(chuàng)建一個具有大量定制處理器核、靈活的外設(shè)、甚至協(xié)處理減負引擎的系統(tǒng)?，F(xiàn)在，您能設(shè)計出一個不折
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Altera發(fā)布Quartus II設(shè)計軟件7.0支持Cyclone III FPGA

  • 　　Altera公司推出了Quartus® II軟件7.0，其訂購版和免費的網(wǎng)絡(luò)版均支持65nm Cyclone® III FPGA全系列產(chǎn)品。網(wǎng)絡(luò)版軟件對Cyclone III器件的支持表明，在所有FPGA供應(yīng)商免費軟件包中，該軟件能夠支持密度最大的器件。與前一系列相比，Quartus II軟件的先進技術(shù)和效能特性使設(shè)計人員能夠充分挖掘Cyclone III系列的潛能，器件功耗降低了50％，比最相近的低成本FPGA競爭
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基于DSP的高速PCB抗干擾設(shè)計

  • 引  言 隨著DSP(數(shù)字信號處理器)的廣泛應(yīng)用，基于DSP的高速信號處理PCB板的設(shè)計顯得尤為重要。在一個DSP系統(tǒng)中，DSP微處理器的工作頻率可高達數(shù)百MHz，其復(fù)位線、中斷線和控制線、集成電路開關(guān)、高精度A／D轉(zhuǎn)換電路，以及含有微弱模擬信號的電路都非常容易受到干擾；所以設(shè)計開發(fā)一個穩(wěn)定的、可靠的DSP系統(tǒng)，抗干擾設(shè)計非常重要。 干擾即干擾能量使接收器處在不希望的狀態(tài)。干擾的產(chǎn)生分兩種：直接的(通過導(dǎo)體、公共阻抗耦合等)和間接的(通過串?dāng)_或輻射耦合)。很多電器發(fā)射源，如光照、電機和日光
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Actel和ARM聯(lián)合開發(fā)專為FPGA應(yīng)用而優(yōu)化的高性能32位處理器

  • Actel公司進一步擴展其工業(yè)標(biāo)準(zhǔn)處理器系列，宣布推出ARM Cortex-M1處理器，這是與ARM公司聯(lián)合開發(fā)的小型高性能32位軟件微處理器核，專為在FPGA中的實施而優(yōu)化。不象許多業(yè)界領(lǐng)先的處理器核通常需要支付授權(quán)費用和權(quán)益金，Actel的客戶能夠免費獲得先進的ARM處理器技術(shù)如Cortex-M1，適用于廣闊的市場領(lǐng)域。 免費提供的Cortex-M1可與Actel以Flash為基礎(chǔ)且可運行M1核的Actel Fusion FPGA和ProASIC3 FPGA同用，為設(shè)計人員提供編程靈活性和系統(tǒng)級集成，
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Altera Announces Quartus II Design Software Version 7.0 With Support for Cyclone III FPGAs

  • Web Edition Offers Free Design Support for Industry’s Highest-Density Low-Cost FPGAsBeijing, March 20, 2007—Altera Corporation (NASDAQ:ALTR) today introduced Quartus II software version 7.0 with support for the entire 65-nm Cyclone? III FPGA family in bot
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SYNPLICITY為ALTERA的CYCLONE III FPGA提供低成本優(yōu)勢

  • 領(lǐng)先的半導(dǎo)體設(shè)計與驗證軟件供應(yīng)商 Synplicity 公司日前宣布即將為 Altera 公司的低成本 Cyclone III FPGA 提供支持。Synplicity 對其 Synplify Pro? FPGA 綜合軟件進行了優(yōu)化，從而提供了更為快速而簡便易用的解決方案，使 Cyclone III 客戶能夠迅速實現(xiàn)時序目標(biāo)，并通過優(yōu)化面積利用來節(jié)約成本。這兩家公司保持長期的合作伙伴關(guān)系，并在產(chǎn)品開發(fā)過程中密切配合，從而快速實現(xiàn)了Synplify Pro 軟件的優(yōu)化。根據(jù)雙方合作，Altera 在產(chǎn)品公開
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Altera發(fā)售業(yè)界首款65nm低成本FPGA

  • Cyclone III FPGA前所未有地同時實現(xiàn)了低功耗、低成本和高性能，適合無線通信、視頻、顯示等其他對成本敏感的應(yīng)用。 2007年3月20號，北京——Altera公司今天宣布，開始發(fā)售業(yè)界的首款65nm低成本FPGA——Cyclone III系列。Cyclone III FPGA比競爭FPGA的功耗低75％，含有5K至120K邏輯單元(LE)，288個數(shù)字信號處理(DSP)乘法器，存儲器達到4Mbits。Cyclone III系列比前一代產(chǎn)品每邏輯單元成本降低20％，使設(shè)計人員能夠更多地在成本敏感
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ARM發(fā)布首款專門針對FPGA而優(yōu)化的處理器，擴展Cortex系列

  • 日前，ARM公司今天發(fā)布了第一款專門針對FPGA應(yīng)用而優(yōu)化的ARM? Cortex?-M1處理器。ARM Cortex-M1處理器擴展了ARM Cortex處理器系列，可幫助OEM廠商在一個通用架構(gòu)下對不同性能需求進行標(biāo)準(zhǔn)化。Actel作為一家核心合作伙伴已與ARM緊密合作，并成為首個獲得授權(quán)可為其FPGA客戶提供Cortex-M1處理器的公司。 2007年4月2日至5日在美國加利福尼亞州圣何塞舉行的嵌入式系統(tǒng)大會（Embedded Systems Conference）上， ARM和Actel將共同展
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為何要將PCB文件轉(zhuǎn)換為GERBER文件和鉆孔數(shù)據(jù)后交PCB廠制板

  • 　　大多數(shù)工程師都習(xí)慣于將PCB文件設(shè)計好后直接送PCB廠加工，而國際上比較流行的做法是將PCB文件轉(zhuǎn)換為GERBER文件和鉆孔數(shù)據(jù)后交PCB廠，為何要“多此一舉”呢？　　因為電子工程師和PCB工程師對PCB的理解不一樣，由PCB工廠轉(zhuǎn)換出來的GERBER文件可能不是您所要的，如您在設(shè)計時將元件的參數(shù)都定義在PCB文件中，您又不想讓這些參數(shù)顯示在 PCB成品上，您未作說明，PCB廠依葫蘆畫瓢將這些參數(shù)都留在了PCB成品上。這只是一個例子。若您自己將PCB文件轉(zhuǎn)換成GERBER文件就可避免此類事件發(fā)生?！　?/li>
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PCB前處理導(dǎo)致之制程問題發(fā)生原因討論

  • 1. PCB制程上發(fā)生的問題千奇百怪, 而制程工程師往往擔(dān)任起法醫(yī)-驗尸責(zé)任(不良成因分析與解決對策). 故發(fā)起此討論題, 主要目的為以設(shè)備區(qū)逐一討論分上包含人, 機, 物, 料, 條件上可能會導(dǎo)致產(chǎn)生的問題, 希望大家一起參與提出自己意見及看法.　　　　2. 會使用到前處理設(shè)備的制程, 例如:內(nèi)層前處理線, 電鍍一銅前處理線, D/F, 防焊(阻焊)...等等.　　　　3. 以硬板PCB 防焊(阻焊)前處理線為例(各廠商不同而有差異): 刷磨*2組->水洗->酸洗->水洗->冷風(fēng)
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