fsp:fpga-pcb 文章最新資訊

Actel FPGA 協(xié)助LYYN AB的技術(shù)平臺(tái)提高清晰度

Actel 公司宣布專業(yè)從事視頻增強(qiáng)技術(shù)的瑞典LYYN AB公司已經(jīng)利用Actel的ProASIC3系列現(xiàn)場(chǎng)可編程門陣列 (FPGA) 器件開發(fā)出軟件和硬件視頻處理平臺(tái)，此舉進(jìn)一步顯示了低功耗單芯片F(xiàn)PGA技術(shù)所具備的先進(jìn)創(chuàng)新性。這個(gè)解決方案提高了視頻錄像的清晰度，可在雪、霧、水底淤泥和黑暗環(huán)境中提供更好的可見度。LYYN的產(chǎn)品主要用于遙控操作車輛 (ROV) 和飛機(jī) (UAV) 以及便攜式設(shè)備如水底攝像機(jī)和先進(jìn)的監(jiān)視系統(tǒng)等。
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艾科瑞德推出最新的基于DSP+FPGA軟件無(wú)線電應(yīng)用解決方案

　　北京艾科瑞德科技有限公司日前宣布推出面向軟件無(wú)線電（Software Defined Radio,SDR）應(yīng)用的解決方案—FFT-SDR-V4。由于采用了美國(guó)德州儀器公司（Texas Instruments，簡(jiǎn)稱“TI”）最高運(yùn)算能力的DSP（TMS320C6416, 1G）和Xinlinx高容量的FPGA (2000萬(wàn)門)，解決了軟件無(wú)線電發(fā)展中的瓶頸技術(shù)—信號(hào)處理的運(yùn)算能力問題?！　∷^軟件無(wú)線電，就是采用數(shù)字信號(hào)處理技術(shù)，在可編程控制的通用硬件平臺(tái)上，利用軟件來定義實(shí)現(xiàn)無(wú)線電臺(tái)的各部分功能：包括
關(guān)鍵字：艾科瑞德 DSP FPGA 無(wú)線電嵌入式消費(fèi)電子

PCB市場(chǎng)規(guī)模不斷擴(kuò)大生產(chǎn)重心偏移亞洲

據(jù)位于紐約的市場(chǎng)研究公司VisantStrategies表示，印制電路板(PCB)市場(chǎng)將在2007年達(dá)到500億美元，并將在2012年增長(zhǎng)到760億美元。亞太地區(qū)有望拓展PCB生產(chǎn)規(guī)模，從而使該地區(qū)的PCB收入在2007～2012年間增長(zhǎng)60%以上，而其它地區(qū)的PCB收入則相應(yīng)下降。其它地區(qū)可能繼續(xù)作為出色的低產(chǎn)量專用PCB生產(chǎn)中心。 “挑戰(zhàn)源于設(shè)計(jì)和制造更小更復(fù)雜的板、滿足芯片中越來越
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基于DSP Builder的DDS設(shè)計(jì)及其FPGA實(shí)現(xiàn)

直接數(shù)字合成器，是采用數(shù)字技術(shù)的一種新型頻率合成技術(shù)，他通過控制頻率、相位增量的步長(zhǎng)，產(chǎn)生各種不同頻率的信號(hào)。他具有一系列的優(yōu)點(diǎn)；較高的頻率分辨率；可以實(shí)現(xiàn)快速的頻率切換；在頻率改變時(shí)能夠保持相位的連續(xù)；很容易實(shí)現(xiàn)頻率、相位和幅度的數(shù)控調(diào)制等。目前可采用專用芯片或可編程邏輯芯片實(shí)現(xiàn)DDS[1]，專用的DDS芯片產(chǎn)生的信號(hào)波形、功能和控制方式固定，常不能滿足具體需要[2]?？删幊踢壿嬈骷哂衅骷?guī)模大、工作速度快及可編程的硬件特點(diǎn)，并且開發(fā)周期短，易于升級(jí)，因?yàn)榉浅＿m合用于實(shí)現(xiàn)DDS。　　1 DDS的
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基于FPGA的LDPC編碼器設(shè)計(jì)與實(shí)現(xiàn)

引言　　低密度奇偶校驗(yàn)（Low Density Parity Check Code，LDPC）碼是一類具有稀疏校驗(yàn)矩陣的線性分組碼，不僅有逼近Shannon限的良好性能，而且譯碼復(fù)雜度較低, 結(jié)構(gòu)靈活，是近年信道編碼領(lǐng)域的研究熱點(diǎn)，目前已廣泛應(yīng)用于深空通信、光纖通信、衛(wèi)星數(shù)字視頻和音頻廣播等領(lǐng)域。LDPC碼已成為第四代通信系統(tǒng)(4G)強(qiáng)有力的競(jìng)爭(zhēng)者，而基于LDPC碼的編碼方案已經(jīng)被下一代衛(wèi)星數(shù)字視頻廣播標(biāo)準(zhǔn)DVB-S2采納。　　編碼器實(shí)現(xiàn)指標(biāo)分析　　作為前向糾錯(cuò)系統(tǒng)的重要部分，設(shè)計(jì)高速率低復(fù)
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基于雙Nios II的紅外圖像實(shí)時(shí)Otsu局部遞歸分割算法設(shè)計(jì)

摘要：針對(duì)傳統(tǒng)Otsu局部遞歸分割方法很難實(shí)時(shí)實(shí)現(xiàn)的局限性，提出了一種適合現(xiàn)場(chǎng)可編程門陣列(FPGA)中Nios II軟核處理器實(shí)現(xiàn)的快速Otsu局部遞歸分割算法，該算法的思路是把一次Otsu分割得到的目標(biāo)區(qū)域作為新的圖像再進(jìn)行一次Otsu分割，得到的結(jié)果作為最終分割閾值．利用并行Nios II和VHDL實(shí)現(xiàn)的硬件加速邏輯協(xié)同設(shè)計(jì)保證算法的實(shí)時(shí)實(shí)現(xiàn)。實(shí)驗(yàn)結(jié)果表明，在不同的背景下，利用本文設(shè)計(jì)能夠?qū)崟r(shí)穩(wěn)定地對(duì)目標(biāo)分割提取，具有較好的魯棒性。關(guān)鍵字：FPGA&nb
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基于CNN的紅外圖像預(yù)處理系統(tǒng)的研究與設(shè)計(jì)

摘要：本文設(shè)計(jì)了一個(gè)以FPGA為核心處理器實(shí)現(xiàn)紅外視頻圖像數(shù)字預(yù)處理的系統(tǒng)，利用Altera公司提供的DE2開發(fā)板，把系統(tǒng)大部分的功能模塊集成在一片F(xiàn)PGA 上，大大優(yōu)化了整個(gè)系統(tǒng)的性能。該方案采用Altera公司推出的低成本、高密度的Cyclone Ⅱ系列FPGA，提高了系統(tǒng)的設(shè)計(jì)靈活性。細(xì)胞神經(jīng)網(wǎng)絡(luò)IP核的開發(fā)，充分利用了細(xì)胞神經(jīng)網(wǎng)絡(luò)在圖像處理方面的優(yōu)勢(shì)，提高了整個(gè)系統(tǒng)的處理效率。實(shí)現(xiàn)了細(xì)胞神經(jīng)網(wǎng)絡(luò)的一種高效數(shù)字實(shí)現(xiàn)方案,并且采用分布式算法可以提供更高的運(yùn)行速度。關(guān)鍵詞　邊緣檢測(cè)；細(xì)胞神經(jīng)網(wǎng)絡(luò)；FP
關(guān)鍵字：消費(fèi)電子邊緣檢測(cè) 細(xì)胞神經(jīng)網(wǎng)絡(luò) FPGA 嵌入式消費(fèi)電子

基于FPGA的星地信道模擬系統(tǒng)的研究與設(shè)計(jì)

1 引言　　衛(wèi)星移動(dòng)通信系統(tǒng)所能提供的業(yè)務(wù)的可行性與質(zhì)量在很大程度上受到衛(wèi)星與移動(dòng)終端間信道特性的影響。研究這些影響，就需要在一定傳播特性下進(jìn)行實(shí)驗(yàn)。由于條件所限，不可能進(jìn)行實(shí)時(shí)現(xiàn)場(chǎng)實(shí)驗(yàn)，這在技術(shù)和經(jīng)費(fèi)上都存在問題，所以采用一個(gè)能反映實(shí)際星地鏈路特性的信道模擬系統(tǒng)可以降低一些難度太大和成本超高的測(cè)試試驗(yàn)的難度和成本，是一個(gè)很好的解決方法。　　1.1 國(guó)內(nèi)外的研究狀況　　目前有很多科研機(jī)構(gòu)和高校進(jìn)行這方面的研究，例如：澳大利亞南澳大學(xué)研制出移動(dòng)衛(wèi)星信道模擬器MSCS-1，該模擬器具有記錄和重
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PCB基材：走向環(huán)保清潔高性能

　　隨著電子設(shè)備向小型化、輕量化、多功能化與環(huán)保型方向發(fā)展，作為其基礎(chǔ)的印刷電路板也相應(yīng)地朝這些方向發(fā)展，而印制板用的材料也該理所當(dāng)然地適應(yīng)這些方面的需要。環(huán)保型材料　　環(huán)保型產(chǎn)品是可持續(xù)發(fā)展的需要，環(huán)保型印制板要求用環(huán)保型材料。對(duì)于印制板的主材料覆銅箔板，按照歐盟RoHS法令禁用有毒害的聚溴聯(lián)苯(PBB)與聚溴聯(lián)苯醚(PBDE)規(guī)定，這涉及到覆銅箔板取消含溴阻燃劑。目前，國(guó)際上先進(jìn)的國(guó)家都已經(jīng)開始大量采用無(wú)鹵素覆銅箔板，而國(guó)內(nèi)無(wú)鹵素覆銅箔板產(chǎn)品僅在含外資的大型企業(yè)開發(fā)成功，許多中小覆銅箔板企
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SVS新多畫面產(chǎn)品Altera Cyclone III FPGA 大顯身手

Altera宣布，Silicon視頻系統(tǒng)(SVS)公司選用了低成本、低功耗Cyclone® III FPGA來生產(chǎn)市場(chǎng)上最緊湊的高性價(jià)比多畫面產(chǎn)品。多畫面產(chǎn)品用于專業(yè)音頻/視頻、安全監(jiān)控和廣播監(jiān)視等需要多幅圖像顯示處理的應(yīng)用中。　　在新的SVS多畫面產(chǎn)品中，Cyclone III FPGA實(shí)現(xiàn)了色彩空間轉(zhuǎn)換、FIFO、時(shí)鐘轉(zhuǎn)換，支持所有的顯示分辨率。在以前的多畫面產(chǎn)品中，實(shí)現(xiàn)這些功能需要采用多個(gè)分立器件。　　作為Altera® Cycl
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單片機(jī)SRAM工藝的FPGA加密應(yīng)用

在現(xiàn)代電子系統(tǒng)設(shè)計(jì)中，由于可編程邏輯器件的卓越性能、靈活方便的可升級(jí)特性，而得到了廣泛的應(yīng)用。由于大規(guī)模高密度可編程邏輯器件多采用SRAM工藝，要求每次上電，對(duì)FPGA器件進(jìn)行重配置，這就使得可以通過監(jiān)視配置的位數(shù)據(jù)流，進(jìn)行克隆設(shè)計(jì)。因此，在關(guān)鍵、核心設(shè)備中，必須采用加密技術(shù)保護(hù)設(shè)計(jì)者的知識(shí)產(chǎn)權(quán)。 1　基于SRAM工藝FPGA的保密性問題通常，采用SRAM工藝的
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PowerPCB電路板設(shè)計(jì)規(guī)范

1 概述　　本文檔的目的在于說明使用PADS的印制板設(shè)計(jì)軟件PowerPCB進(jìn)行印制板設(shè)計(jì)的流程和一些注意事項(xiàng)，為一個(gè)工作組的設(shè)計(jì)人員提供設(shè)計(jì)規(guī)范，方便設(shè)計(jì)人員之間進(jìn)行交流和相互檢查。 2 設(shè)計(jì)流程　　PCB的設(shè)計(jì)流程分為網(wǎng)表輸入、規(guī)則設(shè)置、元器件布局、布線、檢查、復(fù)查、輸出六個(gè)步驟. 2.1 網(wǎng)表輸入　　網(wǎng)表輸入有兩種方法，一種是使用PowerLogic的OLE PowerPCB Connection功能，選擇Send Netlist，應(yīng)用OLE功能，可以隨時(shí)保持原理圖和PCB圖的一致，盡
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PCB行業(yè)持續(xù)增長(zhǎng)，同時(shí)面臨新的挑戰(zhàn)

Visant Strategies最新的研究表明，全球的PCB行業(yè)將從持續(xù)增長(zhǎng)的電子行業(yè)中受益，同時(shí)由于電子行業(yè)快速的發(fā)展和創(chuàng)新也使PCB面臨很多新的挑戰(zhàn)。　　報(bào)告的作者Kaustubha Parkhi說：“PCB行業(yè)和電子和半導(dǎo)體設(shè)備市場(chǎng)緊密地結(jié)合在一起，同時(shí)也很容易受到市場(chǎng)競(jìng)爭(zhēng)和需求變化的影響。現(xiàn)在PCB正受到其所服務(wù)行業(yè)的創(chuàng)新而帶來的挑戰(zhàn)?！?　　PCB所面臨的最大挑戰(zhàn)就是越來越精密和復(fù)雜的設(shè)計(jì)，比如每個(gè)芯片日益增加的引腳數(shù)量、高速數(shù)據(jù)流技術(shù)等等。然而，PCB行業(yè)將繼續(xù)保持增長(zhǎng)
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基于FPGA的DS/CDMA解擴(kuò)解調(diào)模塊設(shè)計(jì)與實(shí)現(xiàn)

在CDMA通信系統(tǒng)中，用于基站信號(hào)轉(zhuǎn)發(fā)的接收機(jī)是一個(gè)核心模塊，一臺(tái)接收機(jī)只是處理一路用戶的解擴(kuò)解調(diào)顯然是不合理的，為了提高接收機(jī)的效率和降低成本，有必要設(shè)計(jì)一種多路CDMA信號(hào)通用解擴(kuò)解調(diào)平臺(tái)。而FPGA具有功能強(qiáng)大，開發(fā)工程投資小，周期短，可反復(fù)編程修改，保密性能好，開發(fā)工具智能化等優(yōu)點(diǎn)，本項(xiàng)目決定采用FPGA作為設(shè)計(jì)平臺(tái)；本文首先建立了CDMA信號(hào)的擴(kuò)頻調(diào)制與解擴(kuò)解調(diào)系統(tǒng)模型，然后提出設(shè)計(jì)這樣一個(gè)多路CDMA信號(hào)通用解擴(kuò)解調(diào)平臺(tái)。該平臺(tái)將保證處理CDMA解擴(kuò)解調(diào)的
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高速DSP系統(tǒng)PCB板的可靠性設(shè)計(jì)

引言　　由于微電子技術(shù)的高速發(fā)展，由IC芯片構(gòu)成的數(shù)字電子系統(tǒng)朝著規(guī)模大、體積小、速度快的方向飛速發(fā)展，而且發(fā)展速度越來越快。新器件的應(yīng)用導(dǎo)致現(xiàn)代EDA設(shè)計(jì)的電路布局密度大，而且信號(hào)的頻率也很高，隨著高速器件的使用，高速DSP(數(shù)字信號(hào)處理) 系統(tǒng)設(shè)計(jì)會(huì)越來越多，處理高速DSP應(yīng)用系統(tǒng)中的信號(hào)問題成為設(shè)計(jì)的重要問題，在這種設(shè)計(jì)中，其特點(diǎn)是系統(tǒng)數(shù)據(jù)速率、時(shí)鐘速率和電路密集度都在不斷增加，其PCB印制板的設(shè)計(jì)表現(xiàn)出與低速設(shè)計(jì)截然不同的行為特點(diǎn)，即出現(xiàn)信號(hào)完整性問題、
關(guān)鍵字：嵌入式系統(tǒng) 單片機(jī) DSP PCB 嵌入式