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基于FPGA的視頻監(jiān)控/安全系統(tǒng)實(shí)現(xiàn)解決方案

視頻監(jiān)控和安全行業(yè)正在經(jīng)歷著一場(chǎng)巨大的變革，正在從傳統(tǒng)的模擬閉路電視攝像機(jī)向基于邏輯的數(shù)字?jǐn)z像機(jī)的方向...
關(guān)鍵字：視頻監(jiān)控安全系統(tǒng) FPGA

基于CYGNAL單片機(jī)和FPGA的舞臺(tái)吊桿控制器的設(shè)計(jì)

　在舞臺(tái)機(jī)械設(shè)備中，吊桿起著重要的傷腦筋。在大型的影劇院，一場(chǎng)演出往往需要調(diào)動(dòng)大量的舞臺(tái)背景，有時(shí)要控制多達(dá)64路的吊桿同時(shí)動(dòng)作。操作人員要在現(xiàn)場(chǎng)不斷變換舞臺(tái)背景，控制室人員要不斷地和現(xiàn)場(chǎng)人員進(jìn)行協(xié)調(diào)，
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基于FPGA的高階QAM調(diào)制器的實(shí)現(xiàn)

　　1 引言　　多電平正交幅度調(diào)制MQAM(Multilevel QuadratureAmplitude Modulation)是一種振幅和相位相結(jié)合的高階調(diào)制方式，具有較高的頻帶利用率和較好的功率利用率。因?yàn)閱为?dú)使甩振幅和相位攜帶信息時(shí)，不能最充
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一種基于FPGA／DSP的靈巧干擾平臺(tái)設(shè)計(jì)與實(shí)現(xiàn)

引言
目前，通信干擾的手段以信號(hào)大功率壓制為主，本質(zhì)上屬于物理層能量干擾，存在效費(fèi)比低，且容易暴露自身目標(biāo)等缺點(diǎn)，而且隨著新的功率控制和信號(hào)處理技術(shù)的應(yīng)用，通信大功率壓制干擾手段的應(yīng)用遇到了瓶頸。
關(guān)鍵字： FPGA DSP 干擾平臺(tái)設(shè)計(jì)

FPGA在激光測(cè)距機(jī)電路檢測(cè)系統(tǒng)中的應(yīng)用

引言
針對(duì)部隊(duì)各類(lèi)激光測(cè)距機(jī)的維修保障，我所研制出了一套便攜式激光測(cè)距機(jī)電路檢測(cè)儀，能實(shí)現(xiàn)對(duì) 85手持式、 88式、88對(duì)海式等五類(lèi)激光測(cè)距機(jī)電路系統(tǒng)的快速檢測(cè)和維修指導(dǎo)，極大地提高了維修效率。由于要完成對(duì)光
關(guān)鍵字： FPGA 激光測(cè)距機(jī) 電路檢測(cè) 系統(tǒng)

設(shè)備廠與半導(dǎo)體、面板廠客戶需建立默契共渡難關(guān)

　　現(xiàn)金為王的觀念是風(fēng)暴下企業(yè)求生之道，凍結(jié)資本支出，遞延設(shè)備訂單，成了常態(tài)，不過(guò)也因?yàn)檫@一連串半導(dǎo)體、面板、PCB及太陽(yáng)能等引發(fā)的設(shè)備凍結(jié)現(xiàn)象，終于使設(shè)備廠與上游客戶關(guān)系失衡的問(wèn)題，浮上臺(tái)面，半導(dǎo)體高層認(rèn)為，雙方不應(yīng)只是買(mǎi)賣(mài)關(guān)系，而應(yīng)該是互相扶持的共生關(guān)系，建立協(xié)商默契，這樣的思維才能讓臺(tái)灣在走向次世代科技發(fā)展，根基更穩(wěn)固。　　一直以來(lái)，臺(tái)灣設(shè)備業(yè)者處于較被動(dòng)的姿態(tài)，在客戶資金緊縮時(shí)，往往設(shè)備采購(gòu)支出，就是首先凍結(jié)的目標(biāo)，從2008年第4季開(kāi)始的設(shè)備訂單遞延潮來(lái)分析，就不難了解，盡管向產(chǎn)業(yè)協(xié)會(huì)或是經(jīng)
關(guān)鍵字：半導(dǎo)體 PCB 太陽(yáng)能

基于嵌入式微處理器和FPGA的高精度測(cè)頻設(shè)計(jì)

基于嵌入式微處理器和FPGA的高精度測(cè)頻設(shè)計(jì), 引言本課題來(lái)源于一個(gè)無(wú)紙記錄儀的項(xiàng)目。在該項(xiàng)目中要求無(wú)紙記錄儀中有一路通道將工業(yè)現(xiàn)場(chǎng)采集到的頻率信號(hào)測(cè)量并顯示出來(lái)。傳統(tǒng)的測(cè)頻系統(tǒng)大多采用單片機(jī)加邏輯器件構(gòu)成，而這類(lèi)測(cè)頻系統(tǒng)存在測(cè)頻
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基于FPGA的高速運(yùn)動(dòng)目標(biāo)單光幕測(cè)速系統(tǒng)設(shè)計(jì)

引言
高速運(yùn)動(dòng)物體的物理狀態(tài)檢測(cè)分析一直以來(lái)都是一項(xiàng)重要的研究?jī)?nèi)容，特別是對(duì)于高速運(yùn)動(dòng)物體瞬時(shí)運(yùn)動(dòng)速度的檢測(cè)。這是瞬態(tài)過(guò)程及效應(yīng)物理研究中的一個(gè)有待發(fā)展的領(lǐng)域，可能會(huì)導(dǎo)致極端條件下的新物理效應(yīng)，
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基于FPGA的RFID板級(jí)標(biāo)簽設(shè)計(jì)與實(shí)現(xiàn)

引言
射頻識(shí)別(Radio Frequency Identification，RFID)技術(shù)是一種新興的非接觸式自動(dòng)識(shí)別技術(shù)，在工業(yè)自動(dòng)化、商業(yè)自動(dòng)化、交通運(yùn)輸控制管理、防偽及軍事等眾多領(lǐng)域都有廣泛的應(yīng)用前景。它利用無(wú)線射頻方式進(jìn)行
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一種數(shù)字射頻存儲(chǔ)器的設(shè)計(jì)

引言
現(xiàn)代電子戰(zhàn)孕育了DRFM的誕生，數(shù)字射頻存儲(chǔ)器是一種對(duì)射頻信號(hào)采樣、存儲(chǔ)、運(yùn)算然后轉(zhuǎn)發(fā)的電子部件。DRFM對(duì)樣本信息保存下來(lái)后，根據(jù)需要加入調(diào)制信息；再通過(guò)高速DAC轉(zhuǎn)發(fā)出去，實(shí)現(xiàn)對(duì)目標(biāo)的有效干擾。隨
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基于DDS技術(shù)的動(dòng)態(tài)偏振控制器驅(qū)動(dòng)電路研究

引言
偏振控制器是一種重要的光器件，在光纖通信和傳感領(lǐng)域都有著廣泛的應(yīng)用。在光纖通信系統(tǒng)中，準(zhǔn)確地控制光纖中的偏振態(tài)，關(guān)系著系統(tǒng)的穩(wěn)定性和數(shù)據(jù)傳輸?shù)恼`碼率。然而在消偏型光纖陀螺中，準(zhǔn)確測(cè)量光的偏振
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在FPGA中實(shí)現(xiàn)源同步LVDS接收正確字對(duì)齊

在串行數(shù)據(jù)傳輸中，數(shù)據(jù)接收端需要一些特定的信息來(lái)恢復(fù)出正確的字邊界，以確定串行碼流中哪些比特屬于原始并行數(shù)據(jù)里的同一時(shí)鐘節(jié)拍里的數(shù)據(jù)，這一處理過(guò)程稱(chēng)為字對(duì)齊(Word Aligner)。一些標(biāo)準(zhǔn)的協(xié)議會(huì)定義特殊的碼
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FPGA動(dòng)態(tài)局部可重構(gòu)中基于TBUF總線宏設(shè)計(jì)

引言
FPGA動(dòng)態(tài)局部可重構(gòu)技術(shù)是指允許可重構(gòu)的器件或系統(tǒng)的一部分進(jìn)行重新配置，配置過(guò)程中其余部分的工作不受影響。動(dòng)態(tài)局部可重構(gòu)縮短了重構(gòu)的時(shí)間，減少了系統(tǒng)重構(gòu)的開(kāi)銷(xiāo)，提高了系統(tǒng)的運(yùn)行效率。局部動(dòng)態(tài)
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通過(guò)在FPGA設(shè)計(jì)流程引入功率分析改善PCB的可靠性

過(guò)去，F(xiàn)PGA設(shè)計(jì)人員考慮的是時(shí)序和面積使用率。但是，隨著FPGA正越來(lái)越多地取代ASSP和ASIC，設(shè)計(jì)人員期望開(kāi)發(fā)功率較低的設(shè)計(jì)并提供更加精確的功率估計(jì)。最新FPGA分析軟件能提供一種精確和靈活的手段來(lái)模擬各種工作環(huán)
關(guān)鍵字： FPGA PCB 設(shè)計(jì)流程分析

基于EDA軟件和FPGA的IP核保護(hù)技術(shù)

隨著電路復(fù)雜性的增加，越來(lái)越多的設(shè)計(jì)者開(kāi)始采用擁有知識(shí)產(chǎn)權(quán)的、設(shè)計(jì)良好的功能模塊來(lái)加快系統(tǒng)開(kāi)發(fā)。因此，需要相應(yīng)的技術(shù)手段保護(hù)這些功能模塊不被非法復(fù)制、篡改或竊取。針對(duì)FPGA開(kāi)發(fā)中的知識(shí)產(chǎn)權(quán)保護(hù)問(wèn)題，提出一種結(jié)合EDA軟件和FPGA的IP(Intellectual Proterty)核保護(hù)方法，有效的防止IP核被竊取，以及防止最終在FPGA上實(shí)現(xiàn)設(shè)計(jì)的非法復(fù)制。
關(guān)鍵字： FPGA EDA 軟件 IP核