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FIR帶通濾波器的FPGA實(shí)現(xiàn)

為設(shè)計(jì)一個(gè)項(xiàng)目可用的FIR數(shù)字帶通濾波器，采用Matlab／Simulink軟件中DSPBulider強(qiáng)大的算法模塊設(shè)計(jì)工具，結(jié)合Altera公司的FPGA開發(fā)板實(shí)現(xiàn)FIR數(shù)字帶通濾波器的系統(tǒng)集成、RTL級(jí)仿真、綜合編譯、下載等設(shè)計(jì)流程，并對(duì)正弦信號(hào)進(jìn)行濾波，結(jié)果下載到開發(fā)板上用示波器觀測(cè)，達(dá)到了預(yù)期的濾波效果和目的?；贒SPBuilder完成系統(tǒng)建模，省去了復(fù)雜的VHDL編程，還可針對(duì)具體模塊進(jìn)行參數(shù)設(shè)置從而適應(yīng)不同的濾波需求。該方法實(shí)現(xiàn)簡(jiǎn)單、可靠，還可類推實(shí)現(xiàn)其他復(fù)雜的嵌入式系統(tǒng)設(shè)計(jì)。
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基于多速率DA的根升余弦濾波器的FPGA實(shí)現(xiàn)

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根升余弦成形濾波器是數(shù)字信號(hào)處理中的重要部件，它能對(duì)數(shù)字信號(hào)進(jìn)行成形濾波，壓縮旁瓣，減少干擾的影響，從而降低誤碼率。根據(jù)文獻(xiàn)[1]，它的傳統(tǒng)FP-GA實(shí)現(xiàn)方式基于乘累加器(Multiplier Add Cell，M
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基于FPGA嵌入式的多比特自相關(guān)器設(shè)計(jì)

該設(shè)計(jì)利用FPGA的嵌入式軟核NiosⅡ處理器，通過嵌入式操作系統(tǒng)μC／OS-Ⅱ，實(shí)現(xiàn)了在FPGA內(nèi)的自相關(guān)計(jì)算器；利用FPGA強(qiáng)大的并行運(yùn)算功能和自帶存儲(chǔ)器實(shí)現(xiàn)的“乒乓”RAM，通過軟核NiosⅡ輸出控制字實(shí)時(shí)切換調(diào)用兩個(gè)“乒乓”RAM的存儲(chǔ)和讀取功能，使之同時(shí)完成對(duì)采集數(shù)據(jù)的緩沖存儲(chǔ)和向乘法器提供計(jì)算數(shù)據(jù)的功能，使芯片的整個(gè)數(shù)字處理鏈路連續(xù)化。另外，采用多比特進(jìn)行自相關(guān)運(yùn)算較之于現(xiàn)在天文臺(tái)使用的1 b量化自相關(guān)器，能有效地提高SNR退化比。
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基于FPGA的PC／104-CAN通訊板設(shè)計(jì)

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PC／104嵌入式控制PC出現(xiàn)于20世紀(jì)80年代末，并于1992年形成IEEEP966．1標(biāo)準(zhǔn)。它一方面繼承了PC的所有資源，另一方面又對(duì)PC的各個(gè)方面做了優(yōu)化設(shè)計(jì)，使其與IBM PC完全兼容，并具有體積小，功耗低，工作
關(guān)鍵字： FPGA 104 CAN 通訊板

LS碼及其FPGA的實(shí)現(xiàn)

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眾所周知，在二元域、有限域以及復(fù)數(shù)域都不存在理想的地址碼，如m序列、Gold序列以及Walsh碼的相關(guān)性都不理想，這使得采用傳統(tǒng)擴(kuò)頻碼的CDMA系統(tǒng)是一個(gè)自干擾系統(tǒng)，需要采用聯(lián)合檢測(cè)技術(shù)、智能天線技術(shù)
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基于SystemC/TLM方法學(xué)的IP開發(fā)及FPGA建模

隨著系統(tǒng)級(jí)芯片技術(shù)的出現(xiàn)，設(shè)計(jì)規(guī)模正變得越來越大，因而變得非常復(fù)雜，同時(shí)上市時(shí)間也變得更加苛刻。通常RT...
關(guān)鍵字： SystemC TLM IP開發(fā) FPGA 建模

基于ARM的3DES加密算法實(shí)現(xiàn)

基于ARM的3DES加密算法實(shí)現(xiàn),3DES算法是一個(gè)重要的對(duì)稱加密算法，被廣泛應(yīng)用于實(shí)際系統(tǒng)中。目前并沒有針對(duì)嵌入式的實(shí)現(xiàn)方法，依據(jù)3DES算法和一般嵌入式系統(tǒng)需求，詳細(xì)介紹該系統(tǒng)硬件和軟件的設(shè)計(jì)過程。硬件以三星公司的S3C2410處理器為核心，系統(tǒng)以嵌入式Linux為載體。在此詳細(xì)闡述開發(fā)環(huán)境的搭建、Bootloader的架構(gòu)及功能、內(nèi)核及文件系統(tǒng)的編譯和移植?；谙到y(tǒng)硬件和軟件設(shè)計(jì)過程，通過MiniGUI圖形界面對(duì)3DES算法進(jìn)行了演示。
關(guān)鍵字：算法實(shí)現(xiàn) 加密 3DES ARM 基于

基于FPGA的激光無(wú)線通信精跟蹤系統(tǒng)

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以大氣作為傳輸介質(zhì)，激光作為信息載體進(jìn)行無(wú)線通信時(shí)，空一地激光無(wú)線通信是激光無(wú)線通信的一種常見形式，信標(biāo)光的準(zhǔn)確捕獲、瞄準(zhǔn)與跟蹤(Acquisition，Pointing and Tracking，APT)是其關(guān)鍵技術(shù)，AP
關(guān)鍵字： FPGA 激光跟蹤系統(tǒng) 無(wú)線通信

可編程芯片：拼合成一個(gè)模擬解決方案

要點(diǎn)經(jīng)濟(jì)形勢(shì)刺激了對(duì)可編程模擬元件的興趣。不存在將可編程模擬芯片用于一個(gè)系統(tǒng)的設(shè)計(jì)流程...
關(guān)鍵字： FPGA 可編程邏輯解決方案

基于FPGA的遠(yuǎn)程圖像采集系統(tǒng)設(shè)計(jì)

本文介紹了一種基于FPGA實(shí)現(xiàn)的圖像采集系統(tǒng)，通過FPGA控制外部高速成像設(shè)備所產(chǎn)生的圖像數(shù)據(jù)、參數(shù)信息和狀態(tài)控制信號(hào)的同步采集，并實(shí)現(xiàn)數(shù)據(jù)格式的轉(zhuǎn)換、圖像數(shù)據(jù)的組幀、存儲(chǔ)及轉(zhuǎn)發(fā)功能。
關(guān)鍵字： FPGA 圖像采集組幀狀態(tài)機(jī) LVDS 200911

FPGA的技術(shù)市場(chǎng)特點(diǎn)

本文通過對(duì)FPGA行業(yè)主要的市場(chǎng)調(diào)查公司、供應(yīng)商和第三方合作伙伴的訪問，力圖揭示FPGA近期的市場(chǎng)特點(diǎn)及發(fā)展態(tài)勢(shì)。
關(guān)鍵字： Xilinx FPGA Altera Actel Lattice Altium Gartner 200911

移動(dòng)終端迅速崛起，芯片行業(yè)面臨新變局

　　曾幾何時(shí)，PC是計(jì)算的代名詞。然而，互聯(lián)網(wǎng)改變了游戲規(guī)則?，F(xiàn)在，用戶希望有更多設(shè)備可以增加自己的計(jì)算體驗(yàn)。電視等消費(fèi)電子產(chǎn)品與互聯(lián)網(wǎng)結(jié)合的趨勢(shì)越來越明顯;iPhone的出現(xiàn)，同樣讓隨身計(jì)算終端有了新的定義。　　終端變革的過程中，計(jì)算的重心不再僅僅停留在PC領(lǐng)域，這使得半導(dǎo)體市場(chǎng)再度煥發(fā)出了活力，各種各樣的處理器、控制芯片層出不窮，一切都在為更多終端設(shè)備的出現(xiàn)鋪平道路。　　ARM的逆襲　　當(dāng)iPhone的出現(xiàn)讓全世界目眩神迷的時(shí)候，三星和ARM站在幕后偷偷地笑了。以節(jié)能高效為主要特性的ARM
關(guān)鍵字： ARM 移動(dòng)終端移動(dòng)計(jì)算

ARM透露下一代架構(gòu)“鷹”

　　ARM本周五透露了他們下一代處理器產(chǎn)品架構(gòu)“鷹”的細(xì)節(jié)，這一架構(gòu)的設(shè)計(jì)主要著重于速度，依賴于GlobalFoundries的28納米制程并最終演化到22納米，提出多核心和“高端”圖形硬件的概念，并且對(duì)安全性進(jìn)行了修正。這一系列的處理器將主要用于智能手機(jī)和其它移動(dòng)設(shè)備，　　由于正在等待制程的改進(jìn)，“鷹”在2013年之前不會(huì)出現(xiàn)，并且到2014年才有相應(yīng)產(chǎn)品出臺(tái)，可謂路漫漫。　　ARM公司本身不直接生產(chǎn)處理器，而是為他人提供設(shè)
關(guān)鍵字： ARM 處理器 22納米鷹

可編程邏輯器件向?qū)Ｓ脴?biāo)準(zhǔn)產(chǎn)品目標(biāo)邁進(jìn)

　　可編程邏輯器件(FPGA)一直以其設(shè)計(jì)靈活性以及現(xiàn)場(chǎng)可編程特性在市場(chǎng)上穩(wěn)穩(wěn)固守著一席之地，隨著半導(dǎo)體制造工藝的進(jìn)步，器件集成度越來越高，其應(yīng)用也日益復(fù)雜。過去FPGA應(yīng)用對(duì)象主要是硬件設(shè)計(jì)人員，他們對(duì)器件本身的物理結(jié)構(gòu)及特性都有相當(dāng)?shù)牧私猓缃裣到y(tǒng)集成工程師、DSP開發(fā)人員甚至嵌入式軟件工程師也都需要在可編程邏輯器件平臺(tái)上進(jìn)行系統(tǒng)開發(fā)，F(xiàn)PGA器件的復(fù)雜性對(duì)他們將是一大挑戰(zhàn)。　　“目前的FPGA已經(jīng)和以前有很大不同，過去它只包含幾千個(gè)查找表用于膠合邏輯，僅僅作為嵌入式系統(tǒng)中的器件，而
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基于FPGA的改進(jìn)型分組交織器的設(shè)計(jì)與實(shí)現(xiàn)

Turbo碼是由法國(guó)人Berrou于1993年提出的一種性能優(yōu)越的信道編碼方案[1]，其應(yīng)用已逐步推廣到衛(wèi)星通信、移動(dòng)通信和計(jì)算機(jī)通信等領(lǐng)域。交織器作為Turbo碼編碼器中的重要組成部分，在Turbo碼的性能中起著至關(guān)重要
關(guān)鍵字： FPGA 改進(jìn)型分組交織器