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一種基于FPGA的BiSS編碼器解碼器設(shè)計(jì)

BiSS協(xié)議是一種高速同步串行通信協(xié)議，使用BiSS協(xié)議的編碼器有利于提高伺服控制系統(tǒng)的動(dòng)態(tài)性能，在高精度絕對式編碼器中應(yīng)用廣泛。本文在分析BiSS協(xié)議數(shù)據(jù)幀特點(diǎn)的基礎(chǔ)上，利用FPGA設(shè)計(jì)了BiSS協(xié)議編碼器解碼器，采集了BiSS協(xié)議編碼器位置數(shù)據(jù)和總線波形，通過與DSP聯(lián)合使用，基于BiSS協(xié)議編碼器對永磁同步電機(jī)的動(dòng)態(tài)性能進(jìn)行了驗(yàn)證，結(jié)果表明該設(shè)計(jì)的合理性。
關(guān)鍵字： BiSS FPGA 編碼器 DSP 202108

基于FPGA的一種DDR4存儲模塊設(shè)計(jì)

5G通信的主要特征包括“高速率、大帶寬”，為了滿足高速率、大帶寬數(shù)據(jù)的傳輸要求，需要一種存儲技術(shù)對數(shù)據(jù)進(jìn)行存儲。本文就存儲技術(shù)結(jié)合DDR4協(xié)議，設(shè)計(jì)了一種DDR4傳輸機(jī)制，本研究采用高性能的XCVU9P系列的FPGA芯片作為控制芯片，使用其內(nèi)部自帶的DDR4 SDRAM（MIG）IP核進(jìn)行例化核設(shè)計(jì)。經(jīng)過驗(yàn)證，實(shí)現(xiàn)在250 MHz時(shí)鐘下對DDR4 SDRAM的讀/寫操作，數(shù)據(jù)無丟失，能夠保證高速率、大帶寬數(shù)據(jù)正常傳輸，該傳輸機(jī)制具有良好的可靠性、適用性及有效性。
關(guān)鍵字： DDR4 高速率大帶寬 FPGA 202108

英特爾推進(jìn)全新架構(gòu)，面向數(shù)據(jù)中心、HPC-AI和客戶端計(jì)算

　　英特爾推出兩大x86 CPU內(nèi)核、兩大數(shù)據(jù)中心SoC、兩款獨(dú)立GPU，以及變革性的客戶端多核性能混合架構(gòu)　　本文作者：Raja M.Koduri英特爾公司高級副總裁兼加速計(jì)算系統(tǒng)和圖形事業(yè)部總經(jīng)理　　架構(gòu)是硬件和軟件的“煉金術(shù)”。它融合特定計(jì)算引擎所需的先進(jìn)晶體管，通過領(lǐng)先的封裝技術(shù)將它們連接，集成高帶寬和低功耗緩存，在封裝中為混合計(jì)算集群配備高容量、高帶寬內(nèi)存和低時(shí)延、可擴(kuò)展互連，并確保所有軟件無縫地加速。披露面向新產(chǎn)品的架構(gòu)創(chuàng)新，是英特爾架構(gòu)師在每年架構(gòu)日上的期許，今年舉辦的第三屆英特爾架構(gòu)日令人
關(guān)鍵字：英特爾架構(gòu)日 CPU SoC GPU IPU

基于逐次最鄰近插值的動(dòng)力電池電壓模擬方法*

動(dòng)力電池模擬系統(tǒng)是新能源汽車測試平臺等工業(yè)領(lǐng)域的重要裝備，而電池模型是該系統(tǒng)能否精確模擬電池特性的關(guān)鍵環(huán)節(jié)。為兼顧數(shù)據(jù)容量和給定電壓的精確性，提出逐次最鄰近插值算法應(yīng)用于電池模型數(shù)據(jù)查表，該方法根據(jù)動(dòng)力電池在電池電荷狀態(tài)(State of Charge，SOC)初始段、平穩(wěn)段和末尾段的輸出特性，建立了三個(gè)不同分辨率的模型子表，并借鑒最鄰近插值算法的計(jì)算量小和容易實(shí)現(xiàn)的優(yōu)點(diǎn)，采用對模型表逐次迭代分區(qū)，進(jìn)而逼近實(shí)際SOC和采樣電流對應(yīng)的電池模型給定電壓值，達(dá)到細(xì)化電池模型表分辨率效果。討論了迭代次數(shù)選擇對算法
關(guān)鍵字：查表最鄰近插值算法動(dòng)力電池 SOC 給定電壓 202102

毫米波5G接收機(jī)多速率數(shù)據(jù)設(shè)計(jì)與研究

針對5G毫米波通信宏基站、微基站等設(shè)備的研發(fā)、生產(chǎn)、預(yù)認(rèn)證、維修保障等測試需求，設(shè)計(jì)一款可應(yīng)用于“5G新基建”通信設(shè)備產(chǎn)業(yè)鏈多環(huán)節(jié)所需儀表的高效多速率信號接收機(jī)處理模塊。采用先進(jìn)的并行多相濾波技術(shù)和任意速率比FFT處理技術(shù)，基于FPGA算法平臺實(shí)現(xiàn)毫米波5G接收機(jī)多路信號接收時(shí)域/頻域并行變速率處理邏輯電路，提高5G復(fù)雜波形接收機(jī)信號解析的實(shí)時(shí)性。實(shí)驗(yàn)結(jié)果表明，該電路能高效完成5G復(fù)雜波形接收機(jī)信號的時(shí)域/頻域解析，適合作為毫米波5G接收機(jī)多速率數(shù)據(jù)處理實(shí)施方案，滿足毫米波5G接收機(jī)的功能設(shè)計(jì)要求。
關(guān)鍵字： FPGA 5G 毫米波接收機(jī) 202105

基于EG4A20BG256和AD7403的電流采樣電路設(shè)計(jì)

AD7403是一種Σ-Δ型模數(shù)轉(zhuǎn)換器，廣泛應(yīng)用于需要電氣隔離的伺服控制電機(jī)相電流采集場合。EG4A20BG256是一種國產(chǎn)FPGA，適用于伺服控制系統(tǒng)信號采集﹑接口擴(kuò)展等應(yīng)用場景。本文基于EG4A20BG256 FPGA設(shè)計(jì)了AD7403模數(shù)轉(zhuǎn)換器接口電路，采集永磁同步電機(jī)相電流，并與伺服控制電路內(nèi)霍爾電流傳感器和DSP采樣結(jié)果進(jìn)行了對比。結(jié)果表明，EG4A20BG256 FPGA可以通過AD7403模數(shù)轉(zhuǎn)換器實(shí)現(xiàn)對永磁同步電機(jī)相電流的準(zhǔn)確采集。
關(guān)鍵字： AD7403 EG4A20BG256 FPGA DSP 永磁同步電機(jī) 202105

衛(wèi)星導(dǎo)航信號多通道隔離轉(zhuǎn)換測量顯示系統(tǒng)的設(shè)計(jì)實(shí)現(xiàn)

設(shè)計(jì)并實(shí)現(xiàn)了一種BD/GPS衛(wèi)星導(dǎo)航信號多通道隔離轉(zhuǎn)換測量顯示系統(tǒng)。該系統(tǒng)將一路輸入的BD/GPS信號通過功分器轉(zhuǎn)換為等量的四路隔離輸出信號，經(jīng)FPGA解析后實(shí)時(shí)顯示在電腦屏幕上，為BD/GPS信號的使用提供直觀的數(shù)據(jù)基礎(chǔ)。
關(guān)鍵字： BD/GPS FPGA 功分器隔離 202107

一種BiSS協(xié)議的編碼器數(shù)據(jù)讀取方法

摘要：針對目前BiSS協(xié)議編碼器數(shù)據(jù)讀取多采用FPGA實(shí)現(xiàn)的實(shí)際情況，文中介紹一種基于XMC4500微控制器的BiSS協(xié)議編碼器數(shù)據(jù)讀取實(shí)現(xiàn)方案。采用該方案，可將使用BiSS協(xié)議編碼器的伺服系統(tǒng)控制電路常用的DSP+FPGA雙控制器架構(gòu)方式簡化為XMC4500單控制器方式，在一定程度上降低了硬件成本和開發(fā)難度。用該方案采集BiSS協(xié)議編碼器數(shù)據(jù)的實(shí)物平臺，使用LabVIEW顯示對讀取的數(shù)據(jù)，并與電機(jī)自帶增量編碼器值進(jìn)行對比，同時(shí)記錄BiSS協(xié)議編碼器實(shí)際數(shù)據(jù)波形圖，結(jié)果表明，該方案具有較高的采樣速率和較好
關(guān)鍵字： 202106 BiSS XMC4500 DSP FPGA LabVIEW

5G NR小區(qū)搜索算法的研究及FPGA實(shí)現(xiàn)

隨著移動(dòng)通信的高速發(fā)展，5G NR通信已經(jīng)進(jìn)入我們的日常生活，5G系統(tǒng)對信息傳輸制訂了全新標(biāo)準(zhǔn)，基于5G NR的小區(qū)搜索相對于長期演進(jìn)（LTE）而言，對同步信號進(jìn)行了重新定義。文章詳細(xì)分析了5G NR系統(tǒng)的主輔同步信號（PSS&SSS），對其新增內(nèi)容進(jìn)行了研究，提出了適用于5G NR系統(tǒng)的小區(qū)搜索算法，使用MATLAB軟件對該算法的性能進(jìn)行了仿真分析，最后在FPGA上實(shí)現(xiàn)開發(fā)應(yīng)用。
關(guān)鍵字： 5G NR FPGA 小區(qū)搜索 PSS SSS 202105

賽靈思：以更高AI效能功耗比支持邊緣運(yùn)算自主

邊緣運(yùn)算主要包含以下四個(gè)部分，低時(shí)延、AI算力、低功耗以及安全和保密，這四者是邊緣自主非常重要的組成部分，也是邊緣區(qū)別于工業(yè)和IoT的一個(gè)主要特點(diǎn)，也就是用運(yùn)算資源來支持邊緣的自主，使它能夠獨(dú)立于云端。賽靈思Versal AI Edge系列資深產(chǎn)品線經(jīng)理 Rehan Tahir賽靈思Versal AI Edge系列高級產(chǎn)品線經(jīng)理Rehan Tahir指出，當(dāng)賽靈思在2018年引入Versal ACAP的時(shí)候，首先推出的是Versal Core和Prime系列，用于云端和網(wǎng)絡(luò)，然后推出了Vers
關(guān)鍵字：賽靈思 FPGA ADAS

5G毫米波基帶數(shù)據(jù)傳輸?shù)难芯颗c實(shí)現(xiàn)

隨著通信技術(shù)的快速發(fā)展，5G已經(jīng)正式商用，5G的6G以下波段對傳輸有很高的要求，在6G以上的毫米波段要求的信號帶寬更大，數(shù)據(jù)傳輸速率更高，高速大帶寬信號要求基帶信號處理的速度將大大增加，對極高速數(shù)據(jù)流的實(shí)時(shí)處理和解析使測試變得更加困難，本文主要是研究與設(shè)計(jì)毫米波基帶數(shù)據(jù)的傳輸與實(shí)現(xiàn)：前端DA的研究與設(shè)計(jì)、傳輸鏈路的FPGA實(shí)現(xiàn)以及毫米波數(shù)據(jù)的DSP接收處理過程，最后把實(shí)現(xiàn)流程成功應(yīng)用到5G測試儀表之中，驗(yàn)證了設(shè)計(jì)的正確性。
關(guān)鍵字： 202104 毫米波 FPGA 基帶數(shù)據(jù) DSP

基于FPGA的數(shù)字和模擬信號合成的彩色液晶顯示器

本文介紹了一款智能型高速模擬與數(shù)字信號合成的液晶顯示器。該顯示器采用雙FPGA作為主控芯片，利用視頻解碼芯片ADV7180將模擬信號解析為可供液晶屏顯示的RGB信號。
關(guān)鍵字： 202104 FPGA ADV7180 模擬與數(shù)字信號

賽靈思CEO：為FPGA提供一個(gè)更廣闊的施展舞臺

作為第四任賽靈思的CEO，上任三年多的Victor Peng在交易后首次面對中國的媒體時(shí)，除了總結(jié)自己上任三年來的成績之外，更是重點(diǎn)的回應(yīng)了對合并后企業(yè)的愿景
關(guān)鍵字：賽靈思 FPGA AMD

可穿戴設(shè)備SoC的動(dòng)向與Nordic解決方案

1? ?可穿戴設(shè)備SoC的動(dòng)向Nordic Semiconductor看到市場對公司無線藍(lán)牙5 (BLE) 系統(tǒng)級芯片(SoC)產(chǎn)品的需求激增，尤其是在可穿戴運(yùn)動(dòng)產(chǎn)品領(lǐng)域。隨著消費(fèi)者對于產(chǎn)品功能和電池使用壽命越來越挑剔，使用具有充足的處理能力的高功效SoC 變得越來越重要。此外，還有一種趨勢是增加更多的醫(yī)療級傳感器來測量血氧飽和度(SPO2)、血壓、心電圖(EKG)等，這對SoC 提出了更高的處理性能要求。具有超低功耗LTE-M 和NB-IoT 網(wǎng)絡(luò)的蜂窩物聯(lián)網(wǎng)的推出，開始推動(dòng)可穿戴設(shè)
關(guān)鍵字： SoC 可穿戴 202105

輕松有趣地提高安全性：SoC組件協(xié)助人們保持健康

我們需要透過智慧的預(yù)防措施來恢復(fù)正常生活。當(dāng)人們必須估量并遵守1.5至2公尺的強(qiáng)制社交距離，很難想象購物、學(xué)習(xí)或工作如何變得輕松起來。在忘記保持安全社交距離時(shí)略帶驚恐地跳開，這已經(jīng)見怪不怪。盡管存在著所有的預(yù)防措施，我們?nèi)砸M快恢復(fù)常態(tài)的生活：企業(yè)需要再次提高產(chǎn)量，商店迫切需要營業(yè)，兒童和青少年需要上學(xué)，以及安排各項(xiàng)休閑活動(dòng)。但我們還缺乏一個(gè)有效、通用和能快速實(shí)施這個(gè)衛(wèi)生理念的方法。為此，政府發(fā)起了圍繞「距離/衛(wèi)生/日常戴口罩」的運(yùn)動(dòng)，目前該運(yùn)動(dòng)為遏制新的感染提供了行動(dòng)綱要，例如受惠于現(xiàn)代科技，企業(yè)和公共
關(guān)鍵字： SoC 可穿戴物聯(lián)網(wǎng)