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2006年2月15日，海爾IC選用ARM Artisan物理IP

  • 　　2006年2月15日 海爾IC選用ARM Artisan®物理IP開發(fā)消費電子產(chǎn)品，全面的解決方案幫助中國工程師實現(xiàn)低功耗、高性能的IC設(shè)計。
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利用APTIX MP3C和Spartan-IIE FPGA實現(xiàn)數(shù)據(jù)系統(tǒng)的

  • 隨著數(shù)字電路設(shè)計的規(guī)模及復(fù)雜程度的提高，對其進行測試試驗證所花費的時間和費用也隨之提高，所以減少測試驗證成本是當(dāng)前數(shù)字電路設(shè)計的關(guān)鍵。
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基于FPGA的高級數(shù)據(jù)加密AES中的字節(jié)替換設(shè)計

  • 介紹AES中的字節(jié)替換算法原理并闡述基于FPGA的設(shè)計和實現(xiàn)。為了提高系統(tǒng)工作速度，在設(shè)計中應(yīng)用了流水線技術(shù)。
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QuickLogic推出嵌入式SDIO IP和SDIO設(shè)計

  •      QuickLogic公司近日宣布推出可嵌入QuickLogic 微瓦FPGA產(chǎn)品系列Eclipse II™的SDIO主控器IP核。為了進一步縮短客戶產(chǎn)品設(shè)計的時間，QuickLogic同時還提供基于Eclipse II QL8325和QL8150 的SDIO參考設(shè)計。         QuickLogic所
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Altium一體化設(shè)計消除FPGA到PCB障礙

  •       Altium宣布Altium 公司的最新一體化電子產(chǎn)品開發(fā)系統(tǒng)Altium Designer 6.0 極大地增強了FPGA-PCB 協(xié)同設(shè)計的能力，工程師可以充分利用FPGA 作為系統(tǒng)平臺，而且簡化大型FPGA 與物理PCB 平臺的集成。       雖然人們早就認識到了FPGA 給邏輯
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德州儀器推出IP質(zhì)量管理單元系統(tǒng)

  • 　　日前，德州儀器 (TI) 宣布推出一套新型的 IP 質(zhì)量管理單元系統(tǒng)—PIQUA，該產(chǎn)品將使服務(wù)供應(yīng)商能夠在 VoIP、IP 視頻、IPTV 以及因特網(wǎng)音樂服務(wù)方面，為個人消費者與企業(yè)用戶提供高級服務(wù)質(zhì)量。通過積極與 Motive 及 Viola Networks 的合作，融合了PIQUA 的TI IP 通信技術(shù)產(chǎn)品，可提供重要技術(shù)信息來正確管理各種新興
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BittWare用FPGA實現(xiàn)I/O開關(guān)量大于5Gbps

  • 　　BittWare是混合(DSP和FPGA)電路板級方案供應(yīng)商，日前該公司采用ADI的TigerSHARC及Altera的FPGA技術(shù)，推出ATLANTiS Rev 2.0(新TigerSHARC使用的高級傳輸鏈路架構(gòu))、I/O切換和處理器件。 　　ATLANTiS采用FPGA實現(xiàn)，便于板外I/O通訊路由和處理，允許系統(tǒng)設(shè)計師們設(shè)置并動態(tài)連接。所有輸入和輸出均通過ATLANTiS進行路由，每簇通信量大于5GBps。ATLANTiS集成了DSP、PCI橋、PMC接口和I/O外設(shè)及板載F
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用FPGA控制CLC5958型A/D轉(zhuǎn)換器實現(xiàn)的高速PCI數(shù)據(jù)采集卡

QuickLogic推出SDIO IP和SDIO參考設(shè)計

  •       QuickLogic公司近日宣布推出可嵌入QuickLogic 微瓦FPGA產(chǎn)品系列Eclipse II™的SDIO主控器IP核。為了進一步縮短客戶產(chǎn)品設(shè)計的時間，QuickLogic同時還提供基于Eclipse II QL8325和QL8150 的SDIO參考設(shè)計。         Quick
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采用FPGA的低功耗系統(tǒng)設(shè)計

  • 　　結(jié)合采用低功耗元件和低功耗設(shè)計技術(shù)在目前比以往任何時候都更有價值。隨著元件集成更多功能，并越來越小型化，對低功耗的要求持續(xù)增長。當(dāng)把可編程邏輯器件用于低功耗應(yīng)用時，限制設(shè)計的低功耗非常重要。本文將討論減小動態(tài)和靜態(tài)功耗的各種方法，并且給出一些例子說明如何使功耗最小化。  　　功耗的三個主要來源是啟動、待機和動態(tài)功耗。器件上電時產(chǎn)生的相關(guān)電流即是啟動電流；待機功耗又稱作靜態(tài)功耗，是電源開啟但I/O上沒有開關(guān)活動時器件的功耗；動態(tài)功耗是指器件正常工作時的功耗。  　　啟動電流因器件而異
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MIPS與Virage優(yōu)化內(nèi)核IP套件提高性能

  •       MIPS 科技與 Virage Logic宣布聯(lián)合推出一個新系列的第一個內(nèi)核優(yōu)化 IP 套件（Core-Optimized IP Kit）。該套件由專門優(yōu)化 MIPS 處理器性能的Virage Logic Area 、Speed and Power (ASAP) Memory™
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ST無線IP家庭網(wǎng)絡(luò)多媒體流組合

  • 多媒體/手機芯片領(lǐng)導(dǎo)廠商針對下一代家庭娛樂信息產(chǎn)品推出成套關(guān)鍵技術(shù) 意法半導(dǎo)體日前公布了該公司正在為無線家庭IP網(wǎng)絡(luò)的音視頻流應(yīng)用開發(fā)一套關(guān)鍵技術(shù)的細節(jié)，以實現(xiàn)新一代消費電子產(chǎn)品。有了這些技術(shù)，不同的消費產(chǎn)品（機頂盒、DVD影碟機、DVD錄放機、移動終端）就可以通過無線連接來共享多媒體內(nèi)容。ST正在開發(fā)的關(guān)鍵技術(shù)包括視頻碼轉(zhuǎn)換、先進的視頻編碼器和強固的解碼器 (H.264)、自適應(yīng)播放、802.11n WLAN和安全/DRM (數(shù)字權(quán)限管理)。 這些技術(shù)的開發(fā)目標(biāo)是按照“隨時
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2005年12月20日，宏力半導(dǎo)體采用ARM Artisan物理IP

  • 　　2005年12月20日宏力半導(dǎo)體采用ARM Artisan物理IP擴展其0.18微米和0.13微米流水線。該協(xié)議使ARM全球用戶可以通過ARM網(wǎng)站免費獲得基于宏力技術(shù)的物理IP。
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用PowerPC實現(xiàn)高帶寬 TCP/IP 性能

  • 用PowerPC實現(xiàn)高帶寬 TCP/IP 性能,今天，實現(xiàn)線速 TCP/IP 性能仍舊是一項重大設(shè)計挑戰(zhàn)。在本文中，我們將討論限制 TCP/IP 性能的單位字節(jié)和單位包的處理成本，并給出在基于嵌入式處理器的應(yīng)用中實現(xiàn)千兆位以太網(wǎng) TCP/IP 性能最大化的技術(shù)。
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使用Verilog實現(xiàn)基于FPGA的SDRAM控制器

  • 介紹了SDRAM的特點和工作原理，提出了一種基于FPGA的SDRAM控制器的設(shè)計方法，使用該方法實現(xiàn)的控制器可非常方便地對SDRAM進行控制。
  • 關(guān)鍵字： Verilog  SDRAM  FPGA  控制器    
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