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fpga ip 文章 最新資訊

PCB上FPGA的同步開(kāi)關(guān)噪聲分析

  • 如今CMOS技術(shù)讓一塊FPGA器件可以擁有多個(gè)I/O接口。同時(shí)，近幾年，低功耗已開(kāi)始成為高速I(mǎi)/O接口的主流概念。降低功耗最有效的途徑就是降低電壓，而電壓降低就會(huì)導(dǎo)致I/O接口所允許的噪聲余量變小。因此，對(duì)FPGA用
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基于FPGA的多功能信號(hào)源生成系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)

  • 摘 要：為了滿足科研與實(shí)驗(yàn)需要，提出并實(shí)現(xiàn)了一種以FPGA和高速D／A為核心，其結(jié)構(gòu)簡(jiǎn)單，控制靈活，信號(hào)質(zhì)量高的多功能信號(hào)源生成系統(tǒng)。該信號(hào)源生成系統(tǒng)能夠?qū)崟r(shí)產(chǎn)生中心頻率在30～130 MHz的各種雷達(dá)、通信、導(dǎo)航和
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具有64位數(shù)據(jù)檢糾錯(cuò)功能的FPGA模塊設(shè)計(jì)

  • 摘要：星載計(jì)算機(jī)系統(tǒng)中電子器件容易受到空間環(huán)境電磁場(chǎng)的輻射和重粒子的沖擊，從而導(dǎo)致器件運(yùn)行出錯(cuò)，特別是存儲(chǔ)器中數(shù)據(jù)容易出現(xiàn)錯(cuò)誤，需要具有檢糾錯(cuò)功能的電路模塊對(duì)其進(jìn)行糾正，以免造成嚴(yán)重的后果?；跐h明碼
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混合信號(hào)FPGA的智能型驗(yàn)證流程

  • 　　為了因應(yīng)市場(chǎng)對(duì)于較高性能、較小的系統(tǒng)尺寸及降低成本和電源的需求，系統(tǒng)設(shè)計(jì)者正將較高層級(jí)的混合信號(hào)功能整合在他們的系統(tǒng)單芯片（SoC）設(shè)計(jì)中。隨著這些SoC設(shè)計(jì)上的混合信號(hào)組件數(shù)量增加了，基本的功能驗(yàn)證對(duì)
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基于DSP和FPGA的嵌入式同步控制器實(shí)現(xiàn)

  • 基于DSP和FPGA的嵌入式同步控制器實(shí)現(xiàn),摘 要：針對(duì)印染設(shè)備多單元同步控制中動(dòng)態(tài)性和穩(wěn)定性的問(wèn)題，提出一種基于DSP和FPGA的嵌入式同步控制器設(shè)計(jì)方案。DSP作為運(yùn)算控制的核心，負(fù)責(zé)控制算法的實(shí)現(xiàn)；FPGA作為數(shù)據(jù)采集模塊的核心，負(fù)責(zé)數(shù)據(jù)采集的實(shí)現(xiàn)。該系
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新環(huán)境、新工藝、新挑戰(zhàn)下的FPGA發(fā)展策略

  • 在全球經(jīng)濟(jì)萎縮引發(fā)的半導(dǎo)體產(chǎn)業(yè)惡化的新環(huán)境、突破更高性能采納的更低節(jié)點(diǎn)的新工藝、以及來(lái)自競(jìng)爭(zhēng)對(duì)手和客...
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FPGA設(shè)計(jì)的安全性，您準(zhǔn)備好了嗎？

  • 一款新游戲面市不到2個(gè)月，市場(chǎng)就已充斥了仿制品，工程師幾個(gè)月甚至幾年的心血就白費(fèi)了？竊取技術(shù)層出不窮，攻擊者...
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PPS推出全新管理控制器BMR入門(mén)級(jí)工具套件

  • 　　愛(ài)特公司 (Actel Corporation) 旗下的 Pigeon Point Systems公司 (PPS) 宣布推出基于Actel Fusion 混合信號(hào) FPGA 的全新 MicroTCA® Carrier 管理控制器 (MicroTCA® Carrier Management Controller, MCMC) 板卡管理參考設(shè)計(jì) (Broad Management Reference, BMR) 入門(mén)級(jí)工具套件。全新的套件提供了世界級(jí)的解決方案，適合用于 MicroTCA
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基于PXA270嵌入式系統(tǒng)的Socket通信設(shè)計(jì)

  • 基于PXA270嵌入式系統(tǒng)的Socket通信設(shè)計(jì),1 引言
    PXA270 是Intel 公司的一款基于XScale 架構(gòu)的高集成度高性能嵌入式處理器，采用ARMv5TE內(nèi)核，包含了Intel的SpeedStep 技術(shù)，優(yōu)化了處理器的功耗，可以動(dòng)態(tài)調(diào)節(jié) CPU 的電壓和頻率來(lái)節(jié)省電源的功耗。支持
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基于DSP和FPGA的磁浮列車(chē)同步485通信方式的研究

  • 基于DSP和FPGA的磁浮列車(chē)同步485通信方式的研究,0 引言　　在高速磁浮交通系統(tǒng)中，車(chē)載測(cè)速定位單元對(duì)車(chē)輛的位置和速度進(jìn)行實(shí)時(shí)測(cè)量，并將位置和速度信號(hào)通過(guò)無(wú)線電系統(tǒng)傳送至地面上的牽引控制系統(tǒng)和運(yùn)行控制系統(tǒng)，以用于長(zhǎng)定子直線同步電機(jī)牽引的反饋控制及車(chē)輛運(yùn)
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中芯國(guó)際發(fā)布65納米低漏電工藝的IP產(chǎn)品

  • 　　中芯國(guó)際集成電路制造有限公司, 是世界領(lǐng)先的集成電路芯片代工企業(yè)之一，也是中國(guó)大陸規(guī)模最大、技術(shù)最先進(jìn)的集成電路芯片代工企業(yè)，今天宣布在65納米低漏電工藝提供一整套 IP 產(chǎn)品給客戶(hù)，其中包括一組六款的存儲(chǔ)器編譯器的初始版本。這套 IP 是繼今年年初發(fā)布的65納米標(biāo)準(zhǔn)單元庫(kù)以后發(fā)布的一些新開(kāi)發(fā)的、并可立即供應(yīng)給客戶(hù)使用的 IP。 　　一組六款的存儲(chǔ)器編譯器是中芯國(guó)際提供的這套新65納米 IP 產(chǎn)品的核心部分，它們可以幫助用戶(hù)快速、隨意和智能化地批量生成不同大小的存儲(chǔ)體模塊。這些編譯器包括經(jīng)過(guò)優(yōu)化的高
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基于FPGA的DVI/HDMI接口實(shí)現(xiàn)

  • 在過(guò)去幾年中，具有高清晰度視頻顯示器的一些產(chǎn)品大幅度增加。高清晰度視頻顯示器被集成在這些產(chǎn)品的內(nèi)部，或者放在產(chǎn)品的外面。原始設(shè)備制造商正在期望能夠利用標(biāo)準(zhǔn)的平板顯示器及接口技術(shù)來(lái)降低產(chǎn)品的成本，并提供
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利用FPGA的新功能保證視頻設(shè)計(jì)安全性

  • 越來(lái)越多的消費(fèi)應(yīng)用開(kāi)始在設(shè)計(jì)中集成流式視頻，結(jié)果引入了許多標(biāo)準(zhǔn)和專(zhuān)有的加密算法。但是加密方案以及實(shí)現(xiàn)方法不統(tǒng)一導(dǎo)致視頻接收設(shè)備在設(shè)計(jì)和支持方面存在巨大的挑戰(zhàn)。DeviceDNA作為FPGA的一項(xiàng)新功能，可保證
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PWM控制電路基本原理與FPGA

  • 在直流伺服控制系統(tǒng)中,通過(guò)專(zhuān)用集成芯片或中小規(guī)模的數(shù)字集成電路構(gòu)成的傳統(tǒng)PWM控制電路往往存在電路設(shè)計(jì)復(fù)雜,體積大,抗干擾能力差以及設(shè)計(jì)困難、設(shè)計(jì)周期長(zhǎng)等缺點(diǎn)因此PWM控制電路的模塊化、集成化已成為發(fā)展趨勢(shì).
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FPGA的進(jìn)步鋪平了通向真正的SoC解決方案之路

  • 全定制數(shù)字ASIC的前景開(kāi)始出現(xiàn)陰影?，F(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)正在接管許多一度被認(rèn)為是全定制芯片專(zhuān)屬領(lǐng)域的應(yīng)用。自從FPGA在約二十年前出現(xiàn)以來(lái)，它已經(jīng)通過(guò)將門(mén)數(shù)提高了三個(gè)數(shù)量級(jí)而侵占了ASIC的主導(dǎo)地位。此外
  • 關(guān)鍵字： FPGA  SoC  方案    
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fpga ip介紹

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