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fpga ip 文章 最新資訊

如何定義RFID標(biāo)簽和讀卡器

  • 作為在供應(yīng)鏈上跟蹤產(chǎn)品的一種手段，RFID在訪問控制和越來越多的傳統(tǒng)應(yīng)用(如售票)中迅速得到采用。RFID系統(tǒng)一...
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Xilinx推出ISE設(shè)計套件11.1版本

  • 　　全球可編程邏輯解決方案領(lǐng)導(dǎo)廠商賽靈思公司今天宣布正式推出ISE® 設(shè)計套件11.1版本(ISE® Design Suite 11.1)。這一FPGA設(shè)計解決方案在業(yè)界率先為邏輯、數(shù)字信號處理、嵌入式處理以及系統(tǒng)級設(shè)計提供了完全可互操作的領(lǐng)域?qū)Ｓ迷O(shè)計流程和工具配置。 該新版本為面向多種市場和應(yīng)用的基于FPGA的片上系統(tǒng)解決方案提供了更簡單、更智能的設(shè)計方法。賽靈思公司致力于為設(shè)計人員提供目標(biāo)設(shè)計平臺，而ISE 設(shè)計套件 11.1版本的推出是一個重要的里程碑。 　　為更好地滿足當(dāng)前異常多
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賽靈思ISE 11.1 量身打造四種工具流程

  • 隨著Xilinx?ISE?設(shè)計套件11.1的推出，賽靈思在優(yōu)化設(shè)計方法、更好地滿足不同技能客戶的多樣化需求，以...
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ARM與臺積電合作40納米實體IP

  • 　　全球硅IP龍頭安謀(ARM)宣布與臺積電40納米泛用型制程合作實體IP。未來將鎖定磁碟機(jī)、機(jī)上盒、行動運(yùn)算裝置、網(wǎng)絡(luò)應(yīng)用、高傳真電視和繪圖處理器等芯片市場提供臺積電制程、安謀IP庫的制造服務(wù)。 　　安謀表示，與臺積電40納米泛用型制程合作的技術(shù)平臺包括高效能和高密度標(biāo)準(zhǔn)元件庫(Standard Cell libraries)、電源管理工具組和工具組元件庫，可以解決芯片設(shè)計所產(chǎn)生的漏電問題，進(jìn)階電源管理是安謀存儲器架構(gòu)不可或缺的一部分，有助于大幅降低系統(tǒng)單芯片設(shè)計動態(tài)功耗與漏電功耗，在多處理器架構(gòu)下發(fā)
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基于FPGA和LVDS技術(shù)的光纜傳輸技術(shù)

  • 為了解決彈上記錄器和地面測試臺之間高速數(shù)據(jù)流遠(yuǎn)距離傳輸問題，提出一種利用低電壓差分信號(LVDS)接口器件實現(xiàn)數(shù)據(jù)遠(yuǎn)距離傳輸?shù)脑O(shè)計方案。實驗證明該方案傳輸速度達(dá)到20 Mh／s，傳輸距離達(dá)到300 m，傳輸速度和傳輸距離得到顯著提高。該優(yōu)秀的長線傳輸技術(shù)已成功應(yīng)用于在某項目中。
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臺積電推展EDA、IP認(rèn)證機(jī)制

  • 　　臺積電將一統(tǒng)IP與EDA?臺積電針對65納米混訊與射頻制程推出設(shè)計套件，同時宣布未來IC設(shè)計客戶將采用由臺積電事先認(rèn)證過的IP、EDA工具以提升投片成功率。在臺積電揮舞認(rèn)證的大旗下，未來勢必使EDA廠商想跟臺積電密切合作都要先經(jīng)過認(rèn)證關(guān)卡，也將促使IC設(shè)計客戶跟進(jìn)選用臺積電認(rèn)可的IP與EDA工具，臺積電收編IP與EDA市場的用意明顯。 　　臺積電借著技術(shù)論壇期間宣布，推出全球第一套65納米射頻與混訊設(shè)計套件，為了推出這款套件，臺積電與EDA廠商Cadence合作數(shù)年，在臺積電開放創(chuàng)新平臺(OIP)上
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LEON2應(yīng)用于數(shù)字機(jī)頂盒CPU的FPGA仿真

  • 摘 要：采用免費(fèi)軟核LEON2作為數(shù)字機(jī)頂盒的CPU可以降低產(chǎn)品成本。為了使LEON2軟核能更快更好地應(yīng)用于數(shù)字機(jī)頂盒，選擇先在FPGA開發(fā)板上建立基于LEON2處理器的一個原型，通過這個原型對硬件性能進(jìn)行仿真，并且還可以在
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基于ARM的嵌入式TCP／IP協(xié)議的實現(xiàn)

  • 基于ARM的嵌入式TCP／IP協(xié)議的實現(xiàn),摘 要：分析嵌入式TCP／IP協(xié)議的選取原則，采用ARM芯片和網(wǎng)絡(luò)接口控制芯片設(shè)計以太網(wǎng)接口，介紹ARM芯片對網(wǎng)絡(luò)接口控制芯片的控制過程和TCP／IP協(xié)議棧處理數(shù)據(jù)包的流程，完成嵌入式TCP／IP系統(tǒng)的開發(fā)。該系統(tǒng)可以將數(shù)
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FPGA引腳信號指配的幾個原則

  • 現(xiàn)在的FPGA正變得越來越復(fù)雜，向引腳分配信號的任務(wù)曾經(jīng)很簡單，現(xiàn)在也變得相當(dāng)繁復(fù)。下面這些用于向多用途引腳...
  • 關(guān)鍵字： 引腳信號指配  FPGA  單極信號  

采用創(chuàng)新降耗技術(shù)應(yīng)對FPGA靜態(tài)和動態(tài)功耗的挑戰(zhàn)

  • 傳統(tǒng)上，數(shù)字邏輯并不耗費(fèi)大量靜態(tài)功耗，但隨著工藝節(jié)點的不斷精微，這一情況在發(fā)生顯著變化?，F(xiàn)在，隨著工藝尺度的...
  • 關(guān)鍵字： FPGA  動態(tài)功耗  動態(tài)功耗  Stratix  

利用低成本FPGA設(shè)計下一代游戲控制臺

  • 游戲控制臺設(shè)計者必須在實現(xiàn)系統(tǒng)的多功能、可靠性和低成本之間尋找平衡。市場壓力經(jīng)常迫使最初的控制臺價格...
  • 關(guān)鍵字： FPGA  游戲控制臺  DSP  

基于Verilog的FPGA與USB 2．0高速接口設(shè)計

  • 0 引 言
    USB(通用串行總線)是英特爾、微軟、IBM、康柏等公司1994年聯(lián)合制定的一種通用串行總線規(guī)范，它具有數(shù)據(jù)傳輸速度快，成本低，可靠性高，支持即插即用和熱插拔等優(yōu)點，迅速得到廣泛應(yīng)用。
    在高速的數(shù)
  • 關(guān)鍵字： Verilog  FPGA  USB  高速接口    

基于FPGA的UART模塊的設(shè)計

  • 0 引 言
    在計算機(jī)的數(shù)據(jù)通信中，外設(shè)一般不能與計算機(jī)直接相連，它們之間的信息交換主要存在以下問題：
    (1)速度不匹配。外設(shè)的工作速度和計算機(jī)的工作速度不一樣，而且外設(shè)之間的工作速度差異也比較大。
  • 關(guān)鍵字： FPGA  UART  模塊    

2009年4月22日，ARM發(fā)布40納米G物理IP平臺

  • 　　2009年4月22日 ARM發(fā)布業(yè)界最廣泛的40納米G物理IP平臺。AR M為臺積電的40納米G代工工藝提供高性能、低成本、高功效的物理IP庫，進(jìn)一步鞏固技術(shù)領(lǐng)先地位。
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基于FPGA的LVDS高速差分板間接口應(yīng)用

  • 隨著ADC器件速率的提高以及FPGA、DSP器件運(yùn)算速度的提升，高速AD和信號處理系統(tǒng)之間需要進(jìn)行高速、穩(wěn)定的數(shù)據(jù)傳輸，原來廣泛應(yīng)用CPCI以及FDPD高速總線的帶寬已經(jīng)無法滿足寬帶接收機(jī)的數(shù)據(jù)傳輸速率要求，成為影響接收機(jī)性能的新瓶頸。針對這一情況，提出了一種基于LVDS差分接口的DDR傳輸接口，解決了這一瓶頸，并且在實際硬件平臺上進(jìn)行了FPGA實現(xiàn)，達(dá)到了18．4 Gbit／s的接口速率。
  • 關(guān)鍵字： FPGA  LVDS  差分板  接口應(yīng)用    
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fpga ip介紹

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