fpga ip 文章最新資訊

基于FPGA的超聲電機(jī)驅(qū)動(dòng)控制電路

摘要：針對(duì)直線超聲電機(jī)的特點(diǎn)，設(shè)計(jì)了一種以FPGA為核心、基于SOPC技術(shù)和NiosⅡ軟核處理器的新型超聲電機(jī)驅(qū)動(dòng)控制器，以控制直線型超聲電機(jī)的速度和位移。該驅(qū)動(dòng)控制器把CPU、DDS模塊以及光柵反饋計(jì)數(shù)模塊都集成在一片F(xiàn)PGA中，具有電子元件使用少，功耗低，易修改、易升級(jí)等特點(diǎn)，為超聲電機(jī)的各種運(yùn)動(dòng)平臺(tái)提供了一個(gè)良好的閉環(huán)控制系統(tǒng)。超聲電機(jī)是一種新型微特電機(jī)，其工作原理是通過(guò)壓電材料的逆壓電效應(yīng)，使定子在超聲頻段微幅振動(dòng)，依靠摩擦將振動(dòng)轉(zhuǎn)換成動(dòng)子的旋轉(zhuǎn)(直線)運(yùn)動(dòng)。超聲電機(jī)具有體積小，重量輕、結(jié)構(gòu)緊
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Altera為下一代非易失FPGA提供早期使用軟件

　　Altera公司(Nasdaq: ALTR)今天宣布，為Altera最新的10代FPGA和SoC系列產(chǎn)品之一——MAX? 10 FPGA，提供Quartus? II beta軟件和早期使用文檔?；赥SMC的55 nm嵌入式閃存工藝技術(shù)，MAX 10 FPGA在小外形封裝、低成本和瞬時(shí)接通可編程邏輯器件中采用了先進(jìn)的工藝，是革命性的非易失FPGA。提供軟件支持和產(chǎn)品文檔，客戶可以馬上開(kāi)始他們的MAX 10 FPGA設(shè)計(jì)?！　ltera最近完成了首批MAX 10 FPGA投片，與TSMC合作將于201
關(guān)鍵字： Altera FPGA SoC

采用高性能SRAM提高DSP密集型應(yīng)用的性能

　　軍事與國(guó)防應(yīng)用極大地受益于數(shù)字信號(hào)處理器(DSP)，其廣泛應(yīng)用于雷達(dá)、軟件無(wú)線電(SDR)、靈巧彈藥與目標(biāo)探測(cè)系統(tǒng)、電子戰(zhàn)應(yīng)用、飛機(jī)成像以及眾多其它應(yīng)用。DSP借助其完美架構(gòu)提供的精確處理能力可以顯著提高性能。關(guān)鍵DSP功能包括實(shí)時(shí)信號(hào)處理、超高吞吐量與可重編程功能。本文介紹了如何采用高性能四倍數(shù)據(jù)速率(QDR)SRAM而使整體DSP系統(tǒng)性能至少提高兩倍(與使用SDRAM的傳統(tǒng)方法相比)的方法?！　?shù)字信號(hào)處理　　數(shù)字信號(hào)處理包含把信號(hào)轉(zhuǎn)換成數(shù)字形式后對(duì)其進(jìn)行處理的方法，如：雷達(dá)處理。雷達(dá)系統(tǒng)基本上是
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基于FPGA的高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)

隨著嵌入式技術(shù)的飛速發(fā)展，對(duì)嵌入式系統(tǒng)的應(yīng)用需求也呈現(xiàn)出不斷增長(zhǎng)的態(tài)勢(shì)，因此，嵌入式技術(shù)也相應(yīng)地取得了重要的進(jìn)展，系統(tǒng)設(shè)備不斷向高速化、集成化、低功耗的方向發(fā)展?，F(xiàn)場(chǎng)可編程門(mén)陣列FPGA經(jīng)過(guò)近20年的發(fā)展，到目前已成為實(shí)現(xiàn)數(shù)字系統(tǒng)的主流平臺(tái)之一。 FPGA具有單片機(jī)和DSP無(wú)法比擬的優(yōu)勢(shì)，相對(duì)于單片機(jī)和DSP工作需要依靠其上運(yùn)行的軟件進(jìn)行，F(xiàn)PGA全部的控制邏輯是由延時(shí)更小的硬件來(lái)完成的。通用串行總線(USB)是現(xiàn)代數(shù)據(jù)傳輸?shù)陌l(fā)展趨勢(shì)，是解決計(jì)算機(jī)與外設(shè)連接瓶頸的有效手段，USB2.O版本在原先的版本
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京微雅格推出國(guó)內(nèi)首款低功耗FPGA芯片CME-HR（黃河）系列

　　日前，京微雅格(北京)科技有限公司宣布適時(shí)推出了黃河系列CAP(可編程應(yīng)用平臺(tái))HR系列，以迎合低功耗，小封裝及靈活的應(yīng)用場(chǎng)景需求?！　?jù)京微雅格產(chǎn)品市場(chǎng)總監(jiān)竇祥峰介紹，其產(chǎn)品特點(diǎn)如下： CME-HR系列低功耗FPGA采用40納米臺(tái)聯(lián)電低功耗工藝，靜態(tài)最低功耗可達(dá)35.2uW，最小封裝WLCSP16僅1.5mm*1.5mm。　　該系列產(chǎn)品主要面向手持類或其它移動(dòng)便攜式終端與設(shè)備的相關(guān)應(yīng)用領(lǐng)域，該領(lǐng)域要求具備遠(yuǎn)程升級(jí)、動(dòng)態(tài)配置和功耗管理等功能，滿足LTE及未來(lái)的5G智能手機(jī)、便攜式智能終端(Tablet
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一種基于DSP與FPGA的高速通信接口設(shè)計(jì)方案

在雷達(dá)信號(hào)處理、數(shù)字圖像處理等領(lǐng)域中，信號(hào)處理的實(shí)時(shí)性至關(guān)重要。由于FPGA芯片在大數(shù)據(jù)量的底層算法處理上的優(yōu)勢(shì)及DSP芯片在復(fù)雜算法處理上的優(yōu)勢(shì)，DSP+FPGA的實(shí)時(shí)信號(hào)處理系統(tǒng)的應(yīng)用越來(lái)越廣泛。ADI公司的TigerSHARC系列DSP芯片浮點(diǎn)處理性能優(yōu)越，故基于這類。DSP的DSP+FPGA處理系統(tǒng)正廣泛應(yīng)用于復(fù)雜的信號(hào)處理領(lǐng)域。同時(shí)在這類實(shí)時(shí)處理系統(tǒng)中，F(xiàn)PGA與DSP芯片之間數(shù)據(jù)的實(shí)時(shí)通信至關(guān)重要。 TigerSHARC系列DSP芯片與外部進(jìn)行數(shù)據(jù)通信主要有兩種方式：總線方式和鏈路口方式。鏈
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基于FPGA的自適應(yīng)均衡器算法實(shí)現(xiàn)

摘要：近年來(lái)，自適應(yīng)均衡技術(shù)在通信系統(tǒng)中的應(yīng)用日益廣泛，利用自適應(yīng)均衡技術(shù)在多徑環(huán)境中可以有效地提高數(shù)字接收機(jī)的性能。為了適應(yīng)寬帶數(shù)字接收機(jī)的高速率特點(diǎn)，本文闡述了自適應(yīng)均衡器的原理并對(duì)其進(jìn)行改進(jìn)。最后使用FPGA芯片和Verilog HDL設(shè)計(jì)實(shí)現(xiàn)了自適應(yīng)均衡器并仿真驗(yàn)證了新方法的有效性。信道均衡技術(shù)(Channel equalization)是指為了提高衰落信道中的通信系統(tǒng)的傳輸性能而采取的一種抗衰落措施。它主要是減小信道的多徑時(shí)延帶來(lái)的碼間串?dāng)_(ISI)問(wèn)題。其原理是對(duì)信道或整個(gè)傳輸系統(tǒng)特性進(jìn)行
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京微雅格率先推出國(guó)內(nèi)首款低功耗FPGA芯片

京微雅格的HR系列FPGA芯片已經(jīng)能夠提供EVB，并預(yù)計(jì)今年第三季度大規(guī)模量產(chǎn)，已成為世界上除美國(guó)外唯一自主研發(fā)并成功量產(chǎn)FPGA產(chǎn)品的公司。
關(guān)鍵字：京微雅格 FPGA

在云端，還好嗎？

　　十四個(gè)月之前，我參加了一次Plunify的媒體沙龍活動(dòng)，寫(xiě)了一篇名為《云時(shí)代才剛剛開(kāi)始》的文章，談了一點(diǎn)我對(duì)把芯片設(shè)計(jì)結(jié)合云計(jì)算和對(duì)Plunify這家創(chuàng)業(yè)公司的看法。那時(shí)候，Plunify主推的業(yè)務(wù)是租用亞馬遜的服務(wù)器資源，搭建一個(gè)FPGA開(kāi)發(fā)的云端平臺(tái)，讓設(shè)計(jì)公司可以把設(shè)計(jì)方案上傳到云端來(lái)仿真，以節(jié)省大量的時(shí)間，同時(shí)也避開(kāi)了自建云的昂貴成本。　　一年過(guò)去了，我終于又有機(jī)會(huì)和Plunify做一次更加深入的交流，看看Plunify在中國(guó)大陸市場(chǎng)的深水里摸了一年石頭后，到底有沒(méi)有摸到魚(yú)。　　Plunify
關(guān)鍵字： Plunify 云端 FPGA InTime

逐夢(mèng)十年賽靈思

　　時(shí)間都去哪了?當(dāng)公司全球上下熱烈慶祝成立30周年的時(shí)候，回首我在賽靈思竟然也已有十載。從上海到北京，從新天地到盤(pán)古大觀，從北京最開(kāi)始幾個(gè)人的小辦事處到今天數(shù)十人數(shù)千規(guī)模的北京公司，我有幸見(jiàn)證了賽靈思在中國(guó)的巨大發(fā)展和變遷，但不變的是這份工作帶來(lái)的強(qiáng)大吸引力和提供給大家的實(shí)現(xiàn)夢(mèng)想的舞臺(tái)。　　賽靈思是我的第一份工作，一做就做了十年。很多周圍的同學(xué)朋友都已經(jīng)換了多家公司，也有很多在高校都成了學(xué)術(shù)帶頭人，教授，也不停地有獵頭和朋友追問(wèn)我為什么不愿意動(dòng)一動(dòng)。我清楚我的執(zhí)著和堅(jiān)守來(lái)源于公司人性化和平等的
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與輝煌30年的Xilinx共同成長(zhǎng)

　　今年是Xilinx 成立30周年。三十年足以讓一個(gè)人從懵懂到不惑，但三十年卻只能讓少數(shù)公司從初創(chuàng)到輝煌。而Xilinx 就用這三十年的光陰，不斷的成長(zhǎng)和蛻變，創(chuàng)造著一個(gè)行業(yè)的傳奇。　　9年前的7月我加入Xilinx 上海。至今還記得那天，在公司里迎接我的是一張張年輕而活力四射的笑臉。作為新的技術(shù)支持中心的經(jīng)理，我明白，我將和這些年輕而聰明的工程師們一起為解決客戶的應(yīng)用問(wèn)題而努力工作。加入Xilinx之前我就用過(guò)它的產(chǎn)品，也聽(tīng)說(shuō)它是一家具有尊重員工，客戶優(yōu)先等等優(yōu)秀企業(yè)文化的公司。技術(shù)領(lǐng)先的產(chǎn)品，尊
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Cadence推出16納米FinFET制程DDR4 PHY IP

　　全球電子設(shè)計(jì)創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計(jì)系統(tǒng)公司(NASDAQ: CDNS)于2014年5月20日宣布，立即推出基于臺(tái)積電16納米FinFET制程的DDR4 PHY IP(知識(shí)產(chǎn)權(quán))。16納米技術(shù)與Cadence創(chuàng)新的架構(gòu)相結(jié)合，可幫助客戶達(dá)到DDR4標(biāo)準(zhǔn)的最高性能，亦即達(dá)到3200Mbps的級(jí)別，相比之下，目前無(wú)論DDR3還是DDR4技術(shù)，最高也只能達(dá)到2133Mbps的性能。通過(guò)該技術(shù)，需要高內(nèi)存帶寬的服務(wù)器、網(wǎng)絡(luò)交換、存儲(chǔ)器結(jié)構(gòu)和其他片上系統(tǒng)(SoC)現(xiàn)在可以使用Cadence? DD
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基于OMAP平臺(tái)的TCP/IP開(kāi)發(fā)及實(shí)現(xiàn)

隨著人們對(duì)智能化產(chǎn)品需求的增加，未來(lái)的嵌入式產(chǎn)品，包括各種家電、通信、PDA、儀器儀表等設(shè)備正逐漸走向網(wǎng)絡(luò)化，以共享互聯(lián)網(wǎng)中龐大的信息資源，因此使嵌入式設(shè)備的網(wǎng)絡(luò)化開(kāi)發(fā)有廣闊市場(chǎng)前景，由于嵌入式硬件資源有限，而傳統(tǒng)的TCP/IP等網(wǎng)絡(luò)通信協(xié)議對(duì)計(jì)算機(jī)存儲(chǔ)器、運(yùn)算速度的要求較高，所以不能直接應(yīng)用，為此，必須開(kāi)發(fā)一套適合嵌入式系統(tǒng)的、高度優(yōu)化的、最為精簡(jiǎn)的TCP/IP協(xié)議棧。開(kāi)放式多媒體應(yīng)用平臺(tái)OMAP(Open Multimedia Application Platform)是美國(guó)德州儀器公司推出的高度
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一種基于Linux的TCP/IP編程實(shí)現(xiàn)文件傳輸實(shí)例

1 引言 Linux 是一種自由的Unix類多用戶，多任務(wù)的操作系統(tǒng)，可在運(yùn)行在Intel 80386及更高檔次的PC機(jī)、ARMS、MIPS和PowerPC等多種計(jì)算機(jī)平臺(tái)，已成為應(yīng)用廣泛、可靠性高、功能強(qiáng)大的計(jì)算機(jī)操作系統(tǒng)，Linux 具有內(nèi)核小、效率高、源代碼開(kāi)放等優(yōu)點(diǎn)，還內(nèi)含了TCP/IP網(wǎng)絡(luò)協(xié)議，很適合在服務(wù)器領(lǐng)域使用，而服務(wù)器主要用途之一就是進(jìn)行網(wǎng)絡(luò)通信，隨著計(jì)算機(jī)辦公自動(dòng)化處理技術(shù)的應(yīng)用與推廣，網(wǎng)絡(luò)的不斷普及，傳統(tǒng)的紙張式文件傳輸方式已經(jīng)不再適合發(fā)展的需要，人們更期待一種便捷、高效、環(huán)保、安
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基于VHDL和QuartusⅡ的數(shù)字電子鐘設(shè)計(jì)與實(shí)現(xiàn)

摘要：采用FPGA進(jìn)行的數(shù)字電路設(shè)計(jì)具有更大的靈活性和通用性，已成為目前數(shù)字電路設(shè)計(jì)的主流方法之一。本文給出一種基于FPGA的數(shù)字鐘設(shè)計(jì)方案。該方案采用VHDL設(shè)計(jì)底層模塊，采用電路原理圖設(shè)計(jì)頂層系統(tǒng)。整個(gè)系統(tǒng)在QuartusⅡ開(kāi)發(fā)平臺(tái)上完成設(shè)計(jì)、編譯和仿真，并在FPGA硬件實(shí)驗(yàn)箱上進(jìn)行測(cè)試。測(cè)試結(jié)果表明該設(shè)計(jì)方案切實(shí)可行。 EDA(Electronic Design Automation)又名電子設(shè)計(jì)自動(dòng)化，其基本特征是：以超大規(guī)模可編程邏輯器件，如FPGA，為設(shè)計(jì)載體，以硬件描述語(yǔ)言，如VHDL，為
關(guān)鍵字： FPGA QuartusⅡ