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楷登電子(美國 Cadence 公司)與西安電子科技大學共同宣布，Cadence將與西安電子科技大學攜手共建集成電路設計培訓中心(下稱“聯合培訓中心”)，并在西安電子科技大學隆重舉行了西電、CSIP、Cadence戰(zhàn)略合作會議暨聯合培訓中心揭牌儀式。西安電子科技大學副校長李建東和Cadence全球副總裁兼亞太區(qū)總裁石豐瑜先生，與陜西省工業(yè)和信息化廳電子信息處處長高翔和工業(yè)和信息化部軟件與集成電路促進中心集成電路處負責人霍雨濤共同為聯合培訓中心進行揭牌。在揭牌儀式之后，西安電子科
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Cadence 集成電路
歐萊特SBS-15全自動干手器電路原理如圖所示。電路主要由電源電路、控制電路、烘手電路組成(點擊放大)。1.電源電路AC220V電壓經保險管FU送至變壓器T初級，其次級輸出的16V左右交流電加至由D1~D4構成的整流橋...
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歐萊特 SBS-15 全自動干手器
FPGA嵌入式設計中，常通過軟件編程的方式來訪問或者控制某些外圍設備。電路設計軟件Altium Designer的軟件平臺構建器(SPB)是一個包含了用于創(chuàng)建復雜軟件系統所需的所有驅動和服務程序的軟件構架。SPB中的軟件IP模塊可以屏蔽底層細節(jié)，為FPGA嵌入式設計的快速開發(fā)提供便利，提高研發(fā)效率。介紹了基于SPB的FPGA嵌入式設計關鍵技術，并在智能開發(fā)平臺NanoBoard 3000上實現了基于SPB的嵌入式音頻處理系統設計。
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SPB 嵌入式 音頻處理 系統設計
益華電腦(Cadence Design Systems, Inc.)宣布，展訊通訊(上海)公司(Spreadtrum Communications (Shanghai) Co., Ltd.,)運用全新的 Cadence Innovus 設計實現系統，大幅縮短數百
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展訊 Cadence
ARM?今日宣布加強在中國的戰(zhàn)略部署，與重慶市政府、重慶仙桃數據谷達成多項協議，建立合作計劃，共同推進重慶仙桃數據谷電子產業(yè)創(chuàng)新生態(tài)圈建設。當日，雙方共同為位于仙桃數據谷的ARM生態(tài)產業(yè)園揭幕;并宣布成立重慶地區(qū)ARM生態(tài)集成電路人才培養(yǎng)與產學研協同創(chuàng)新聯盟，建立重慶ARM生態(tài)產業(yè)技術人才實訓中心;此外，由ARM和中科創(chuàng)達共同投資的創(chuàng)業(yè)加速器安創(chuàng)空間宣布其重慶公司開業(yè)，正式落戶重慶仙桃數據谷ARM生態(tài)產業(yè)園?！ ?nbsp;
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ARM Cadence
Cadence設計系統公司今日宣布，正式交付完整的數字與簽核參考流程，用于Imagination Technologies (IMG.L)公司PowerVR Series7圖形處理單元(GPU)。采用此高度集成的Cadence® 參考流程，550萬實例的完整合成與設計實現可在2.5天完成。對比上一代Cadence設計流程，產品開發(fā)設計時間縮短1倍以上。同時，采納新參考流程后，芯片面積平均縮小3%，Imagination最復雜的組塊面積可縮小達7%。
此參考流程操作簡單，僅需單次執(zhí)行;同時
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Cadence GPU
當有上千名工程師與有關當局人士聚集在某地，準備花三個星期的時間審查修訂一個復雜的議題，像是如何在全球范圍內為不同的無線通訊網路與應用分配稀疏的頻譜，妥協至關重要。
由國際電信聯盟(ITU;為聯合國旗下負責資通訊技術的專門組織)主持、在11月2日至27日于瑞士日內瓦舉行的世界無線電通訊大會(World Radiocommunications Conference，WRC)就是這樣的情形;每四年舉行一次的WRC (在今年度舉行的會議簡寫為WRC-15)不可避免地必須討論廣泛的議題，其中有很大一部分是
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WRC-15
Cadence作為全球EDA電子設計自動化領導廠商，其Palladium平臺自2001年推出以來，給眾多系統芯片開發(fā)商在提高設計水平、驗證以前無法實現的性能與擴展性方面帶來了巨大的幫助。今天，Cadence正式推出Cadence Palladium Z1企業(yè)級硬件仿真加速平臺。 Palladium Z1：業(yè)內第一個數據中心級硬件仿真加速器 據介紹，這是業(yè)內第一個數據中心級硬件仿真加速器，仿真處理能力是上一代產品(Palladium XP II)的5
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Cadence Palladium
國際電聯世界無線電通信大會WRC-15做出重要決定，將在國際電聯1區(qū)(歐洲、非洲、中東和中亞)的 694MHz~790MHz 頻段提供移動寬帶增容和數字紅利落實工作的全球協調解決方案。 根據該決定，與2007年世界無線電通信大會(WRC-07)為國際電聯2區(qū)(美洲)和3區(qū)(亞太)做出的決定相同，將這一頻段劃分給國際電聯1區(qū)的移動業(yè)務并確定用于國際移動通信(IMT)?！ H電聯表示，WRC-15通過的規(guī)定將向電視廣播，尤其是區(qū)域通信聯合(RCC)國家在此頻段運行的航空無線電導航系統提供充分保護。該聯
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WRC-15 寬帶
兩岸的IC設計公司在先進制程節(jié)點晶片設計和其復雜度的進展令全球半導體界矚目。于此同時，對領先EDA工具的需求也持續(xù)上升。
Cadence在今年上半年推出了Innovus設計實現系統，稱其為新一代的實體設計實現解決方案，使系統開發(fā)人員能夠在先進的16/14/10奈米FinFET制程以及其他成熟的制程節(jié)點上交付最佳功耗、性能和面積(PPA)指標的設計。
2015年10月中旬，我拜訪了Cadence位于美國矽谷的總部，與Cadence公司設計實作產品事業(yè)部的產品管理總監(jiān)Vinay Patward
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Cadence IC設計
全球電子設計創(chuàng)新領先公司Cadence設計系統公司 (Cadence Design Systems, Inc.)宣布：將于8月13日(星期四)在上海浦東嘉里大酒店舉辦一年一度的中國用戶大會——CDNLive China 2015!以“聯結，分享，啟發(fā)!”為主題的CDNLive大會將集聚超過700位IC行業(yè)從業(yè)者，包括IC設計工程師、系統開發(fā)者與業(yè)界專家，將分享重要半導體設計領域的解決方案和成功經驗，讓參與者獲得知識、靈感與動力，并為實現高階半導體芯片、S
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Cadence SoC
益華電腦(Cadence)推出下一代Cadence JasperGold形式驗證平臺，此新型形式驗證解決方案將Cadence Incisive形式與JasperGold技術整合為單一平臺，與以往解決方案相比，效能可增加至15倍。此外，整合至Cadence系統開發(fā)套裝(Cadence System Development Suite)后，JasperGold技術可縮短驗證時程達3個月。
JasperGold形式(formal)與形式輔助技術整合至Cadence系統開發(fā)套
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Cadence JasperGold
Cadence(Cadence Design Systems, Inc. )今天發(fā)布Cadence® Innovus™ 設計實現系統，這是新一代的物理設計實現解決方案，使系統芯片(system-on-chip，SoC)開發(fā)人員能夠在加速上市時間的同時交付最佳功耗、性能和面積(PPA)指標的的設計。Innovus設計實現系統由具備突破性優(yōu)化技術所構成的大規(guī)模的并行架構所驅動，在先進的16/14/10納米FinFET工藝制程和其他成熟的制程節(jié)點上通常能提升10%到20%的功耗、性能和面
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Cadence SoC
Cadence今天宣布燦芯半導體(Brite Semiconductor Corporation)運用Cadence® 數字設計實現和signoff工具，完成了4個28nm系統級芯片(SoC)的設計，相比于先前的設計工具，使其產品上市時間縮短了3周。通過使用Cadence設計工具，燦芯半導體的設計項目實現了提升20%的性能和節(jié)省10%的功耗。
燦芯半導體使用Cadence Encounter® 數字設計實現系統用于物理實現、Cadence Voltus™ IC電源完整
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Cadence SoC
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