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集成計(jì)數(shù)器74LS161的邏輯功能擴(kuò)展

作者: 時(shí)間:2011-05-17 來(lái)源:網(wǎng)絡(luò) 收藏

由圖2,圖3可知,將加法狀態(tài)圖中每一狀態(tài)中各位取反即為減法的狀態(tài)圖。
以可編程的狀態(tài)輸出Q3,Q2,Q1,Q0為變量并增設(shè)一個(gè)加/減控制變量M進(jìn)行修改設(shè)計(jì),在M=0時(shí)各位狀態(tài)輸出不變,計(jì)數(shù)器進(jìn)行加法計(jì)數(shù);在M=1時(shí)各位狀態(tài)輸出取反,計(jì)數(shù)器進(jìn)行減法計(jì)數(shù),設(shè)修改設(shè)計(jì)后的計(jì)數(shù)器的狀態(tài)輸出為m.jpg,表2為修改的真值表。

本文引用地址:http://www.bjwjmy.cn/article/150742.htm

c.JPG


由表2可得修改后的狀態(tài)輸出邏輯表達(dá)式為:
d.JPG
圖4為按式(1)構(gòu)成的加/減可逆計(jì)數(shù)器的邏輯圖,其中,C在加法計(jì)數(shù)時(shí)為進(jìn)位輸出、在減法計(jì)數(shù)時(shí)為借位輸出。

e.JPG


1.2 可編程計(jì)數(shù)器構(gòu)成移位寄存器
將可編程計(jì)數(shù)器的狀態(tài)輸出反饋到預(yù)置數(shù)輸入端,實(shí)現(xiàn)“次態(tài)=預(yù)置數(shù)”的時(shí)序關(guān)系,可構(gòu)成移位寄存器電路。
f.JPG

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