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基于FPGA的HDLC轉E1傳輸控制器的實現(xiàn)

  • 摘    要：本文介紹了一種用FPGA實現(xiàn)的HDLC轉E1的協(xié)議控制器，能實現(xiàn)將速率為N
  • 關鍵字： E1  FPGA  HDLC  幀結構  

RF 功率控制電路的電壓級設定

  • 2004年7月B版 　　典型的現(xiàn)代通信信號鏈由發(fā)射和接收端組成，兩個部分都需要RF(射頻)功率監(jiān)測和控制(圖1)。目前，在兩部分電路中，RF功率的監(jiān)測通常都采用將功率監(jiān)測和基于基準電壓設定點的自動增益控制(AGC)技術結合起來的技術。接收端的信號監(jiān)測往往是在中頻(IF)完成的，而發(fā)射端的功率監(jiān)測則可以在RF 或IF部分完成。兩種最常見的方法是給控制鏈(往往在中頻)添加一個可變增益放大器(variable-gain amplifier，VGA)，或者通過調節(jié)功率放大器(PA)的偏壓直接對RF信號進行控制。
  • 關鍵字： RF專題  RF  IF  

嵌入式系統(tǒng)中FPGA的被動串行配置方式

  • 嵌入式系統(tǒng)中FPGA的被動串行配置方式,介紹一種在嵌放式系統(tǒng)中使用微處理器被動串行配置方式實現(xiàn)對FPGA配置的方案，將系統(tǒng)程序及配置文件存在系統(tǒng)Flash中，利用微處理器的I/O口產(chǎn)生配置時序，省去配置器件；討論FPGA的各種配置方式及各種配置文件的使用。
  • 關鍵字： 配置  方式  串行  被動  系統(tǒng)  FPGA  嵌入式  

數(shù)字頻率合成器的FPGA實現(xiàn)

  • 介紹了DDFS的原理和Altera公司的FPGA器件ACEX 1K的主要特點，給出了用ACEX 1K系列器件EP1K10TC144－1實現(xiàn)數(shù)字頻率合成器的工作原理、設計思路、電路結構和仿真結果。
  • 關鍵字： FPGA  數(shù)字頻率合成器    

基于MicroBlaze軟核的FPGA片上系統(tǒng)設計

  • 分析軟處理器MicroBlaze的體系結構，給出MicroBlaze內(nèi)核在軟件無線電系統(tǒng)中的應用，實現(xiàn)SOPC（可編程系統(tǒng)芯片）。
  • 關鍵字： MicroBlaze  FPGA  軟核  片上系統(tǒng)    

Stratix II FPGA：成功的90nm開發(fā)和推出案例研究

  • Stratix II FPGA：成功的90nm開發(fā)和推出案例研究
  • 關鍵字： Stratix  FPGA  II  90    

用FPGA實現(xiàn)1553B總線接口中的曼碼編解碼器

基于FPGA的高頻時鐘的分頻和分配設計

  • 介紹了為PET（正電子發(fā)射斷層掃描儀）的前端電子學模塊提供時間基準而設計的一種新型高頻時鐘扇出電路。
  • 關鍵字： FPGA  高頻時鐘  分頻  分配    

基于FPGA的新型諧波分析儀設計

  • 給出一種基于FPGA的新型諧波分析儀的設計方案。
  • 關鍵字： FPGA  諧波分析儀    

數(shù)字簽名算法SHA-1的FPGA高速實現(xiàn)

  • 常用的信息驗證碼是使用單向散列函數(shù)生成驗證碼，安全散列算法SHA-1使用在是因特網(wǎng)協(xié)議安全性(IPSec)標準中。
  • 關鍵字： FPGA  SHA  數(shù)字簽名算法  高速實現(xiàn)    

FPGA芯片APA150及其應用

  • 文章介紹了APA150的主要特點、內(nèi)部結構、主要性能參數(shù)，給出了APA150在通信系統(tǒng)設計中的應用實例。
  • 關鍵字： FPGA  APA  150  芯片    

基于FPGA的快速傅立葉變換

  • 在對FFT（快速傅立葉變換）算法進行研究的基礎上，描述了用FPGA實現(xiàn)FFT的方法，并對其中的整體結構、蝶形單元及性能等進行了分析。
  • 關鍵字： FPGA  傅立葉變換    

異步FIFO結構及FPGA設計

  • 首先介紹異步FIFO的概念、應用及其結構，然后分析實現(xiàn)異步FIFO的難點問題及其解決辦法；在傳統(tǒng)設計的基礎上提出一種新穎的電路結構并對其進行綜合仿真和FPGA實現(xiàn)。
  • 關鍵字： FIFO  FPGA    

3-DES算法的FPGA高速實現(xiàn)

  • 介紹3-DES算法的概要；以Xilinx公司SPARTANII結構的XC2S100為例，闡述用FPGA高速實現(xiàn)3-DES算法的設計要點及關鍵部分的設計。
  • 關鍵字： FPGA  DES  算法  高速實現(xiàn)    

基于CPLD/FPGA的半整數(shù)分頻器的設計

  • 簡要介紹了CPLD/FPGA器件的特點和應用范圍，并以分頻比為2.5的半整數(shù)分頻器的設計為例，介紹了在MAX+plus II開發(fā)軟件下，利用VHDL硬件描述語言以及原理圖的輸入方式來設計數(shù)字邏輯電路的過程和方法。
  • 關鍵字： CPLD  FPGA  整數(shù)  分頻器    
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