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RF WCDMA基準(zhǔn)比較測(cè)試
- 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
- 關(guān)鍵字: 基準(zhǔn)比較測(cè)試 RF WCDMA PXI RF儀器
基于FPGA的汽車(chē)視頻和圖形控制系統(tǒng)設(shè)計(jì)
- LCD顯示器真是無(wú)處不在,在家庭、超市、體育館以及汽車(chē)內(nèi)你都可以見(jiàn)到它們的身影。無(wú)疑車(chē)載LCD顯示系統(tǒng)是增長(zhǎng)最快的市場(chǎng)。增長(zhǎng)的動(dòng)力包括:不斷下降的顯示器價(jià)格、不斷提升的用戶(hù)體驗(yàn)、更多的產(chǎn)品性能以及車(chē)內(nèi)消費(fèi)類(lèi)
- 關(guān)鍵字: FPGA 汽車(chē)視頻 控制系統(tǒng)設(shè)計(jì)
設(shè)定相位同調(diào) RF 量測(cè)系統(tǒng):從 MIMO 到波束賦形
- 設(shè)定相位同調(diào) RF 量測(cè)系統(tǒng):從 MIMO 到波束賦形概觀自從傳送出第一筆無(wú)線(xiàn)電波之后,工程師就持續(xù)發(fā)明新方法,以?xún)?yōu)化電磁微波訊號(hào)。RF 訊號(hào)已廣泛用于多種應(yīng)用,其中又以無(wú)線(xiàn)通信與 RADAR 的 2 項(xiàng)特殊應(yīng)用正利用此常見(jiàn)
- 關(guān)鍵字: MIMO RF 設(shè)定 量測(cè)系統(tǒng)
基于FPGA的移動(dòng)通信中卷積碼編碼器設(shè)計(jì)

- 摘要:卷積碼是一種性能優(yōu)良的差錯(cuò)控制編碼。介紹了卷積碼編碼原理,基于FPGA利用VHDL硬件描述語(yǔ)言實(shí)現(xiàn)了一個(gè)(2,1,9)卷積碼編碼器。給出了仿真結(jié)果,并在FPGA器件上驗(yàn)證實(shí)現(xiàn)。仿真及測(cè)試結(jié)果表明,達(dá)到了預(yù)期的設(shè)計(jì)
- 關(guān)鍵字: 設(shè)計(jì) 編碼器 移動(dòng)通信 FPGA 基于
基于FPGA的無(wú)線(xiàn)信道模擬器設(shè)計(jì)
- 摘要:為了縮短研發(fā)周期,需要在實(shí)驗(yàn)室模擬出無(wú)線(xiàn)信道的各種傳播特性,無(wú)線(xiàn)信道模擬器設(shè)計(jì)必不可少。采用基于頻率選擇性信道Jakes仿真器模型,使用Xilinx公司的VIrtex-2p模擬實(shí)現(xiàn)了頻率選擇性衰落信道,最后將數(shù)據(jù)通
- 關(guān)鍵字: FPGA 無(wú)線(xiàn) 信道模擬器
FPGA的基本結(jié)構(gòu)
- 一、FPGA的基本結(jié)構(gòu)FPGA由6部分組成,分別為可編程輸入/輸出單元、基本可編程邏輯單元、嵌入式塊RAM、豐富的布線(xiàn)資源、底層嵌入功能單元和內(nèi)嵌專(zhuān)用硬核等。每個(gè)單元簡(jiǎn)介如下:1.可編程輸入/輸出單元(I/O單元)目前大
- 關(guān)鍵字: FPGA 基本結(jié)構(gòu)
基于CPLD的多DSP及FPGA遠(yuǎn)程加載設(shè)計(jì)
- 摘要:介紹了一種以CPLD為基礎(chǔ)的對(duì)多DSP和FPCA芯片實(shí)現(xiàn)程序遠(yuǎn)程更新、加載的設(shè)計(jì)方法。詳細(xì)分析了軟硬件架構(gòu)及具體實(shí)施方案,對(duì)以DSP+FPCA為架構(gòu)的信號(hào)處理模塊實(shí)現(xiàn)遠(yuǎn)程更新、加載,有重要的使用價(jià)值。
關(guān)鍵詞:遠(yuǎn)程 - 關(guān)鍵字: CPLD FPGA DSP 遠(yuǎn)程加載
FPGA/CPLD中常見(jiàn)模塊設(shè)計(jì)精華集錦(一)
- 一、智能全數(shù)字鎖相環(huán)的設(shè)計(jì) 1 引言 數(shù)字鎖相環(huán)路已在數(shù)字通信、無(wú)線(xiàn)電電子學(xué)及電力系統(tǒng)自動(dòng)化等領(lǐng)域中得到了極為廣泛的應(yīng)用。隨著集成電路技術(shù)的發(fā)展,不僅能夠制成頻率較高的單片集成鎖相環(huán)路,而且可以把整
- 關(guān)鍵字: FPGA CPLD 模塊設(shè)計(jì) 集錦
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