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mcu-fpga 文章 最新資訊

基于FPGA嵌入式系統(tǒng)的雷達(dá)目標(biāo)模擬器的設(shè)計

  • 基于FPGA嵌入式系統(tǒng)的雷達(dá)目標(biāo)模擬器的設(shè)計,人為地對雷達(dá)進(jìn)行測試時，有時只對雷達(dá)的某個和某些參數(shù)感興趣，希望在回波中表征感興趣的參數(shù)強(qiáng)一些，這時就應(yīng)該在回波中去掉雜波和噪聲的影響，而這在實(shí)際的外場試飛過程中是不可能實(shí)現(xiàn)的，這也是雷達(dá)信號模擬器對
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MCU+DSP雙處理器的嵌入式平臺構(gòu)建

  • MCU+DSP雙處理器的嵌入式平臺構(gòu)建,自動化控制要求實(shí)時采集數(shù)據(jù)，快速控制，多樣分析，通信靈活，雖然采用單個處理器構(gòu)成的硬件平臺不能滿足要求。采用以MCU+DSP雙處理器為核心的硬件平臺則是較合理的設(shè)計方案。利用DSP實(shí)現(xiàn)數(shù)據(jù)實(shí)時采集、分析、計算;M
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基于MCU和FPGA的LED圖文顯示屏控制系統(tǒng)

  • 　　引言　　目前，市場上的中小規(guī)模LED顯示系統(tǒng)，一般采用傳統(tǒng)的單片機(jī)作為主控芯片。對LED大屏幕顯示屏來說，由于數(shù)據(jù)傳輸量大，要求掃描速度快，而單片機(jī)內(nèi)部的資源較少、運(yùn)行速度較慢，難于滿足系統(tǒng)要求。以FPGA
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基于便攜式DAB接收機(jī)的MP3播放器設(shè)計

  • 引言近年來，數(shù)字音頻廣播(DigitalAudioBroadcasting，DAB)憑借其音質(zhì)好，靈敏度高，頻譜利用率高等諸多優(yōu)點(diǎn)引起...
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基于FPGA的PCM3032路系統(tǒng)信號同步數(shù)字復(fù)接設(shè)計

  • 摘要：在現(xiàn)代數(shù)字通信系統(tǒng)中，為了擴(kuò)大信道的傳輸容量提高信號傳輸效率，常采用數(shù)字復(fù)接的技術(shù)。在分析了PCM30／32...
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基于FPGA雷達(dá)多目標(biāo)模擬器DRFM設(shè)計與實(shí)現(xiàn)

  • 研究了雷達(dá)多目標(biāo)模擬系統(tǒng)中數(shù)字射頻存儲(DRFM)單元的設(shè)計與實(shí)現(xiàn)，根據(jù)模擬系統(tǒng)的設(shè)計要求, 提出一種基于高性能 FPGA數(shù)字射頻存儲單元設(shè)計方法；著重闡述了數(shù)字射頻存儲單元的設(shè)計思路, 給出了系統(tǒng)的設(shè)計方案, 并對系統(tǒng)中雷達(dá)模擬目標(biāo)的各功能模塊進(jìn)行了分析，實(shí)驗結(jié)果表明，所設(shè)計的DRFM滿足設(shè)計系統(tǒng)要求。
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FPGA與單片機(jī)實(shí)現(xiàn)低頻數(shù)字式相位測量儀

  • FPGA與單片機(jī)實(shí)現(xiàn)低頻數(shù)字式相位測量儀,摘要：提出了以AVR ATmega128單片機(jī)和Altera公司的Cyclone系列EP1C3T100為核心的系統(tǒng)設(shè)計方案。分析了數(shù)字式低頻相位測量儀的測量原理和測量誤差及其消除的方法。主要介紹了系統(tǒng)的軟硬件設(shè)計。實(shí)踐表明，此方案設(shè)計的
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基于TMS320C6416與FPGA的實(shí)時光電圖像識別系統(tǒng)

  • 基于TMS320C6416與FPGA的實(shí)時光電圖像識別系統(tǒng),光電混合模式識別以其高速并行處理和無串?dāng)_的優(yōu)點(diǎn)成為實(shí)現(xiàn)模式識別實(shí)用化和實(shí)時化的重要途徑，其在目標(biāo)識別、指紋識別、光纖檢測、工業(yè)零件識別、汽車牌照識別等領(lǐng)域得到了廣泛的研究和應(yīng)用[1.2]，并取得了很好的識別
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FPGA設(shè)計中毛刺信號解析

  • FPGA設(shè)計中毛刺信號解析,在FPGA的設(shè)計中，毛刺現(xiàn)象是長期困擾電子設(shè)計工程師的設(shè)計問題之一, 是影響工程師設(shè)計效率和數(shù)字系統(tǒng)設(shè)計有效性和可靠性的主要因素。由于信號在FPGA的內(nèi)部走線和通過邏輯單元時造成的延遲,在多路信號變化的瞬間，組合
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豐田“普銳斯α”新技術(shù)：只通過改變軟件便可抑制車輛縱搖速度

基于FPGA的超聲波信號處理研究

  • 摘要：為了降低超聲波流量檢測過程中噪聲對檢測精度的影響，采用FPGA器件構(gòu)建了FIR濾波器，并提出一種新穎的查表法替代濾波器中的乘法運(yùn)算。試驗結(jié)果表明，該濾波器設(shè)計方法顯著降低了FPGA的片內(nèi)硬件開銷，提高了濾波
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基于FPGA的PCM30／32路系統(tǒng)信號同步數(shù)字復(fù)接設(shè)計

  • 摘要：在現(xiàn)代數(shù)字通信系統(tǒng)中，為了擴(kuò)大信道的傳輸容量提高信號傳輸效率，常采用數(shù)字復(fù)接的技術(shù)。在分析了PCM30／32路系統(tǒng)基群信號幀結(jié)構(gòu)的基礎(chǔ)上，以EDA綜合仿真設(shè)計軟件QuartusⅡ8．0為開發(fā)平臺，利用Verilog HDL硬
  • 關(guān)鍵字： FPGA  PCM  30  系統(tǒng)    

LTE中卷積碼的譯碼器設(shè)計與FPGA實(shí)現(xiàn)

  • 摘要：基于長期演進(jìn)(LTE)的Tail-biting卷積碼，介紹了維特比譯碼算法，它是一種最優(yōu)的卷積碼譯碼算法。由于Tail-biting卷積碼的循環(huán)特性，采用固定延遲譯碼的方法，降低了譯碼復(fù)雜度。通過使用全并行的結(jié)構(gòu)及簡單的回
  • 關(guān)鍵字： FPGA  LTE  卷積碼  譯碼器    

馬自達(dá)“德米歐”配備SKYACTIV技術(shù)將燃效提高三成

車載多媒體系統(tǒng)數(shù)字音效DSP的軟件設(shè)計

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