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matlab parallel server
matlab parallel server 文章 進(jìn)入matlab parallel server技術(shù)社區(qū)
基于Matlab GUI的整流電路仿真設(shè)計(jì)
- 以Matlab/Simulink仿真軟件為基礎(chǔ),利用Power System工具箱完成了整流電路的建模與仿真,同時(shí)利用Matlab的圖形用戶界面(G-UI)設(shè)計(jì)了整流電路的分析界面,借助此界面時(shí)Simulink模型進(jìn)行操作,可以方便地實(shí)現(xiàn)時(shí)模型參數(shù)的設(shè)置和修改、模型的查看和修正、仿真的顯示及相關(guān)的輔助操作,極大地簡(jiǎn)化了仿真的操作過程,提高了仿真的效率。此界面友好、開放,仿真結(jié)果即時(shí)可見,既可為建立其他類型的電力電子電路仿真界面提供重要參考,也可用于指導(dǎo)實(shí)際系統(tǒng)的設(shè)計(jì)。
- 關(guān)鍵字: 仿真 設(shè)計(jì) 電路 整流 Matlab GUI 基于
基于Matlab和VC++混合編程的障礙檢測(cè)系統(tǒng)設(shè)計(jì)

- 摘要:文中主要研究移動(dòng)機(jī)器人在環(huán)境未知情況下的障礙物檢測(cè)問題,提出了一種基于Matlab和VC++混合編程的障礙物檢測(cè)系統(tǒng)軟件實(shí)現(xiàn)方法。該方法整合了MATLAB的數(shù)值計(jì)算功能,具有強(qiáng)大的圖形、圖像處理功能和VC++的可視
- 關(guān)鍵字: 障礙 檢測(cè)系統(tǒng) 設(shè)計(jì) 編程 混合 Matlab VC 基于
基于Matlab/DSP Builder任意波形信號(hào)發(fā)生器的兩種設(shè)計(jì)

- 基于Matlab/DSP Builder任意波形信號(hào)發(fā)生器的兩種設(shè)計(jì),根據(jù)傳統(tǒng)型任意波形信號(hào)發(fā)生器和基于DDS任意波形信號(hào)發(fā)生器的設(shè)計(jì)原理,采用Matlab/DSP Builder的建模方法,在DSP Builder平臺(tái)上完成兩種原理的系統(tǒng)建模和仿真,并用SignalCompiler工具對(duì)模型進(jìn)行編譯,產(chǎn)生QuartusⅡ能夠識(shí)別的VHDL源程序,并通過FPGA芯片EP2C8Q208C來(lái)實(shí)現(xiàn),最后用SignalTapⅡ進(jìn)行硬件測(cè)試。經(jīng)系統(tǒng)仿真和硬件測(cè)試,證明兩種設(shè)計(jì)方法的正確性。比較傳統(tǒng)的硬件描述語(yǔ)言建模
- 關(guān)鍵字: 波形 信號(hào)發(fā)生器 設(shè)計(jì) 任意 Builder Matlab DSP 基于
SQL Server存儲(chǔ)過程編寫和優(yōu)化
- SQL Server存儲(chǔ)過程編寫和優(yōu)化,一、適合讀者對(duì)象:數(shù)據(jù)庫(kù)開發(fā)程序員,數(shù)據(jù)庫(kù)的數(shù)據(jù)量很多,涉及到對(duì)SP(存儲(chǔ)過程)的優(yōu)化的項(xiàng)目開發(fā)人員,對(duì)數(shù)據(jù)庫(kù)有濃厚興趣的人?! 《?、介紹:在數(shù)據(jù)庫(kù)的開發(fā)過程中,經(jīng)常會(huì)遇到復(fù)雜的業(yè)務(wù)邏輯和對(duì)數(shù)據(jù)庫(kù)的操作,
- 關(guān)鍵字: 編寫 優(yōu)化 過程 存儲(chǔ) Server SQL
基于MATLAB在IIR濾波器的設(shè)計(jì)與仿真
- 利用MATLAB的強(qiáng)大運(yùn)算功能,基于MATLAB的信號(hào)處理工具箱(Signal Processing Toolbox)的數(shù)字濾波器設(shè)計(jì)法可以快速有效地設(shè)計(jì)由軟件組成的常規(guī)數(shù)字濾波器,設(shè)計(jì)方便、快捷,大大減輕了工作量。在設(shè)計(jì)過程中可以對(duì)比濾波器特性。隨時(shí)更改參數(shù),以達(dá)到濾波器設(shè)計(jì)的最優(yōu)化。利用MATLAB設(shè)計(jì)數(shù)字濾波器在數(shù)字通信系統(tǒng)和計(jì)算機(jī)領(lǐng)域信號(hào)處理中,有著廣泛的應(yīng)用前景。
- 關(guān)鍵字: MATLAB IIR 濾波器 仿真
單相PWM整流器能量雙向傳輸?shù)膶?shí)現(xiàn)技術(shù)
- 摘要:本文論證了高功率因數(shù)電能轉(zhuǎn)換和負(fù)載電能回饋電網(wǎng)的實(shí)現(xiàn)是電力節(jié)能的關(guān)鍵問題。在對(duì)電壓型單相PWM整流器的拓?fù)浣Y(jié)構(gòu)以及其工作原理分析的基礎(chǔ)上,提出了相應(yīng)的控制方法,并分別對(duì)主電路參數(shù)和PI調(diào)節(jié)器參數(shù)進(jìn)行了選
- 關(guān)鍵字: Matlab 計(jì)算機(jī) 仿真
基于MATLAB/SIMULINK的心電信號(hào)源系統(tǒng)設(shè)計(jì)
- 基于MATLAB/SIMULINK的心電信號(hào)源系統(tǒng)設(shè)計(jì),心電信號(hào)主要頻率范圍為0.05100Hz,幅度約為04mV,信號(hào)十分微弱。由于心電信號(hào)中通?;祀s有其它生物信號(hào),加之體外以500Hz工頻為主的電磁場(chǎng)干擾,使得心電噪聲背景較強(qiáng),測(cè)量條件比較復(fù)雜,為醫(yī)學(xué)研究、救治和教學(xué)
- 關(guān)鍵字: SIMULINK MATLAB 心電信號(hào) 系統(tǒng)設(shè)計(jì)
基于Matlab的FIR數(shù)字濾波器的優(yōu)化設(shè)計(jì)
- 摘要 通過實(shí)例介紹了基于Matlab的FIR濾波器的優(yōu)化設(shè)計(jì)方法。3種結(jié)果比較發(fā)現(xiàn),在同樣階數(shù)下,優(yōu)化設(shè)計(jì)可以獲得最佳的頻率特性和衰耗特性。
關(guān)鍵詞 數(shù)字濾波器;Matlab;FIR;IIR;優(yōu)化設(shè)計(jì)
數(shù)字濾波在數(shù)字信 - 關(guān)鍵字: Matlab FIR 數(shù)字濾波器 優(yōu)化設(shè)計(jì)
用VB如何實(shí)現(xiàn)文件數(shù)據(jù)對(duì)SQL Server上傳下載
- 用VB如何實(shí)現(xiàn)文件數(shù)據(jù)對(duì)SQL Server上傳下載,本文以Visual Basic6.0和SQL Server 2000環(huán)境下的數(shù)據(jù)庫(kù)為例,介紹文件數(shù)據(jù)對(duì)SQL Server 2000數(shù)據(jù)庫(kù)的上傳和下載。很多單位尤其是制造業(yè)、設(shè)計(jì)院,計(jì)算機(jī)應(yīng)用開展的較早。在這些單位,各種法規(guī)文件的下達(dá)以及日常工作
- 關(guān)鍵字: SQL Server 上傳下載 數(shù)據(jù) 文件 如何 實(shí)現(xiàn) VB
基于MATLAB在FPGA 算法上浮點(diǎn)定點(diǎn)轉(zhuǎn)換的實(shí)現(xiàn)

- 基于MATLAB在FPGA 算法上浮點(diǎn)定點(diǎn)轉(zhuǎn)換的實(shí)現(xiàn),浮點(diǎn)定點(diǎn)轉(zhuǎn)換是在 FPGA 上實(shí)現(xiàn)算法時(shí)最困難的地方(圖 1)。雖然 MATLAB 是一種強(qiáng)大的運(yùn)算開發(fā)工具,但其許多優(yōu)點(diǎn)卻在浮點(diǎn)定點(diǎn)轉(zhuǎn)換過程中被降低了。例如,由于定點(diǎn)算術(shù)中精度較低,新的數(shù)學(xué)誤差被引入算法。您必須重
- 關(guān)鍵字: 定點(diǎn) 轉(zhuǎn)換 實(shí)現(xiàn) 浮點(diǎn) 算法 MATLAB FPGA 基于
FPGA的TCP/IP通信協(xié)議與Matlab通信系統(tǒng)的研究

- O 引言 近年來(lái),隨著信息技術(shù)的發(fā)展,網(wǎng)絡(luò)化日加普遍,以太網(wǎng)被廣泛應(yīng)用到各個(gè)領(lǐng)域。例如在數(shù)據(jù)采集領(lǐng)域,一些小型監(jiān)測(cè)設(shè)備需要增加網(wǎng)絡(luò)實(shí)現(xiàn)遠(yuǎn)程數(shù)據(jù)傳輸?shù)墓δ埽灰切┰O(shè)備上增加一個(gè)網(wǎng)絡(luò)接口并實(shí)現(xiàn)了TCP/I
- 關(guān)鍵字: 通信 系統(tǒng) 研究 Matlab 協(xié)議 IP FPGA TCP
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