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ip-in 文章 最新資訊

基于Wishbone總線的UART IP核設計

  • 摘要:介紹了一種基于Wishbone總線的UART IP核的設計方法。該設計采用了自頂向下的模塊化劃分和有限狀態(tài)機相結合的方法,由于其應用了標準的Wishbone總線接口,從而使微機系統與串行設備之間的通信更加靈活方便。驗證
  • 關鍵字: IP  設計  UART  總線  Wishbone  基于  

臺積電和聯電爭搶IP授權商機 代工廠整合第三方設計工具已成趨勢

  •   芯片設計愈趨復雜,對已驗證IP的需求也愈來愈高,根據全球半導體協會(GSA)統計,2010年晶圓代工廠提供給IC設計業(yè)者的IP數量,已經超過以IP授權為主要業(yè)務的第三方IP供貨商。為了縮短芯片設計至量產時間,臺積電旗下創(chuàng)意、聯電旗下智原等2家設計服務業(yè)者,已經成為晶圓雙雄搶食IP授權市場趨勢下的主要受惠者。   根據GSA調查統計,IC設計業(yè)者的IP來源,雖然因為芯片設計功能區(qū)塊(design block)仍以自家技術為主,自有IP比例達到66%,但是去年一年當中,已有愈來愈多的IC設計業(yè)者開始依賴
  • 關鍵字: 臺積電  IP  

FPGA基礎入門(二)

基于CPLD設計的電器定時開關控制系統

利用CPLD來替代微控制器的6種方法

我學習FPGA的總結

verilog中阻塞賦值和非阻塞復制的理解

選擇VHDL或者verilog HDL還是System Verilog?

系統級芯片設計語言和驗證語言的發(fā)展

FPGA設計中關鍵問題的研究

讓Verilog仿真狀態(tài)機時可以顯示狀態(tài)名

基于Nios的DDS高精度信號源實現

FPGA系統設計實戰(zhàn)經驗分享FPGA系統設計實戰(zhàn)經驗分享

FPGA基礎入門

面向超低功耗設計的微控制器功效優(yōu)化方案

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