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fpga-to-asic 文章 最新資訊

Xilinx推出符合汽車應(yīng)用標(biāo)準(zhǔn)的低成本FPGA

  •   2008年1月15日,中國北京- 在剛剛結(jié)束的國際消費(fèi)電子展(CES)上,全球領(lǐng)先的可編程邏輯器件供應(yīng)商賽靈思公司(Xilinx, Inc. (NASDAQ: XLNX))宣布推出Xilinx® Automotive (XA) Spartan™-3A 和 Spartan-3A DSP FPGA,進(jìn)一步擴(kuò)展了其符合汽車應(yīng)用標(biāo)準(zhǔn)的低成本器件產(chǎn)品線。這些新推出的器件為
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Xilinx推出符合汽車應(yīng)用標(biāo)準(zhǔn)的低成本XA Spartan-3A和Spartan-3A DSP FPGA

  •   在剛剛結(jié)束的國際消費(fèi)電子展(CES)上,賽靈思推出Xilinx Automotive (XA) Spartan-3A 和 Spartan-3A DSP FPGA,進(jìn)一步擴(kuò)展了其符合汽車應(yīng)用標(biāo)準(zhǔn)的低成本器件產(chǎn)品線。這些新推出的器件為信息娛樂、混合顯示系統(tǒng)以及汽車輔助駕駛系統(tǒng)的開發(fā)帶來了大I/O邏輯比和大帶寬數(shù)字信號處理(DSP)領(lǐng)域優(yōu)化解決方案,以及相應(yīng)的低功耗和高級設(shè)計安全性等優(yōu)點(diǎn)。   XA Spartan-3A FPGA提供了最高的I/O邏輯單元比,以及廣泛的連接功能支持,對于I/O密集的顯示和
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FPGA器件選型研究

  •          1 引 言        現(xiàn)場可編程門陣列FPGA有集成度高、體積小、靈活可重配置、實(shí)驗風(fēng)險小等優(yōu)點(diǎn),在復(fù)雜數(shù)字系統(tǒng)中得到了越來越廣泛的應(yīng)用。        隨著FPGA技術(shù)的成熟和不斷飛速發(fā)展,數(shù)字電路的設(shè)計只需一片F(xiàn)PGA器件、一些存儲設(shè)備和一些
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CPLD開發(fā)板和FPGA開發(fā)板的區(qū)別

  • ?????市面上尤其是學(xué)校里面可以看到Xilinx公司或者Altera公司各種不同的開發(fā)板,其實(shí)只有兩個大類,CPLD開發(fā)板和FPGA開發(fā)板。盡管FPGA和CPLD都是可編程ASIC器件,有很多共同特點(diǎn),但由于CPLD和FPGA結(jié)構(gòu)上的差異,具有各自的特點(diǎn):? ?????①?CPLD更適合完成各種組合邏輯,FP?GA更適合于完成時序邏輯。換句話說,FPGA更適合于觸發(fā)器豐富的結(jié)
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實(shí)現(xiàn)電源排序的簡單電路

  •   asic、fpga和dsp可能需要多個電源電壓,而這些電源電壓的啟動順序有種種限制。通常電壓值最高的i/o電壓常常必須首先啟動,然后其他電壓按照從高到低的順序逐一啟動,最后啟動的是芯核電壓。這種情況可能還要求一個電源線的電壓不能比另一電源線的電壓大一個二極管壓降以上;否則過大的電流可從i/o電壓通過ic回流到較低的電壓,有可能損壞昂貴的ic。你控制這一順序的常用方法是,在排序的相鄰電壓線之間連接外部二極管,以便把一個較高的電壓嵌位到一個較低電壓的一個二極管壓降以內(nèi),從而防止ic中可能出現(xiàn)的閂鎖現(xiàn)象。二
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基于FPGA的SOC系統(tǒng)中的串口設(shè)計

  •   1 概述   在基于FPGA的SOC設(shè)計中,常使用串口作為通信接口,但直接用FPGA進(jìn)行串口通信數(shù)據(jù)的處理是比較繁雜的,特別是直接使用FPGA進(jìn)行串口通信的協(xié)議的解釋和數(shù)據(jù)打包等處理,將會消耗大量的FPGA硬件資源。   為簡化設(shè)計,降低硬件資源開銷,可以在FPGA中利用IP核實(shí)現(xiàn)的嵌入式微處理器來對串口數(shù)據(jù)進(jìn)行處理。   本文中的設(shè)計采用了XILINX的FPGA,可選用的嵌入式微處理器IP核種類繁多,但基于對硬件資源開銷最少的考慮,最終選用了Picoblaze。   嵌入式微處理器PicoB
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SEP3203處理器與FPGA數(shù)據(jù)通信接口設(shè)計

  • 采樣數(shù)據(jù)經(jīng)過FPGA的算法處理后,SEP3203處理器通過DMA方式將運(yùn)算結(jié)果存儲到片外SDRAM,SEP3203與FPGA的數(shù)據(jù)通信遵循SRAM時序。通過兩組FIFO存儲A/D數(shù)據(jù),系統(tǒng)實(shí)現(xiàn)了信號的不間斷采集和信號處理的流水線操作。
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Xilinx開放源碼硬件創(chuàng)新大賽復(fù)賽名單公布

  •   2008年1月8日,北京訊:自2007年6月正式開始的覆蓋全國高校的“中國電子學(xué)會Xilinx開放源碼硬件創(chuàng)新大賽”初賽經(jīng)過大賽組委會的認(rèn)真篩選,來自34所高校的53支隊伍從170多支參賽隊伍中脫穎而出,入圍復(fù)賽階段。入圍隊伍中,大連理工,清華,電子科大, 西安電子科大等表現(xiàn)突出, 僅大連理工就有6支隊伍進(jìn)入復(fù)賽。 開賽以來,包括清華、北大、中國電子科技大學(xué)、西安電子科技大學(xué)、中國科技大學(xué)等在內(nèi)的近50所高校學(xué)生踴躍報名, 共有170多只隊伍的1000多位在校
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電壓調(diào)節(jié)技術(shù)用于SoC低功耗設(shè)計

  •   引言   SoC即“System on chip”,通俗講為“芯片上的系統(tǒng)”,主要用于便攜式和民用的消費(fèi)的電子產(chǎn)品。隨著便攜式和民用電子產(chǎn)品的高速發(fā)展,廣大用戶對便攜設(shè)備新功能的要求永無止境。于是要求設(shè)計人員在設(shè)計小型便攜式消費(fèi)類電子產(chǎn)品時,不僅要縮小產(chǎn)品尺寸、降低成本,更重要的是降低功耗,用戶都希望便攜式產(chǎn)品的電池充電后的工作時間越長越好。于是,系統(tǒng)設(shè)計與SoC 設(shè)計人員面臨著在增加功能的同時保證電池的使用時間的挑戰(zhàn)。要達(dá)到這一點(diǎn),就需要使用新的節(jié)能技術(shù),比如電壓調(diào)節(jié)(voltage scalin
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前沿技術(shù)提高圖像處理實(shí)例分析

  •   intevac是商用和軍用市場光學(xué)產(chǎn)品的前沿開發(fā)商。本文介紹該公司nightvista嵌入式電子系統(tǒng)的開發(fā),該產(chǎn)品是高性能超低亮度緊湊型攝像機(jī)。該攝像機(jī)最初采用了流行的數(shù)字信號處理器、幾個assp和外部存儲器件。系統(tǒng)對性能的需求越來越高,工程師團(tuán)隊決定試驗一種替代方案——在可編程邏輯中實(shí)現(xiàn)可配置軟核處理器。這一決定帶來了以下好處:   達(dá)到了目標(biāo)所要求的性能:   1.在單個FPGA中集成了分立的元件和數(shù)字信號處理(dsp)功能   2.功耗降低了近80%   3.將五塊元件板縮減到一塊,顯著
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一種基于FPGA的新型誤碼測試儀的設(shè)計與實(shí)現(xiàn)

  •   引言   誤碼儀是評估信道性能的基本測量儀器。本文介紹的誤碼儀結(jié)合FPGA 的特點(diǎn),采用全新的積分式鑒相結(jié)構(gòu),提出了一種新的誤碼測試方法,經(jīng)多次測試驗證,方案可行,設(shè)計的系統(tǒng)穩(wěn)定。本文設(shè)計的誤碼儀由兩部分組成:發(fā)信機(jī)和接收機(jī)。   1 發(fā)信機(jī)   發(fā)信機(jī)的主要功能是產(chǎn)生具有隨機(jī)特性的偽隨機(jī)m 序列,通過FPGA 由VHDL 編程實(shí)現(xiàn)。偽隨機(jī)序列產(chǎn)生原理如下:      圖1 偽隨機(jī)序列產(chǎn)生原理圖   其中,ak-i是各移位寄存器的狀態(tài),Ci對應(yīng)各寄存器的反饋系數(shù),為1表示參與反饋
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ARM、DSP、FPGA的技術(shù)特點(diǎn)和區(qū)別是什么

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
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fpga-to-asic介紹

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