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將DSP設(shè)計擴展為異構(gòu)硬件平臺
- 您可以在自動流程中將一個 FPGA 協(xié)處理器添加到 DSP 系統(tǒng)中。 視頻、影像和電信市場的標(biāo)準(zhǔn)推動了異構(gòu)可重配置 DSP 硬件平臺的使用。就本文而言，這些平臺包括 DSP 處理器和 FPGA，它們提供的現(xiàn)成硬件解決方案可以解決視頻、影像和電信設(shè)計中的重大難題，但仍不失產(chǎn)品差異化所需的足夠的可定制性。 據(jù)市場研究公司 Forward Concepts 于 2005 年發(fā)表的一則調(diào)查報告(圖 1)稱，選擇處理器和 FPGA 的主要標(biāo)準(zhǔn)不是器件本身，而是開發(fā)它們的工具。這一概念對于包含 FPG
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基于DSP的光伏并網(wǎng)發(fā)電系統(tǒng)數(shù)字鎖相技術(shù)
- 引言 在光伏并網(wǎng)發(fā)電系統(tǒng)中，需要實時檢測電網(wǎng)電壓的相位和頻率以控制并網(wǎng)逆變器，使其輸出電流與電網(wǎng)電壓相位及頻率保持同步，即同步鎖相。同步鎖相是光伏并網(wǎng)系統(tǒng)一項關(guān)鍵的技術(shù)，其控制精確度直接影響到系統(tǒng)的并網(wǎng)運行件能。倘若鎖相環(huán)電路不可靠，在逆變器與電網(wǎng)并網(wǎng)工作切換過群中會產(chǎn)生逆變器與電網(wǎng)之間的環(huán)流，對沒備造成沖擊，這樣會縮短設(shè)備使用壽命，嚴(yán)重時還會造成設(shè)備的損壞。 TI公司生產(chǎn)的高速數(shù)字信號處理器TMS320C2000系列，不僅體積小、功耗小、可靠性高，而且內(nèi)部集成了12路PWM發(fā)生器、6路C
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AC-Link數(shù)字音頻VHDL編/解碼的FPGA設(shè)計
- 引言 數(shù)字音頻處理是指為真實再現(xiàn)聲音的逼真效果而對音頻進(jìn)行的編解碼處理技術(shù),它是寬帶網(wǎng)絡(luò)多媒體、移動多媒體通信的關(guān)鍵技術(shù).Audio Codec′97(音頻數(shù)字信號編/解碼器)是其中一種用于聲音錄放的技術(shù)標(biāo)準(zhǔn),簡稱AC′97. AC′97采用雙集成結(jié)構(gòu),即Digital Controller(數(shù)字信號控制器)和Audio Codec(音頻編解碼),使模/數(shù)轉(zhuǎn)換器ADC和數(shù)?模轉(zhuǎn)換器DAC轉(zhuǎn)換模塊獨立,盡可能降低EMI(電磁干擾)的影響。 利用FPGA,可
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基于主從式雙處理器的光纖比色測溫儀軟件設(shè)計
- 摘要： 介紹一種基于DSP和MCU雙處理器的內(nèi)調(diào)制光纖比色測溫儀的設(shè)計原理。測溫儀以AT89C55和TMS320F206為核心，對內(nèi)調(diào)制光電探測器進(jìn)行線性補償和溫度補償，并加入比輻射率的修正。本系統(tǒng)能夠?qū)Νh(huán)境溫度變化大、周圍環(huán)境惡劣的高溫物體進(jìn)行高精度的溫度測量。 在冶金、鋼鐵、建筑材料、化工等眾多行業(yè)中，溫度是確保順利生產(chǎn)和質(zhì)量控制的重要參數(shù)。溫度測量直接關(guān)系到產(chǎn)品的質(zhì)量，關(guān)系到生產(chǎn)成本。熔融狀態(tài)下，鋼、鐵溫度在1200℃以上，主要測量方法有接觸式的金屬熱電偶溫度計和非接觸式的輻射溫度計
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AC-Link數(shù)字音頻VHDL編/解碼的FPGA設(shè)計
- ?????? 提出一種利用FPGA實現(xiàn)AC-Link數(shù)字音頻處理的設(shè)計方案.AC-Link音頻編解碼系統(tǒng)以VHDL模塊進(jìn)行設(shè)計,經(jīng)過波形仿真和結(jié)果驗證后,將程序下載到FPGA中實現(xiàn)1這種設(shè)計方法可以縮短設(shè)計周期,提高設(shè)計的可靠性和效率。 ??????? 引言 ??????? 數(shù)字音頻處理是指為真
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FPGA在語音存儲與回放系統(tǒng)中的應(yīng)用
- 1 引言 隨著數(shù)字信號處理器、超大規(guī)模集成電路的高速發(fā)展，語音記錄技術(shù)已從模擬錄音階段過渡到數(shù)字錄音階段。在數(shù)字化錄音技術(shù)中，壓縮后的語音數(shù)據(jù)有些存儲在硬盤中，有些存儲在帶有掉電保護(hù)功能的RAM或FLASH存儲器中。筆者介紹的語音存儲與回放系統(tǒng)，未使用專用的語音處理芯片，不需要擴展接口電路，只利用FPGA作為核心控制器，就能完成語音信號的數(shù)字化處理，即實現(xiàn)語音的存儲與回放。 2 系統(tǒng)總體結(jié)構(gòu) 數(shù)字化語音存儲與回放系統(tǒng)的基本工作原理是將模擬語音信號通過模數(shù)轉(zhuǎn)換器(A/D)轉(zhuǎn)換成數(shù)字信號
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基于DVD-ROM應(yīng)用的內(nèi)容加擾系統(tǒng)的VLSI設(shè)計
- 摘 要：本文介紹了一種基于DVD-ROM應(yīng)用的內(nèi)容干擾系統(tǒng)(CSS)的設(shè)計和實現(xiàn)。該系統(tǒng)可有效防止對DVD盤片的非法拷貝。文中通過對其工作原理和實際應(yīng)用的分析，給出其最終實現(xiàn)方案，并用Verilog HDL完整整個系統(tǒng)的設(shè)計。功能仿真和FPGA驗證表明，設(shè)計成功。 關(guān)鍵詞：內(nèi)容加擾系統(tǒng);DVD;Verilog HDL;FPGA驗證 引 言 DVD-ROM的視頻和音頻數(shù)據(jù)是經(jīng)過加密編碼的，加擾的源是標(biāo)題密鑰(Tittle Key)，同時標(biāo)題密鑰被光盤密鑰(光盤密鑰)加密，主機在播放影碟
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定點DSP C55X實現(xiàn)浮點相關(guān)運算
- 引 言 DSP結(jié)構(gòu)可以分為定點和浮點型兩種。其中，定點型DSP可以實現(xiàn)整數(shù)、小數(shù)和特定的指數(shù)運算，它具有運算速度快、占用資源少、成本低等特點;靈活地使用定點型DSP進(jìn)行浮點運算能夠提高運算的效率。目前對定點DSP結(jié)構(gòu)支持下的浮點需求也在不斷增長，主要原因是：實現(xiàn)算法的代碼往往是采用C/C++編寫，如果其中有標(biāo)準(zhǔn)型的浮點數(shù)據(jù)處理，又必須采用定點DSP器件，那么就需要將浮點算法轉(zhuǎn)換成定點格式進(jìn)行運算。同時，定點DSP結(jié)構(gòu)下的浮點運算有很強的可行性，因為C語言和匯編語言分別具有可移植性強和運算效率高的
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使用FPGA測試的一些有效方法
- 引言 隨著芯片設(shè)計技術(shù)越來越成熟，越來越多的產(chǎn)品選擇使用SoC（System on Chip）的技術(shù)實現(xiàn)。然而，每一次流片不一定都能達(dá)到預(yù)期的效果。根據(jù)Synopsys公司統(tǒng)計，有超過60％的公司需要重新流片（respin）。在這個過程中浪費了大量的金錢，一次修正平均的花費就超過100萬美元。如果一旦錯過了商品推出的最佳時機，那么錯過市場機會的代價則以數(shù)千萬美元計，甚至更高。據(jù)統(tǒng)計，在需要respin的芯片中有43％是在前端的設(shè)計和實現(xiàn)的時候產(chǎn)生的邏輯功能錯誤。如何避免或減小如此高的風(fēng)險是每一
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基于FPGA系統(tǒng)易測試性的研究
- 引 言 現(xiàn)代科技對系統(tǒng)的可靠性提出了更高的要求，而FPGA技術(shù)在電子系統(tǒng)中應(yīng)用已經(jīng)非常廣泛，因此FPGA易測試性就變得很重要。要獲得的FPGA內(nèi)部信號十分有限、FPGA封裝和印刷電路板(PCB)電氣噪聲，這一切使得設(shè)計調(diào)試和檢驗變成設(shè)計中最困難的一個流程。另一方面，當(dāng)前幾乎所有的像CPU、DSP、ASIC等高速芯片的總線，除了提供高速并行總線接口外，正迅速向高速串行接口的方向發(fā)展，F(xiàn)PGA也不例外。每一條物理鏈路的速度從600 Mbps到10 Gbps，高速I／O的測試和驗證更成為傳統(tǒng)專注于FPG
- 關(guān)鍵字： FPGA
基于FPGA的USB2.0虛擬邏輯分析儀的設(shè)計與實現(xiàn)
- 引言 傳統(tǒng)的邏輯分析儀體積龐大、價格昂貴、通道數(shù)目有限，并且在數(shù)據(jù)采集、傳輸、存儲、顯示等方面存在諸多限制，在很大程度上影響了其在實際中的應(yīng)用。選用高性能的FPGA芯片進(jìn)行數(shù)據(jù)處理，充分利用PC的強大處理功能，配合LabView圖形化語言開發(fā)的虛擬邏輯分析儀，其數(shù)據(jù)處理和傳輸速率大大提高，適用性極大增強，其顯示、操作界面和低廉的成本較之傳統(tǒng)的邏輯分析儀具有極大的優(yōu)勢和發(fā)展前景。 工作原理 本設(shè)計選用Altera公司的Cyclone系列FPGA器件EP1C3進(jìn)行數(shù)據(jù)采集和處理，外接SRAM
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TMS320C6000系列DSP的軟件優(yōu)化技術(shù)
- 1 DSP系統(tǒng)的軟件優(yōu)化流程 DSP系統(tǒng)的軟件優(yōu)化流程如圖l所示。整個工作流程分為3個階段： 第l階段，直接根據(jù)需要用高級C語言實現(xiàn)DSP功能，測試代碼的正確性。然后，移植到C6X平臺，利用C6X開發(fā)環(huán)境Profile測試程序的運行時間。若不滿足要求，則進(jìn)入下一階段。 第2階段，利用C6X提供的優(yōu)化方式和其他各種優(yōu)化技巧，如使用不同的編譯器選項使能軟件流水，循環(huán)展開，字存取代替半字存取等，優(yōu)化C語言代碼。如果還不能滿足要求，則進(jìn)入第3階段。 第3階段，將C語言代碼中耗時最長的部
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基于FPGA的步進(jìn)電機控制器設(shè)計
- 步進(jìn)電機是一種將電脈沖信號轉(zhuǎn)換成相應(yīng)的角位移的特殊電機，每改變一次通電狀態(tài)，步進(jìn)電機的轉(zhuǎn)子就轉(zhuǎn)動一步。目前大多數(shù)步進(jìn)電機控制器需要主控制器發(fā)送時鐘信號，并且要至少一個I/O口來輔助控制和監(jiān)控步進(jìn)電機的運行情況。在單片機或DSP的應(yīng)用系統(tǒng)中，經(jīng)常配合CPLD或者FPGA來實現(xiàn)特定的功能。本文介紹通過FPGA實現(xiàn)的步進(jìn)電機控制器。該控制器可以作為單片機或DSP的一個直接數(shù)字控制的外設(shè)，只需向控制器的控制寄存器和分頻寄存器寫入數(shù)據(jù)，即町實現(xiàn)對步進(jìn)電機的控制。 1 步進(jìn)電機的控制原理 步進(jìn)電機是數(shù)
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