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fpga+arm 文章 最新資訊

基于短時能量和短時過零率的VAD算法及其FPGA實現

  • 　　語音激活檢測VAD（Voice Activity Detection）是一種通過特定的判決準則判斷語音中出現的停頓和靜默間隔，檢測出有效語音部分的技術。運用這種技術可以在確保語音質量的前提下，對不同類別的語音段采用不同的比特數進行編碼，從而降低語音的編碼速率。由于在雙工移動通信系統(tǒng)中，一方只有35％的時間處于激活狀態(tài)[1]，如何降低靜音期的編碼速率對于減少傳輸帶寬、功率以及容量具有積極的作用，因此VAD技術在語音通信領域具有重要的使用價值。隨著適合于變比特率語音編碼的CDMA和PRMA等多址技術的出現
  • 關鍵字： FPGA  VAD  短時能量  短時過零率  FIFO  濾波器  

Xilinx為低功耗Intel車載信息娛樂參考設計增加靈活的連接功能

  • 　　賽靈思公司（Xilinx, Inc.）宣布推出一款集成了賽靈思汽車（XA）現場可編程門陣列（FPGA）和知識產權（IP）的解決方案。這一集成解決方案包括在針對汽車音響本體（head unit）應用的低功耗Intel車載信息娛樂（IVI）參考設計中。該參考設計結合了XA解決方案與Intel® Atom™ 處理器，為系統(tǒng)開發(fā)人員在開發(fā)開放式汽車信息娛樂平臺時提供了更高級別的性能、可擴展能力和靈活性。 　　與消費者在家庭和辦公室中的需求一樣，車載數字信息訪問和娛樂應用的需求也在不斷增長
  • 關鍵字： Xilinx  低功耗  Intel  車載信息娛樂  FPGA  

FPGA系統(tǒng)的供電要求和最新DC/DC穩(wěn)壓器解決方案

  • FPGA系統(tǒng)的供電要求和最新DC/DC穩(wěn)壓器解決方案,隨著FPGA制造工藝尺寸持續(xù)縮小、設計配置更加靈活，以及采用FPGA的系統(tǒng)的不斷發(fā)展，原來只采用微處理器和ASIC的應用現在也可以用FPGA來實現了。最近FPGA供應商推出的新型可編程器件進一步縮小了FPGA和ASIC之間的性能差別。盡管這類器件的可配置性對設計工程師很有吸引力，但使用這些器件所涉及的復雜設計規(guī)則和接口協(xié)議，要求設計工程師經過全面的培訓，并需要進行參考設計評估、設計仿真和驗證工作。另一方面，FPGA應用中非常復雜的模擬設計，例如用于內核
  • 關鍵字： DC/DC  穩(wěn)壓器  解決方案  最新  要求  系統(tǒng)  供電  FPGA  

中文版《低功耗設計方法學》出版

  • 　　本報訊 北京大學出版社日前宣布，將出版由新思科技和ARM共同撰寫的先進的SoC（片上系統(tǒng)）設計功耗管理實用指南《低功耗設計方法學》的中文版。同時，北京大學還將基于《低功耗設計方法學》設置一套低功耗設計課程，并將其推廣至中國的其他各所大學。2007年8月發(fā)行的《低功耗設計方法學》英文版已經成為低功耗設計廣被采納的標準方法。
  • 關鍵字： 北京大學  新思科技  ARM  SoC  

高效FPGA乘法器在無線基站中的使用

  • 　　基于WiMax及其派生標準的新興寬帶無線協(xié)議需要越來越高的吞吐量和數據速率。這些協(xié)議提出的快速芯片速率和數字射頻處理可以在使用FPGA方案的硬件上得到最佳的實現。 　　FPGA非常適合作為高性能、高性價比的解決方案來實現這些物理層協(xié)議中的數字功能，因為它們包括以下豐富的資源： 　　1.DSP模塊，可以用來實現各種FIR濾波和FFT/IFFT操作所要求的乘法器和加法器/累加器功能； 　　2. SERDES收發(fā)器，可以支持無線前端與基帶數字板之間的CPRI和OBSAI接口； 　　3. 重要的FPG
  • 關鍵字： FPGA  乘法器  無線  基站  WiMax  DSP  IP核  

基于Modelsim FLI接口的FPGA仿真技術

  • 　　1、Modelsim 及 FLI接口介紹 　　Modelsim是 Model Technology（Mentor Graphics的子公司）的 HDL 硬件描述語言仿真軟件，可以實現 VHDL, Verilog，以及 VHDL-Verilog 混合設計的仿真。除此之外，Modelsim還能夠與 C 語言一起實現對 HDL 設計文件的協(xié)同仿真。同時，相對于大多數的 HDL 仿真軟件來說，Modelsim 在仿真速度上也有明顯優(yōu)勢。這些特點使 Modelsim 越來越受到 EDA設計者、尤其是 FPGA
  • 關鍵字： FPGA  仿真  Modelsim  FLI  VHDL  

設計技術問答：FPGA設計的安全性考量

  • 設計技術問答：FPGA設計的安全性考量,本文以提問的形式講述了FPGA設計安全性考量
  • 關鍵字： 設計  考量  安全性  問答  技術  FPGA  

用FPGA實現低成本實時深度感知

  • 引言 　　對于自主機器人導航和其它機器視覺應用來說，實時深度感知是很關鍵的。目前通過立體圖像來計算深度的算法計算量很大，例如差異測繪，要占用CPU大量的時間，或者需要用昂貴的器件進行實時操作。 　　針對立體攝像的深度感知，FPGA解決方案能使處理器的時間得到緩解，減少或除去器件的成本，例如MPU、DSP、激光器和昂貴的鏡頭。通過提供給機器人其環(huán)境中 的差異測繪，FPGA使機器人中的CPU專注于重要的高層任務，例如建圖和定位。 差異測繪 　　加深度感知到機器人的常用技術是用兩個水平放置的
  • 關鍵字： 機器視覺  FPGA  深度感知  嵌入式  DSP  200806  

一種新型高速數據采集系統(tǒng)的設計與實現

  • 介紹了一種基于USB2.0接口的高速數據采集系統(tǒng)的設計。該采集系統(tǒng)能夠將雷達接收機送來的信號進行高速的采集，然后通過USB接口，將采集到的數據送到計算機，經由上層軟件對數據進行處理分析。
  • 關鍵字： USB2.0  FPGA  高速數據采集  雷達接收機  200806  

基于SOPC技術的醫(yī)用呼吸機主控系統(tǒng)設計

  • 摘要： 以Altera公司FPGA芯片為平臺，利用SOPC技術和Nios II處理器設計并實現了醫(yī)用呼吸機的主控系統(tǒng)。 關鍵詞： 呼吸機；SOPC；Nios II軟核處理器；壓力補償 　　呼吸機是可以代替人的呼吸功能或輔助人的呼吸功能的儀器。它適用于呼吸衰竭、甚至停止呼吸的病人做人工呼吸之用。它能幫助病人糾正缺氧和排出二氧化碳，是挽救某些危重病人生命的重要工具。 　　現有的呼吸機產品，其主控系統(tǒng)大多基于單片機來實現，對于功能強一些的產品就需要使用高端單片機，這樣使得系
  • 關鍵字： SOPC  Nios II  FPGA  呼吸機  壓力補償  200806  

CADENCE與Common Platform及ARM合作提供45納米RTL-to-GDSII參考流程

  • 　　全球電子設計創(chuàng)新企業(yè)Cadence設計系統(tǒng)公司(NASDAQ: CDNS)今天宣布面向Common Platform™技術的45納米參考流程將于2008年7月面向大眾化推出。Cadence®與Common Platform技術公司包擴IBM、特許半導體制造公司和三星聯(lián)合開發(fā)RTL-to-GDSII 45納米流程，滿足高級節(jié)點設計需要。該參考流程基于對應Common Power Format（CPF）的Cadence低功耗解決方案，而且還包含來自Cadence的關鍵可制造性設計（De
  • 關鍵字： CADENCE  Common Platform  ARM  RTL-to-GDSII  低功耗  

FPGA+DSP實時三維圖像信息處理系統(tǒng)

  • 　　三維圖像信息處理一直是圖像視頻處理領域的熱點和難點，目前國內外成熟的三維信息處理系統(tǒng)不多，已有的系統(tǒng)主要依賴高性能通用PC完成圖像采集、預處理、重建、構型等囊括底層和高層的處理工作。三維圖像處理數據量特別大、運算復雜，單純依靠通用PC很難達到實時性要求，不能滿足現行高速三維圖像處理應用。 　　本系統(tǒng)中，采用FPGA實現底層的信號預處理算法，其處理數據量很大，處理速度高，但算法結構相對比較簡單，可同時兼顧速度和靈活性。高層處理算法數據量較少、算法結構復雜，可采用運算速度快、尋址方式靈活、通信機制強大的
  • 關鍵字： FPGA  DSP  三維圖像信息處理  EVIP  PCI  

全新片上可編程系統(tǒng)（SOPC）多參監(jiān)護儀專用主控板簡介

  • 　　主控板是多參監(jiān)護儀執(zhí)行信息處理的核心部件，主要解決臨床生理信息的傳輸、存儲、顯示、交換和信息數據的組合加工。特別是數字化醫(yī)院的發(fā)展，HIS、CIS 系統(tǒng)的建立和普遍使用，使得多參監(jiān)護儀不僅是一個生理參數的顯示和記錄終端，而且正成為醫(yī)療單位信息系統(tǒng)中必不可少的一個重要的臨床、生理信息平臺。它的許多技術指標直接體現了多參監(jiān)護儀整機的重要技術性能指標。在多參監(jiān)護儀市場競爭日趨激烈的今天，選擇一款技術既先進，性能價格比又高的主控板，無疑可以大大提高它的市場競爭力。 　　一、目前國內多參監(jiān)護儀主控板的現狀：
  • 關鍵字： ARM  數字化醫(yī)院  SOC  PCB  

利用Virtex-5 FPGA實現最低功耗解決方案

  • 　　過渡至65納米工藝的FPGA具備采用更小尺寸工藝所帶來的優(yōu)勢：低成本、高性能和更強的邏輯能力。盡管這些優(yōu)勢能夠為高級系統(tǒng)設計帶來激動人心的機會，但65納米工藝節(jié)點本身也帶來了新的挑戰(zhàn)。例如，在為產品選擇FPGA時，功耗的考慮變得越來越重要。很可能下一代設計會需要在功耗預算不變(或更小)的情況下，集成更多的特性和實現更高的性能。 　　本文將分析功耗降低所帶來的益處，還將介紹Virtex-5器件中所采用的多種技術和結構上的革新，它們能提供功耗最低的解決方案，并且不犧牲性能。 　　降低功耗的好處 　　
  • 關鍵字： FPGA  低功耗  Virtex-5  靜態(tài)功耗  動態(tài)功耗  

飛思卡爾推出世界首款軟ColdFire32位內核FPGA

  • 　　2008年6月9日，為了滿足高度定制化半導體解決方案的市場需求，飛思卡爾在Altera Cyclone III系列FPGA上推出32位V1 ColdFire內核的首款現場可編程柵格陣列（FPGA）。半導體知識產權（IP）許可專家IPextreme公司將通過其在線Core Store™市場免費為Cyclone III客戶提供V1內核許可。 　　V1 ColdFire內核許可為那些不能通過標準嵌入式處理器和片上系統(tǒng)（SOC）器件解決其設計問題的工程師提供一款靈活、經濟高效的解決方案。
  • 關鍵字： 飛思卡爾  FPGA  內核  Cyclone  
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