fpga ip 文章 最新資訊
Altera Quartus II軟件v13.1編譯時(shí)間縮短70%
- Altera公司 (NASDAQ: ALTR)今天宣布發(fā)布Quartus? II軟件13.1版,通過大幅度優(yōu)化算法以及增強(qiáng)并行處理,與前一版本相比,編譯時(shí)間平均縮短了30%,最大達(dá)到70%,進(jìn)一步擴(kuò)展了在軟件效能方面的業(yè)界領(lǐng)先優(yōu)勢(shì)。軟件還包括最新的快速重新編譯特性,適用于客戶對(duì)Altera Stratix? V FPGA設(shè)計(jì)進(jìn)行少量源代碼改動(dòng)的情形。采用快速重新編譯特性,客戶可以重新使用以前的編譯結(jié)果,從而保持性能,不需要前端設(shè)計(jì)劃分,進(jìn)一步將編譯時(shí)間縮短了50%。
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基于FPGA的基帶64×64數(shù)據(jù)分配矩陣設(shè)計(jì)方案
- 本文采用FPGA作為實(shí)現(xiàn)控制邏輯的核心部件,提出了基于FPGA的基帶64×64 數(shù)據(jù)分配矩陣設(shè)計(jì)方案,并介紹了上位機(jī) ...
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基于FPGA的多普勒測(cè)振計(jì)信號(hào)采集與處理系統(tǒng)設(shè)計(jì)方案
- 0 引言 傳統(tǒng)的淺海地形測(cè)量以船只為平臺(tái),采用聲納技術(shù)進(jìn)行,這種測(cè)量方法對(duì)于一些船只難以駛?cè)氲膮^(qū)域便形 ...
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基于FPGA的TDICCD8091 驅(qū)動(dòng)時(shí)序電路設(shè)計(jì)
- 0引言時(shí)間延時(shí)積分電荷耦合器件(TimeDelayandIntegra-tionChargeCoupledDevices,TDICCD)易于實(shí)現(xiàn)實(shí)...
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將數(shù)據(jù)轉(zhuǎn)換器IP集成到系統(tǒng)芯片簡(jiǎn)化設(shè)計(jì)技術(shù)(三)
- 技術(shù)9:盡量減小電源域轉(zhuǎn)換 由于信號(hào)沿著時(shí)鐘網(wǎng)絡(luò)進(jìn)展,并在不同的電源域進(jìn)行轉(zhuǎn)換,信號(hào)會(huì)受到不同電源的電源 ...
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將數(shù)據(jù)轉(zhuǎn)換器IP集成到系統(tǒng)芯片簡(jiǎn)化設(shè)計(jì)技術(shù)(二)
- 當(dāng)數(shù)據(jù)轉(zhuǎn)換器需要外部基準(zhǔn)時(shí)也會(huì)出現(xiàn)類似的問題。由于基準(zhǔn)決定數(shù)據(jù)轉(zhuǎn)換器的滿幅輸入擺幅,如果噪聲或不需要的 ...
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將數(shù)據(jù)轉(zhuǎn)換器IP集成到系統(tǒng)芯片簡(jiǎn)化設(shè)計(jì)技術(shù)(一)
- 為了滿足苛刻性能和快速運(yùn)行要求,今天的系統(tǒng),從通訊接口到高品質(zhì)圖像視頻和多媒體系統(tǒng),各種消費(fèi)類應(yīng)用廣泛采用 ...
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FPGA攻城拔寨,引領(lǐng)視頻監(jiān)控應(yīng)用潮流
- 通信領(lǐng)域歷來是FPGA應(yīng)用的傳統(tǒng)主流市場(chǎng),也是業(yè)界領(lǐng)先FPGA廠商傾力爭(zhēng)奪的大市場(chǎng)。FPGA產(chǎn)業(yè)發(fā)展方興未艾,已經(jīng)由 ...
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