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I2C器件接口IP核的CPLD設計

  • 根據(jù)單片機I2C串行擴展的特點，在EDA軟件MaxplusII的環(huán)境下，利用AHDL語言，建立IP核。
  • 關鍵字： CPLD  I2C  器件  接口    

PSD813F2在FPGA配置中的應用

  • 可編程外圍器件PSD應用于單片機系統(tǒng)后，簡化了單片機外圍電路的設計，增加了系統(tǒng)的可靠性；利用PSD與單片機組成的系統(tǒng)，通過計算機串口對FPGA進行實時在線編程、仿真和配置。
  • 關鍵字： 813F  FPGA  PSD  813    

用PowerPC860實現(xiàn)FPGA配置

  • 介紹如何用PowerPC860（MPC860）進行FPGA（Xilinx的Virtex-II系列）的配置；給出進行FPGA配置所需的詳細時序圖和原理圖。
  • 關鍵字： PowerPC  FPGA  860    

利用FPGA實現(xiàn)MMC2107與SDRAM接口設計

  • 介紹基于現(xiàn)場可編程門陣列（FPGA），利用VHDL語言設計實現(xiàn)MMC2107與SDRAM接口電路。文中包括MMC2107組成結構、SDRAM存儲接口結構和SDRAM控制狀態(tài)機的設計。
  • 關鍵字： SDRAM  FPGA  MMC    

基于CPLD的高壓電力線FSK MODEM設計

  • 介紹應用CPLD實現(xiàn)非標準的FSK MODEM的設計方法；探討如何優(yōu)化算法和改良電路來減少系統(tǒng)的誤碼率，并給出應用電路。
  • 關鍵字： MODEM  設計  FSK  力線  CPLD  高壓電  基于  

一種基于CPLD的PWM控制電路設計

用TMS320LF2407和FPGA實現(xiàn)電能質量監(jiān)測

  • 提出用TMS320LF2407和FPGA實現(xiàn)電能監(jiān)測的一種方案，闡述各模塊的設計和實現(xiàn)方法，本方案中，F(xiàn)PGA用于采樣16路交流信號并進行64次諧波分析。
  • 關鍵字： 質量  監(jiān)測  電能  實現(xiàn)  FPGA  TMS320LF2407  

Vitex-4平臺FPGA

  • 　　Xilinx公司基于ASMBLTM(Advanced Silicon Modular Block)架構最近推出第4代Virtex系列器件Vitex-4平臺FPGA，成為具有成本優(yōu)勢的ASIC和ASSP替代解決方案。 Vitex-4平臺FPGA 　　Vitex-4平臺FPGA系列(Vitex-4 LX、SX、FX)提供不同的內(nèi)核功能組合(見圖1)。邏輯、存儲器、并行和串行I/O、嵌入式處理器、高性能DSP、增強時鐘管理、硬IP、混合信號以及其他功能模塊的優(yōu)化組合使Vitex-4系列可以完美地滿足特定
  • 關鍵字： FPGA  嵌入式  

博物館智能防盜保護器系統(tǒng)設計

  • 摘    要：本設計的目的是實現(xiàn)博物館藏品防盜和保護的智能化。以微處理器為核心，利用美國國家半導體的彩色圖像傳感器LM9628和溫度傳感器LM19進行環(huán)境監(jiān)控，并控制報警系統(tǒng)和空調系統(tǒng)以及進行圖像處理。關鍵詞：圖像傳感器；溫度傳感器；AVR單片機；CPLD引言博物館內(nèi)的藏品常常受到人為盜竊的威脅，周圍環(huán)境的變化也會對其造成破壞，因此需要極為可靠的防盜系統(tǒng)及完善的空調系統(tǒng)，本設計的目的就是實現(xiàn)對館藏品的智能化防盜和保護。博物館關閉時便可將此防盜保護器啟動，通過CMOS傳感器對博
  • 關鍵字： AVR單片機  CPLD  圖像傳感器  溫度傳感器  

嵌入式同步時鐘系統(tǒng)的設計與實現(xiàn)

  • 摘    要：本文介紹了一種基于嵌入式微控制器MSP430構建的嵌入式同步時鐘系統(tǒng)的設計與實現(xiàn)方案，在實現(xiàn)了網(wǎng)絡時鐘同步的基礎上又提供了方便易用的網(wǎng)絡管理接口。關鍵詞：同步時鐘；MSP430單片機；數(shù)字鎖相環(huán)；CPLD同步時鐘系統(tǒng)是同步設備中實現(xiàn)同步通信的核心，因此，要實現(xiàn)數(shù)字同步網(wǎng)的設備同步就要求同步時鐘系統(tǒng)一方面要能提供精確的定時同步，另一方面還要能方便實現(xiàn)網(wǎng)絡管理中心對同步時鐘的管理。本文詳細介紹了利用嵌入式微控制器MSP430單片機和數(shù)字鎖相環(huán)(DPLL)來實現(xiàn)嵌入式
  • 關鍵字： CPLD  MSP430單片機  數(shù)字鎖相環(huán)  同步時鐘  

嵌入式同步時鐘系統(tǒng)的設計與實現(xiàn)

  • 摘    要：本文介紹了一種基于嵌入式微控制器MSP430構建的嵌入式同步時鐘系統(tǒng)的設計與實現(xiàn)方案，在實現(xiàn)了網(wǎng)絡時鐘同步的基礎上又提供了方便易用的網(wǎng)絡管理接口。關鍵詞：同步時鐘；MSP430單片機；數(shù)字鎖相環(huán)；CPLD同步時鐘系統(tǒng)是同步設備中實現(xiàn)同步通信的核心，因此，要實現(xiàn)數(shù)字同步網(wǎng)的設備同步就要求同步時鐘系統(tǒng)一方面要能提供精確的定時同步，另一方面還要能方便實現(xiàn)網(wǎng)絡管理中心對同步時鐘的管理。本文詳細介紹了利用嵌入式微控制器MSP430單片機和數(shù)字鎖相環(huán)(DPLL)來實現(xiàn)嵌入式
  • 關鍵字： CPLD  MSP430單片機  數(shù)字鎖相環(huán)  同步時鐘  

列車車載GPS智能里程表的網(wǎng)絡化設計

  • 摘    要：本文提出了采用基于GPS的行駛里程數(shù)據(jù)采集和通過網(wǎng)絡通信控制器WebChip進行網(wǎng)絡化數(shù)據(jù)管理的智能里程表設計,并給出了具體設計方案。關鍵詞：車輛管理；GPS；WebChip；CPLD引言在鐵路列車車輛管理過程中，對列車每一節(jié)車廂行駛里程的統(tǒng)計，是對車廂進行管理和維護的一個重要依據(jù)。因此，獲取精確的行駛里程對于鐵路系統(tǒng)的高效、安全運營無疑是非常重要的。計算行駛里程的傳統(tǒng)方法：一種是靠人工估計，費時費力且不夠準確；另一種是通過計算列車車輪行駛的距離，這種方法操作復
  • 關鍵字： CPLD  GPS  WebChip  車輛管理  

使用LeonardoSpectrum綜合Xilinx FPGA的VHDL程序

  • 摘   要： 本文總結了使用LeonardoSpectrum綜合Xilinx FPGA的VHDL程序應用，以及在VHDL中使用不同類型RAM的方法。關鍵詞： LeonardoSpectrum；FPGA；VHDLLeonardoSpectrum 是Mentor Graphics公司設計的功能強大的EPLD/FPGA/ASIC綜合工具，支持大部分EPLD/FPGA廠商的產(chǎn)品。LeonardoSpectrum支持VHDL、Verilog、EDIF的綜合、優(yōu)化和定時分析，可
  • 關鍵字： FPGA  LeonardoSpectrum  VHDL  

一種近距雷達目標檢測信號處理的FPGA實現(xiàn)

  • 摘   要： 本文在闡述某種近距雷達目標檢測原理和FPGA技術發(fā)展狀況的基礎上，著重討論用FPGA設計高性能的數(shù)字信號處理系統(tǒng)的方法，并給出一個應用實例。關鍵詞：  FPGA；近距雷達；目標檢測；數(shù)字信號處理前言FPGA及其相關技術是當代微電子技術迅速發(fā)展的產(chǎn)物，目前已經(jīng)成為開發(fā)復雜數(shù)字系統(tǒng)的主要方式之一。某近距雷達系統(tǒng)要求利用在與被探測目標的短暫交會過程中，對獲得的多普勒信號進行頻譜分析并完成動目標的識別檢測。交會的短暫性對信號處理系統(tǒng)的實時性提出了嚴格的要求，在
  • 關鍵字： FPGA  近距雷達  目標檢測  數(shù)字信號處理  

PCI總線至UTOPIA接口控制的CPLD設計實現(xiàn)

  • 摘   要： 本文采用Altera的CPLD實現(xiàn)了PCI總線至UTOPIA接口的邏輯轉換控制，為低成本實現(xiàn)ATM終端奠定了基礎。關鍵詞： CPLD ;   PCI總線 ; UTOPIA2總線引言  EDA技術憑借其高速、方便等特點而被廣泛應用于通信領域。本文采用Altera的CPLD實現(xiàn)了PCI總線至UTOPIA接口的邏輯轉換控制，該設計再配上ATM線路成幀部件即可成為基于個人電腦的ATM終端設備，從而改善因成本較高、市場需求不足等原因
  • 關鍵字： CPLD  PCI總線  UTOPIA2總線  
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