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cpld/fpga 文章 最新資訊

松下新高清晰攝像機選用Altera Cyclone III FPGA

  •   Altera公司宣布,松下公司在P2 HD專業(yè)廣播高清晰攝像機中選用了Cyclone® III FPGA。P2 HD AJ-HPX2700和P2 HD手持式AG-HPX170是松下公司為滿足全球范圍內對高清晰(HD)廣播需求而開發(fā)的兩款無磁帶攝像機。   隨著全球市場向HD的邁進,廣播行業(yè)需要高清晰圖像質量。在松下公司P2 HD專業(yè)廣播高清晰攝像機中,Cyclone III FPGA提供HD視頻處理功能,實現與P2存儲卡的接口,并控制LCD顯示屏。在所有低成本FPGA系列中,Cyclone
  • 關鍵字: Altera  FPGA  高清  HD  

四通道超聲探傷卡的硬件設計

  • 1 四通道超聲探傷卡的總體結構   四通道超聲探傷卡的總體結構框圖如圖1所示。從框圖中可以看出,其主要由超聲發(fā)射電路、通道選擇、放大濾波、數據采集壓縮、卡內微處理器、USB接口等部分組成。   四通道采用分時工作方式。四個通道分時進行超聲發(fā)射,回波信號經過通道選擇開關后進行信號放大與帶通濾波,然后在FPGA的控制下進行A/D轉換,采集的數據在FPGA內實時壓縮后存入FPGA內部的雙端口RAM中,然后由卡上的微處理器讀取數據,再次進行數字濾波后通過USB接口向上位PC機傳送。 2 超聲波發(fā)射電路
  • 關鍵字: 微處理器  探傷卡  FPGA  超聲波  

GPON脈沖模式接收器的低功率解決方案

MIMO-OFDMA無線基站的DSP-FPGA系統劃分

  • 引言   無線運營商通過提供增強數據服務來提高單位用戶平均收益(ARPU),這同時推動了對寬帶的需求,導致對數據速率的要求越來越高。而且,為用戶提供各種應用體驗的要求也促使底層網絡體系結構進行變革。窄帶2G GSM、IS-95系統等以語音為中心的技術已經發(fā)展到了基于WCDMA的HSDPA和HSUPA系統,峰值數據速率達到了10Mbps。今后的3GPP長期發(fā)展規(guī)范采用了多輸入多輸出(MIMO)等復雜的信號處理技術,以及正交頻分復用接入(OFDMA)和多載波碼分復用接入(MC-CDMA)等新的射頻技術,這些
  • 關鍵字: MIMO  WiMAX  LTE  3G  FPGA  

基于USB2.0與FPGA技術的高速數據采集系統的設計

  •   近年來筆記本電腦迅速普及和更新,其中大部分已經不配置RS232接口,而USB接口已成為今后一段時間PC機與外設接口的主流。本采集系統的設計構建了一個基于USB接口的多功能通用數據采集、傳輸平臺,將嵌入式系統的實時性、靈活性和PC機強大的數據存儲、處理、顯示功能結合起來。該采集系統在智能儀器儀表、測控系統、工控系統等領域有廣闊的應用前景。 1 系統總體結構設計   1.1 系統總體結構   系統總體結構框圖如圖1所示,系統包括:單片機與USB接口模塊、FPGA模塊、信號調理及A/D模塊。其中,單片
  • 關鍵字: 單片機  USB  FPGA  A/D  

基于DSP的嵌入式顯微圖像處理系統的設計

  •   顯微圖像處理是數字圖像處理的一個重要研究領域,隨著其技術的不斷發(fā)展,已經在材料、生物、醫(yī)學等領域得到了廣泛應用[1][2]。目前的顯微圖像處理通常利用圖像采集系統將顯微圖像采集到計算機中再進行圖像處理,這樣,雖然運算速度高,但體積龐大、不便于攜帶,有一定的局限性。因此,采用數字圖像處理技術和DSP技術實現顆粒顯微圖像的高效、快速、全面的統計與測量,具有重要的實用價值和廣闊的應用前景。     本文提出并設計了一種基于DSP和FPGA的嵌入式顯微圖像采集處理系統,如圖1所
  • 關鍵字: DSP  圖像處理  顯微  FPGA  

GE Fanuc智能設備推出首個加固XMCV5夾層卡

  •   針對數字信號處理應用而設計;可應用于最惡劣的環(huán)境當中   * Xilinx Virtex FPGA 處理器   * 5種加固選項   * 靈活配置選項   * 兼容 VITA-42.0、VITA 42.2 和VITA 42.3   GE Fanuc 智能設備近日發(fā)布支持Xilinx Virtex-5 FPGA 的XMCV5夾層卡,以滿足軍事和航空領域客戶日益增長的對FPGA技術的需求。我們設計的XMCV5應用范圍十分廣泛,在數字信號(DSP)處理應用方面,可應用于地面移動通信、飛機固定和旋
  • 關鍵字: FPGA  數字信號處理  GE Fanuc  夾層卡  

Spartan-3 FPGA系列中高效PCB布局的LVDS信號倒相

  •   提要   在比較簡單的未大量使用過孔的四層或六層 PCB 上,可能很難對 LVDS 或 LVPECL 這類差分信號布線。其原因是,驅動器上的正極引腳必須驅動接收器上的相應正極引腳,而負極引腳則必須驅動接收器的負極引腳。有時跡線以錯誤的方向結束,這實際上是向電路中添加了一個倒相器。本應用指南說明 Spartan?- 3 FPGA 系列如何僅通過在接收器數據通路中加入一個倒相器即可避免大量使用過孔,并且在不要求 PCB 重新設計的情況下即可解決意外的 PCB 跡線交換問題。這項技術同樣適用于將 FPGA
  • 關鍵字: PCB  LVDS  倒相器  FPGA  SDR  

3G系統中AGC的FPGA設計實現

  •   1 引 言    大多數接收機必須處理動態(tài)范圍很大的信號,這需要進行增益調整,以防止過載或某級產生互調,調整解調器的工作以優(yōu)化工作。在現代無線電接收裝置中??勺冊鲆娣糯笃魇请娍氐模⑶耶斀邮諜C中使用衰減器時,他們通常都是由可變電壓控制的連續(xù)衰減器??刂茟撌瞧交牟⑶遗c輸入的信號能量通常成對數關系(線性分貝)。在大多數情況下,由于衰落,AGC通常用來測量輸入解調器的信號電平,并且通過反饋控制電路把信號電平控制在要求的范同內。   2 系統總體設計   在本設計中,前端TD_SCDM
  • 關鍵字: TD_SCDMA  AGC  FPGA  RSP  IIR  

利用FPGA實現工業(yè)以太網交換機設計優(yōu)化

  • 利用FPGA實現工業(yè)以太網交換機設計優(yōu)化,工業(yè)以太網技術一直在進步,并越來越普及,而設計師面臨著對高性價比工業(yè)交換機日益強勁的需求?;贏SIC和ASSP的交換機因其架構固定,所以實際上沒有余地定制出新的系統特性。為了增加特性設計一般要推倒重來,此舉會導致額外的設計時間和成本支出。但如上所述的支持IEEE 1588交換機的FPGA設計可節(jié)省6到9個月的工程時間,并提供給設計師夢寐以求的靈活性,幫助他們實現精確定時協議(PTP)、 支持多個工業(yè)以太網標準、額外的標準接口或者其它可能的定制特性。
  • 關鍵字: 交換機  設計  優(yōu)化  以太網  工業(yè)  FPGA  實現  利用  

在高清晰LCD HDTV中使用Cyclone III FPGA

  •   引言   當今的液晶顯示(LCD) 技術在高清晰電視(HDTV) 領域得到了廣泛應用,其挑戰(zhàn)在于如何獲得更高的分辨率,實現更快的數據速率。提高數據速率需要專業(yè)圖像處理算法來支持快速移動的視頻。業(yè)界遇到的主要問題是:怎樣實現這些算法,率先將產品推向市場,并且能夠控制好產品功耗?   為解決這一問題,當硬件平臺和不同尺寸的LCD 顯示屏連接時,設計人員需要確定怎樣重新配置圖像處理算法。面積較大的LCD 顯示屏需要更快的數據速率,因此,難點在于怎樣根據顯示屏大小來調整數據速率。   采用新的低成本Cy
  • 關鍵字: FPGA  Cyclone III  LCD  HDTV  

立體液晶顯示器的圖像獲取及顯示

  •   立體液晶顯示器是近年來新出現的虛擬現實顯示設備,它真實地再現場景的三維信息,顯示具有縱深感的圖像。其最大特點就是觀察者無需使用任何附加設備,直接用肉眼就可看到屏幕上顯示的立體圖像。觀測者可以更容易、更快速地理解真實的景深信息,更全面、更直觀地洞察圖像空間位置的實際分布狀況。   目前,國內外的自由立體液晶顯示方式通常采用計算機采集圖像并存儲,處理后輸出到液晶屏驅動電路板,然后通過板載模數轉換模塊等處理后在液晶屏顯示立體圖像。這種方式主要由計算機進行圖像采集和處理,其開發(fā)周期短,但成本較高,體積較大,
  • 關鍵字: 顯示器  虛擬  液晶  FPGA  

FPGA設計開發(fā)中應用仿真技術解決故障的方法

  •   本文針對FPGA實際開發(fā)過程中,出現故障后定位困難、反復修改代碼編譯時間過長、上板后故障解決無法確認的問題,提出了一種采用仿真的方法來定位、解決故障并驗證故障解決方案??梢源蟠蟮墓?jié)約開發(fā)時間,提高開發(fā)效率。   FPGA近年來在越來越多的領域中應用,很多大通信系統(如通信基站等)都用其做核心數據的處理。但是過長的編譯時間,在研發(fā)過程中使得解決故障的環(huán)節(jié)非常令人頭痛。本文介紹的就是一種用仿真方法解決故障從而減少研發(fā)過程中的編譯次數,最終達到準確定位故障、縮短解決故障時間的目的。文例所用到的軟件開發(fā)平臺
  • 關鍵字: FPGA  應用仿真  

影響FPGA設計中時鐘因素的探討

  •   時鐘是整個電路最重要、最特殊的信號,系統內大部分器件的動作都是在時鐘的跳變沿上進行, 這就要求時鐘信號時延差要非常小, 否則就可能造成時序邏輯狀態(tài)出錯;因而明確FPGA設計中決定系統時鐘的因素,盡量較小時鐘的延時對保證設計的穩(wěn)定性有非常重要的意義。   1.1 建立時間與保持時間   建立時間(Tsu:set up time)是指在時鐘沿到來之前數據從不穩(wěn)定到穩(wěn)定所需的時間,如果建立的時間不滿足要求那么數據將不能在這個時鐘上升沿被穩(wěn)定的打入觸發(fā)器;保持時間(Th:hold time)是指數據穩(wěn)定后
  • 關鍵字: FPGA  時鐘  

2008年7月18日,Altera公布第二季度業(yè)績

  •   Altera公司今天宣布第二季度銷售額達到3.599億美元,比2008年第一季度增長7%,比2007年第二季度增長13%。在2008年第一季度0.839億美元凈收入和每股攤薄后收益0.27美元基礎上,第二季度凈收入增長到0.98億美元,每股攤薄后收益0.32美元。和2007年第二季度相比,今年第二季度凈收入增長22%,每股攤薄后收益增長43%。   上半年運營現金流為2.268億美元。第二季度,Altera以140萬美元回購其65,000普通股。到目前為止,在第三季度,Altera已經以1004萬美
  • 關鍵字: Altera  FPGA  Stratix   
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