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cpld／fpga 文章 最新資訊

一種基于FPGA的誘發(fā)電位儀系統(tǒng)研究與設(shè)計

  • O引言誘發(fā)電位是指對神經(jīng)系統(tǒng)某一特定部位給予特定刺激后在大腦皮層所產(chǎn)生的特定電活動，對于神經(jīng)...
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大型設(shè)計中FPGA的多時鐘設(shè)計策略

  • 利用FPGA實現(xiàn)大型設(shè)計時，可能需要FPGA具有以多個時鐘運(yùn)行的多重數(shù)據(jù)通路，這種多時鐘FPGA設(shè)計必須特別小心，需要注意最大時鐘速率、抖動、最大時鐘數(shù)、異步時鐘設(shè)計和時鐘/數(shù)據(jù)關(guān)系。設(shè)計過程中最重要的一步是確定要
  • 關(guān)鍵字： FPGA  大型  策略  多時鐘    

脈沖壓縮原理及FPGA實現(xiàn)

  • 摘要：為解決雷達(dá)作用距離和距離分辨力的問題，分析了線性調(diào)頻脈沖壓縮的原理及工程實現(xiàn)方法，并利用Matlab軟件對加權(quán)前后的線性調(diào)頻信號脈沖壓縮波形進(jìn)行對比。簡述了分布式(DA)算法的基本原理，給出一種基于FPGA分
  • 關(guān)鍵字： FPGA  脈沖壓縮  原理    

基于FPGA的帶CRC校驗的異步串口通信

  • 摘要：由于FPGA具有速度快，效率高，靈活穩(wěn)定，集成度高等優(yōu)點，所以為了提高串口通信的速度和效率，在串行通信中采用FPGA來實現(xiàn)串口通信是十分必要的。由于通信傳輸?shù)牟淮_定性以及干擾等原因，串行通信經(jīng)常會出現(xiàn)異
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基于FPGA的數(shù)據(jù)中繼器設(shè)計

  • 1前言高速以太網(wǎng)可以滿足新的容量需求，解決了低帶寬接入、高帶寬傳輸?shù)钠款i問題，擴(kuò)大了應(yīng)用范圍，并...
  • 關(guān)鍵字： FPGA  數(shù)據(jù)中繼器  

基于CPLD的發(fā)射激光多頻率同步調(diào)制器

  • 摘要：本文根據(jù)發(fā)射激光信號的要求,采用CPLD產(chǎn)生了頻率及占空比可調(diào)的激光調(diào)制信號,利用視頻同步分離器LM1881實現(xiàn)了激光調(diào)制信號與視頻輸入信號的同步,保證了激光光束多參數(shù)測量中測量設(shè)備的同步工作,在實際應(yīng)用中取
  • 關(guān)鍵字： CPLD  發(fā)射  調(diào)制器  激光    

基于FPGA的AD7862接口電路設(shè)計

  • 摘要：針對在自動控制系統(tǒng)設(shè)計領(lǐng)域和通信領(lǐng)域中有著廣泛運(yùn)用的AD7862芯片，介紹了一種基于FPGA的驅(qū)動接口電路的設(shè)計。闡述了 AD7862的特點及基本功能，以及基于這些功能特點的驅(qū)動時序，并以此時序為基礎(chǔ)在FPGA芯片中
  • 關(guān)鍵字： FPGA  7862  AD  接口    

FPGA需求大幅增長

  • 　　幾乎每一家分析研究公司都毫無例外的預(yù)測FPGA市場2011年以及未來會有較大的增長，例如，IMS研究公司預(yù)測2014年年度收益達(dá)到10億美元以上，IBS有限公司聲稱，F(xiàn)PGA解決方案日益完善，功能越來越強(qiáng)，2015年，其增長率要超過IC市場。2009年全年增長率在60%到65%之間，遠(yuǎn)遠(yuǎn)超出了半導(dǎo)體行業(yè)最初的預(yù)測。繼40 nm產(chǎn)品大獲成功之后，Altera所有產(chǎn)品在2010年的收益都有顯著增長，我們預(yù)計今后會繼續(xù)增長。
  • 關(guān)鍵字： FPGA  3G  LTE  

基于DS28E01的FPGA加密認(rèn)證系統(tǒng)的設(shè)計

  • 在現(xiàn)在電子設(shè)計的成本越來越高的情況下，基于 SRAM的 FPGA由于自身限制，容易使得設(shè)計者的設(shè)計被復(fù)制，從而給設(shè)計者提出了設(shè)計具有加密功能的電子系統(tǒng)，由于 SHA-1 算法引擎的 DS28E01芯片作為加密認(rèn)證系統(tǒng)的核心芯片，并利用 DS28E01針對 Xilinx公司的 X3CS500E開發(fā)了實際的加密認(rèn)證系統(tǒng)，并將此系統(tǒng)應(yīng)用于實際的產(chǎn)品中，取得了良好的效果。　　
  • 關(guān)鍵字： FPGA  28E  E01  DS    

一種基于FPGA的CAN總線通信接口的設(shè)計

  • CAN總線是現(xiàn)場總線的一種，因為其成本低、容錯能力強(qiáng)、支持分布式控制、通信速率高等優(yōu)點在汽車、工業(yè)控...
  • 關(guān)鍵字： FPGA  CAN總線  通信接口  

基于CPLD的矩陣鍵盤掃描模塊設(shè)計

  • 為了在不增加CPU工作負(fù)擔(dān)的前提下，實現(xiàn)標(biāo)準(zhǔn)鍵盤和矩陣鍵盤雙鍵盤同時工作，提出了一種基于復(fù)雜可編邏輯器件(CPLD)的矩陣鍵盤掃描方案，實現(xiàn)了在矩陣鍵盤狀態(tài)控制下CPLD自動完成鍵盤掃描、編碼、輸出的功能，CPU通過定時器中斷服務(wù)程序定時查詢矩陣鍵盤狀態(tài)，并將按鍵值直接送入鍵盤緩沖區(qū)，供其他程序使用。給出了CPLD部分模塊的VHDL語言實現(xiàn)和仿真波形。在矩陣鍵盤的掃描、編碼、輸出完全不需CPU控制的前提下，實現(xiàn)標(biāo)準(zhǔn)鍵盤和矩陣鍵盤雙鍵盤同時使用。
  • 關(guān)鍵字： CPLD  矩陣  鍵盤掃描  模塊設(shè)計    

FPGA實現(xiàn)的任意波形發(fā)生器的設(shè)計

  • 運(yùn)用DDS原理，進(jìn)行任意波形發(fā)生器的設(shè)計，使得任意波形發(fā)生器兼顧DDS的優(yōu)點。設(shè)計中通過實現(xiàn)DDS模塊與單片機(jī)接口的控制部分將頻率控制字由單片輸入到輸入寄存器模塊，由相位累加器模塊對輸入頻率控制字進(jìn)行累加運(yùn)算，輸出作為雙口RAM的讀地址線，讀數(shù)據(jù)線上即輸出了波形幅度量化數(shù)據(jù)。其中雙口RAM的內(nèi)容由單片機(jī)進(jìn)行更新，從而實現(xiàn)任意波形的發(fā)生。本設(shè)計中的相位累加器采用了8級流水線結(jié)構(gòu)借助前5級的超前進(jìn)位的方法，使得編譯的最高工作頻率由317．97MHz提高到336．7 MHz，實現(xiàn)了任意波形的發(fā)生，節(jié)約了成本，提
  • 關(guān)鍵字： FPGA  任意波形發(fā)生器    
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