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降低任何嵌入式設計的體積和成本的常用方法是使用具有較少I/O引腳的通信總線。雖然從并行總線發(fā)展到串行總線可明顯減小體積和降低成本,但是從一種串行總線發(fā)展為另一種具有較少引腳的串行總線也很有用。用串行總線替代并行總線時,傳輸速度是一個關鍵參數(shù)。在小體積是最重要參數(shù)的設計中,使用具有較少引腳的串行總線很有優(yōu)勢。單片機集成超過12種不同的串行接口,本文將討論各串行接口的優(yōu)缺點。

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- 關鍵字: 總線 串行 具有 體積 并行 使用 降低 發(fā)展 接口 參數(shù)
基于CAN總線的A320模擬器硬件仿真方案研究
- 針對飛機模擬器硬件仿真時系統(tǒng)模塊多、通信頻繁、結構復雜而導致模塊間布線繁雜,以及由此產(chǎn)生的干擾等問題,提出一種基于CAN總線的駕駛艙仿真方案。該方案中上位機負責邏輯運算,下位機負責操作信息采集,通過CAN總線將上、下位機組成一個網(wǎng)絡,實現(xiàn)駕駛艙功能仿真。闡述系統(tǒng)的總體結構,設計了整個駕駛艙的數(shù)據(jù)傳輸協(xié)議,結合實際應用,給出了節(jié)點中數(shù)據(jù)收發(fā)模塊的硬件設計結構和數(shù)據(jù)傳輸軟件實現(xiàn)方法。實際測試結果表明,該設計布線簡潔,數(shù)據(jù)傳輸穩(wěn)定可靠,達到預期目標。
- 關鍵字: A320 CAN 總線 模擬
1553B總線中曼徹斯特編解碼器的設計
- 曼徹斯特鳊解碼器是1553B總線協(xié)議的重要組成部分,其性能的好壞直接影響整個系統(tǒng)的通信質量。通過分析MIL STD-1553B協(xié)議和GJB5186測試標準,制定出鳊解碼器的設計規(guī)范。采用硬件描述語言(Verilog)設計電路,VCS對設計進行仿真,并利用Synplify Pro及ISE完成綜合和布局布線的工作,最后載入Xilinx FPGA進行測試。在深入分析曼徹斯特碼型特點的基礎上,對鳊解碼器的工作過程及邏輯電路結構進行詳細介紹。提出的時鐘分離電路比超前滯后數(shù)字鎖相環(huán)更為簡單有效。
- 關鍵字: 1553B 總線 曼徹斯特 編解碼器
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