asic ip 文章進(jìn)入asic ip技術(shù)社區(qū)

燦芯半導(dǎo)體提供MIPI IP完整解決方案

中國上?！?022年10月14日——一站式定制芯片及IP供應(yīng)商——燦芯半導(dǎo)體日前宣布推出可用于客制化ASIC/SoC設(shè)計(jì)服務(wù)的MIPI IP完整解決方案。該解決方案由一系列 MIPI控制器和PHY構(gòu)成?？梢詭椭到y(tǒng)制造商和IC公司等設(shè)計(jì)高質(zhì)量的ASIC/SoC產(chǎn)品，同時(shí)加速上市時(shí)間。 MIPI聯(lián)盟在2003年成立，MIPI全稱Mobile Industry Processor Interface，即移動產(chǎn)業(yè)處理器接口。顧名思義，是為了統(tǒng)一和簡化手機(jī)處理器的接口，CSI、DSI、DigRF、C/D
關(guān)鍵字：燦芯 MIPI IP

CEVA推出業(yè)界首個(gè)用于5G RAN ASIC基頻平臺IP

全球領(lǐng)先的無線連接和智慧感測技術(shù)及共創(chuàng)解決方案的授權(quán)許可廠商CEVA推出了PentaG-RAN，這是業(yè)界首個(gè)用于ASIC的5G基頻平臺IP，針對基地站和無線電配置中的蜂巢式基礎(chǔ)設(shè)施。這款I(lǐng)P包括分布式單元（DU）和遠(yuǎn)程無線電單元（RRU），涵蓋從小基站到大規(guī)模多輸入多輸出（mMIMO）范圍。這款異構(gòu)基頻計(jì)算平臺將為有意開拓Open RAN（O-RAN）設(shè)備市場的企業(yè)大幅降低進(jìn)入壁壘。數(shù)字化轉(zhuǎn)型不斷要求更高的蜂巢帶寬和更低的延遲，推動5G基地站和無線電ASIC市場蓬勃發(fā)展。最近，Open RAN提倡和mMI
關(guān)鍵字： CEVA 5G RAN ASIC

CEVA推出業(yè)界首個(gè)用于5G RAN ASIC的基帶平臺IP加速5G基礎(chǔ)設(shè)施部署

●? ?PentaG-RAN彌補(bǔ)半導(dǎo)體行業(yè)設(shè)計(jì)差距，為企業(yè)優(yōu)化ASIC 解決方案以挺進(jìn)利潤豐厚的?5G Open RAN設(shè)備市場●? ?突破性平臺架構(gòu)通過完整L1 PHY解決方案應(yīng)對大規(guī)模MIMO計(jì)算難題，與現(xiàn)有的FPGA和商用現(xiàn)貨CPU 替代方案相比，節(jié)省功耗和面積高達(dá)10倍●? ?PentaG-RAN客戶可享用CEVA共創(chuàng)服務(wù)，以開發(fā)整個(gè)?PHY 子系統(tǒng)直至完成芯片設(shè)計(jì)全球領(lǐng)先的無線連接和智能感知技術(shù)及共創(chuàng)解決方案的授權(quán)許
關(guān)鍵字： CEVA 5G RAN ASIC 基帶平臺IP

Achronix收購FPGA網(wǎng)絡(luò)解決方案領(lǐng)導(dǎo)者Accolade Technology的關(guān)鍵IP和專長

加利福尼亞州圣克拉拉市，2022年9月19日——高性能現(xiàn)場可編程邏輯門陣列（FPGA）和嵌入式FPGA（eFPGA）半導(dǎo)體知識產(chǎn)權(quán)（IP）領(lǐng)域的領(lǐng)導(dǎo)性企業(yè)Achronix半導(dǎo)體公司宣布：該公司已經(jīng)收購了Accolade Technology的關(guān)鍵IP資產(chǎn)以及Accolade的技術(shù)團(tuán)隊(duì)，此舉使Achronix的客戶能夠更快速且更輕松地設(shè)計(jì)高性能網(wǎng)絡(luò)和數(shù)據(jù)中心系統(tǒng)。Accolade在FPGA的網(wǎng)絡(luò)應(yīng)用方面擁有深厚的專業(yè)知識，此次收購使Achronix能夠?yàn)殚_發(fā)網(wǎng)絡(luò)技術(shù)的客戶提供強(qiáng)大的硬件和軟件解決方案?！叭缃?/li>
關(guān)鍵字： Achronix FPGA Accolade IP

燦芯半導(dǎo)體推出USB IP完整解決方案

一站式定制芯片及IP供應(yīng)商——燦芯半導(dǎo)體日前宣布推出可用于ASIC/SoC的USB IP完整解決方案。該解決方案由一系列 USB 控制器和 PHY 構(gòu)成，可以助力系統(tǒng)制造商、個(gè)人電腦原始設(shè)備制造商和 IC公司等設(shè)計(jì)高質(zhì)量的ASIC/SoC 產(chǎn)品。USB（通用串行總線）已經(jīng)非常成功地將打印機(jī)、掃描儀、鍵盤、鼠標(biāo)、閃存驅(qū)動器、操縱桿、相機(jī)和顯示器等硬件連接到各種計(jì)算機(jī)，包括智能手機(jī)、臺式機(jī)、平板電腦和筆記本電腦等。USB4規(guī)范在2019年9月由USB-IF組織執(zhí)行，可支持USB3、Displayport、PC
關(guān)鍵字：燦芯 USB IP

第 150 億顆CEVA 助力芯片出貨

全球領(lǐng)先的無線連接和智能感知技術(shù)及共創(chuàng)解決方案的授權(quán)許可廠商CEVA, Inc.(納斯達(dá)克股票代碼：CEVA)宣布，包含CEVA IP的并支付權(quán)利金的芯片的累計(jì)出貨量已經(jīng)在第二季超過了150億顆。在上市將近二十周年之際，CEVA達(dá)成了這一重要里程碑。實(shí)現(xiàn)前100億顆CEVA助力的芯片出貨花費(fèi)了超過15年時(shí)間，而完成隨后50 億顆芯片出貨則只用了不到三年半。 CEVA IP在物聯(lián)網(wǎng)時(shí)代以令人驚訝的速度被廣泛采用也證實(shí)了CEVA在無線連接的普及方面發(fā)揮了重要的作用。CEVA將5G、蜂窩物聯(lián)網(wǎng)、藍(lán)牙、
關(guān)鍵字： CEVA IP

Credo正式推出基于臺積電5nm及4nm先進(jìn)制程工藝的全系列112G SerDes IP產(chǎn)品

?Credo Technology（納斯達(dá)克股票代碼：CRDO）近日正式宣布推出其基于臺積電5nm及4nm制程工藝的112G PAM4 SerDes IP全系列產(chǎn)品，該系列能夠全面覆蓋客戶在高性能計(jì)算、交換芯片、人工智能、機(jī)器學(xué)習(xí)、安全及光通信等領(lǐng)域的廣泛需求，包括：超長距（LR+）、長距（LR）、中距（MR）、超極短距（XSR+）以及極短距（XSR）。?Credo IP產(chǎn)品業(yè)務(wù)開發(fā)助理副總裁Jim Bartenslager表示， “Credo先進(jìn)的混合信號以及數(shù)字信號處理（DSP）1
關(guān)鍵字： Credo 臺積電 5nm 4nm SerDes IP

嵌入式北斗網(wǎng)絡(luò)時(shí)間服務(wù)器的Web網(wǎng)頁實(shí)現(xiàn)

摘要：本文介紹了嵌入式北斗網(wǎng)絡(luò)時(shí)間服務(wù)器的基本功能，重點(diǎn)講述了如何在該設(shè)備中添加Web網(wǎng)頁的方法及實(shí)現(xiàn)過程，以及在嵌入式設(shè)備中添加此功能應(yīng)該考慮的資源因素。關(guān)鍵詞：TCP/IP；HTTP；Cortex-M4；RAM；鏈表?1 時(shí)間服務(wù)器功能描述北斗衛(wèi)星接收終端接收北斗導(dǎo)航衛(wèi)星發(fā)射的 RNSS （Radio Navigation Satellite System，無線導(dǎo)航衛(wèi)星系統(tǒng)）無線電波信號，在設(shè)備內(nèi)部通過 PVT 解算，計(jì)算出用戶當(dāng)前的位置、速度以及時(shí)間信息。北斗的時(shí)間信息具
關(guān)鍵字： 202208 TCP/IP HTTP Cortex-M4 RAM 鏈表

Inuitive 與 Arteris IP 合作為邊緣設(shè)備提供下一代視覺處理技術(shù)

Inuitive? 和業(yè)界領(lǐng)先的提供片上網(wǎng)絡(luò)(NoC)互連和IP部署軟件以加快系統(tǒng)級芯片(SoC)創(chuàng)建的系統(tǒng)IP供應(yīng)商 Arteris? Inc.今天宣布，Inuitive 已為其下一代計(jì)算機(jī)視覺平臺部署了 Arteris FlexNoC? 互連 IP。該技術(shù)解決了連接和時(shí)序收斂的挑戰(zhàn)，可以實(shí)現(xiàn)先進(jìn)的下一代前沿視覺處理器所需的激進(jìn)性能目標(biāo)。這些先進(jìn)的 SoC 將擴(kuò)展多核視覺處理并增強(qiáng)高質(zhì)量的深度傳感。這些芯片將部署在 3D 深度成像、物體識別和跟蹤，以及其他使用計(jì)算機(jī)視覺算法的各種應(yīng)用中，比如增強(qiáng)現(xiàn)實(shí)、虛
關(guān)鍵字： Arteris IP 視覺處理器

燦芯半導(dǎo)體推出兩項(xiàng)創(chuàng)新技術(shù)用于DDR物理層

一站式定制芯片及IP供應(yīng)商——燦芯半導(dǎo)體日前宣布推出用于高速DDR物理層中的Zero-Latency （零延遲）和True-Adaptive（真自適應(yīng)）兩項(xiàng)技術(shù)。這兩項(xiàng)技術(shù)已經(jīng)開始在12/14 FinFET, 22/28nm的DDR4/LPDDR4,4x高性能物理層IP上進(jìn)行部署，將為客戶帶來更高效、更穩(wěn)定的全新體驗(yàn)。 Zero-Latency （零延遲）技術(shù)在讀數(shù)據(jù)通路上，采用了兩種可選的、獨(dú)特的采樣方式進(jìn)行數(shù)據(jù)轉(zhuǎn)換，而不像其他DDR物理層供貨商采用FIFO進(jìn)行跨時(shí)鐘域轉(zhuǎn)換，此技術(shù)將延遲降低
關(guān)鍵字：燦芯 DDR IP

Codasip為RISC-V處理器系列增加Veridify安全啟動功能

可定制RISC-V處理器知識產(chǎn)權(quán)（IP）和處理器設(shè)計(jì)自動化的領(lǐng)導(dǎo)者Codasip日前宣布，Veridify Security公司的抗量子安全工具現(xiàn)在可以通過安全啟動功能支持Codasip的RISC-V處理器。在固件加載到Codasip處理器上時(shí)，Veridify的安全算法就會對其進(jìn)行驗(yàn)證，以使RISC-V開發(fā)人員確信嵌入式系統(tǒng)是安全可用的。Veridify的安全啟動功能是基于一種比傳統(tǒng)加密方法運(yùn)行速度更快的算法；只需要很小的代碼空間和超低功耗，非常適合Codasip的低功耗嵌入式處理器系列。通過使用Ver
關(guān)鍵字： Codasip RISC-V IP

Arm 全面計(jì)算解決方案重新定義視覺體驗(yàn) 強(qiáng)力賦能移動游戲

新聞重點(diǎn)：· 全新旗艦產(chǎn)品 Immortalis GPU 將顯著優(yōu)化安卓游戲體驗(yàn)，并首次推出基于硬件的光線追蹤功能· 最新 Armv9 CPU 將峰值和效率性能提升至全新水平· 新的 Arm 全面計(jì)算解決方案 (Total Compute Solutions) 可滿足各級別的性能、效率和可擴(kuò)展
關(guān)鍵字： arm IP 移動游戲

NOVATEK NT98560 監(jiān)控與AIoT產(chǎn)品方案

聯(lián)詠芯片NT98560是一款高度集成的SoC，具有高畫質(zhì)、低碼率、低功耗，適用于2Mp 至5Mp Edge-IP Camera應(yīng)用。NT98560集成了ARM Cortex A9 CPU內(nèi)核、新一代 ISP、H.265/H.264視頻壓縮編解碼器、高性能硬件DLA模塊、圖形引擎、顯示控制器、以太網(wǎng)PHY、USB 2.0 (Host/Device)、音頻編解碼器、RTC和SD/SDIO 3.0提供最佳性價(jià)比Edge-IP Camera解決方案、可適用于Professional IPCAM、HOME / Co
關(guān)鍵字： IP CAM nt98560 aiot ai

全新推出的Codasip Studio Mac版本為RISC-V處理器帶來更多的差異化設(shè)計(jì)潛力

可定制RISC-V處理器硅知識產(chǎn)權(quán)（IP）的領(lǐng)導(dǎo)者Codasip日前宣布，其Codasip Studio平臺現(xiàn)已支持蘋果公司macOS Monterey（當(dāng)前macOS的主要版本）。Codasip Studio是一個(gè)處理器設(shè)計(jì)自動化平臺，用于完成Codasip領(lǐng)先的RISC-V處理器IP的定制，使設(shè)計(jì)人員能夠快速且輕松地定制其處理器設(shè)計(jì)，以面向特定領(lǐng)域中的應(yīng)用實(shí)現(xiàn)最高性能。Codasip Studio還可以用于創(chuàng)建Codasip的業(yè)內(nèi)最佳的RISC-V處理器內(nèi)核，并幫助設(shè)計(jì)人員評估微架構(gòu)的替代方案。應(yīng)用軟
關(guān)鍵字： RISC-V IP

燦芯半導(dǎo)體推出高精度16位SAR ADC

一站式定制芯片及IP供應(yīng)商——燦芯半導(dǎo)體日前宣布推出高精度16位逐次逼近型（16bit SAR）ADC。該IP首個(gè)測試芯片基于中芯國際55nm工藝流片成功，現(xiàn)已完成EVB測試，可提供給客戶進(jìn)行評估。該IP采樣率為1MHz, ENOB（有效位）可達(dá)14bit，通常情況下其DNL（微分線性誤差）介于-0.4LSB至0.47LSB之間，INL（積分線性誤差）居于-1.8LSB至2.2LSB之間，其典型功耗是4.25mA，性能指標(biāo)處于國內(nèi)領(lǐng)先水平。燦芯半導(dǎo)體深耕高精度12/14/16 bit SAR
關(guān)鍵字： ADC IP