arm+fpga 文章最新資訊

Altera 推出業(yè)界首款串行 RapidIO 2.1 IP 解決方案

　　Altera 公司 (NASDAQ: ALTR) 今天宣布推出業(yè)界首款支持 RapidIO® 2.1 規(guī)范的知識產(chǎn)權(quán) (IP) 內(nèi)核。Altera 的串行 RapidIO IP 內(nèi)核可支持多達(dá)四條通道，每條通道速率為 5.0 GBaud，從而滿足了無線市場日益增長的帶寬和可靠性需求。該 IP 內(nèi)核專門針對擁有多個(gè)嵌入式收發(fā)器的 Stratix® IV FPGA 而優(yōu)化，并得到了Quartus® II 軟件 v9.1 的支持。　　RapidIO 2.1 規(guī)范在許多應(yīng)用中均可實(shí)
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擴(kuò)大嵌入式領(lǐng)域勢力范圍 FPGA廠商積極備戰(zhàn)

　　隨著經(jīng)濟(jì)情勢與市場環(huán)境的改變,歷經(jīng)長足發(fā)展的可編程邏輯組件(PLD)正憑借著成熟的技術(shù)將觸角深入量產(chǎn)型的消費(fèi)及嵌入式市場,并以更加經(jīng)濟(jì)的開發(fā)成本持續(xù)搶占傳統(tǒng)ASIC/ASSP市場. 　　"ASIC/ASSP的商業(yè)模式愈來愈難以為繼,"愛特(Actel)公司應(yīng)用工程師陳冠志指出.巨額的芯片制造成本是首先面臨的關(guān)卡."300mm晶圓廠的成本以驚人的速度增長,在45nm節(jié)點(diǎn)約需30億美元;而到了32nm節(jié)點(diǎn),估計(jì)會達(dá)到100億美元."另一方面,全球市場的動蕩情況,也
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Xilinx推出EasyPath-6 FPGA

　　全球可編程邏輯解決方案領(lǐng)導(dǎo)廠商賽靈思公司 (Xilinx, Inc. )日前宣布隆重推出EasyPath?-6 FPGA，該產(chǎn)品為高性能 FPGA 進(jìn)入量產(chǎn)器件提供了六周內(nèi)即可實(shí)現(xiàn)的總成本最低、風(fēng)險(xiǎn)最小的的解決方案，在所有FPGA降低成本解決方案中轉(zhuǎn)入量產(chǎn)時(shí)間最快。新款 EasyPath FPGA 無最低訂購量限制，讓客戶可根據(jù)最終市場需求下訂單，且成本較購買等量的 FPGA 低 35%。　　此外，雖然大多數(shù)成本降低的方案會讓設(shè)計(jì)選項(xiàng)受到限制，迫使客戶接受未經(jīng)優(yōu)化的部件或封裝，然而
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基于FPGA的人工神經(jīng)網(wǎng)絡(luò)實(shí)現(xiàn)方法的研究

基于FPGA的神經(jīng)網(wǎng)絡(luò)實(shí)現(xiàn)方法已成為實(shí)際實(shí)時(shí)應(yīng)用神經(jīng)網(wǎng)絡(luò)的一種途徑。本文就十多年來基于FPGA的ANN實(shí)現(xiàn)作一個(gè)系統(tǒng)的總結(jié)，例舉關(guān)鍵的技術(shù)問題，給出詳細(xì)的數(shù)據(jù)分析，引用相關(guān)的最新研究成果，對不同的實(shí)現(xiàn)方法和思想進(jìn)行討論分析，并說明存在的問題以及改善方法，強(qiáng)調(diào)神經(jīng)網(wǎng)絡(luò)FPGA實(shí)現(xiàn)的發(fā)展方向和潛力及提出自己的想法。另外，還指出基于FPGA實(shí)現(xiàn)神經(jīng)網(wǎng)絡(luò)存在的瓶頸制約，最后對今后的研究趨勢作出估計(jì)。
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LPC2214的IAP實(shí)現(xiàn)方案

LPC2214的IAP實(shí)現(xiàn)方案,引言
IAP即在應(yīng)用中編程，對于嵌入式產(chǎn)品，指在不影響產(chǎn)品正常運(yùn)行的情況下實(shí)現(xiàn)應(yīng)用程序的更新。許多ARM芯片都提供該操作接口，相對于ISP(在系統(tǒng)編程)方式，具有方便靈活且不需要借助專用boot裝載程序或工具的
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賽靈思目標(biāo)設(shè)計(jì)平臺再獲電子行業(yè)大獎

《電子產(chǎn)品世界》在“2009年度影響中國的嵌入式系統(tǒng)技術(shù)獎”評選中授予賽靈思目標(biāo)設(shè)計(jì)平臺“最佳新興理念獎”，對目標(biāo)設(shè)計(jì)平臺給設(shè)計(jì)師帶來的巨大價(jià)值表示高度認(rèn)可
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ARM逐步蠶食工業(yè)市場專有核心MCU固守優(yōu)勢

　　嵌入式應(yīng)用MCU業(yè)務(wù)被證明是半導(dǎo)體產(chǎn)品市場上一項(xiàng)賺錢的業(yè)務(wù)。根據(jù)市場調(diào)研公司iSuppli的統(tǒng)計(jì),僅僅在中國,目前嵌入式應(yīng)用MCU市場每年都有20億美元左右的規(guī)模。因此,在半導(dǎo)體業(yè)務(wù)增速放緩,經(jīng)濟(jì)大環(huán)境并不樂觀的情況下,大多數(shù)擁有MCU業(yè)務(wù)的公司都在加強(qiáng)該項(xiàng)業(yè)務(wù)。而在此過程中,MCU廠商的策略各有不同。　　CortexM3拓展消費(fèi)和工業(yè)市場或?qū)⑿纬扇愣α⒕置? 　　毫無疑問,基于ARMCortex-M3的MCU產(chǎn)品目前在嵌入式MCU市場掀起了一股熱潮。多家MCU企業(yè)已經(jīng)推出或計(jì)劃推出基于該核心的
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基于FPGA的FIFO設(shè)計(jì)和應(yīng)用

為實(shí)現(xiàn)目標(biāo)識別與跟蹤的應(yīng)用目的，在基于TMS320DM642的FIFO基礎(chǔ)上擴(kuò)展存儲空間，提出一種基于FPGA實(shí)現(xiàn)SDRAM控制器的方法。分析所用SDRAM的特點(diǎn)和工作原理，介紹FPGA中SDRAM控制器的組成和工作流程，給出應(yīng)用中讀SDRAM的時(shí)序圖。FPGA采用模塊化設(shè)計(jì)，增強(qiáng)SDRAM控制器的通用性，更方便地滿足實(shí)際需求。
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BP神經(jīng)網(wǎng)絡(luò)圖像壓縮算法乘累加單元的FPGA設(shè)計(jì)

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神經(jīng)網(wǎng)絡(luò)(Neural Networks)是人工神經(jīng)網(wǎng)絡(luò)(Ar-tificial Neural Networks)的簡稱，是當(dāng)前的研究熱點(diǎn)之一。人腦在接受視覺感官傳來的大量圖像信息后，能迅速做出反應(yīng)，并能在腦海中重現(xiàn)這些圖像信息，這
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小型無人靶機(jī)掠海定高飛行控制系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)

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靶機(jī)是無人機(jī)家族中的一個(gè)重要分支，主要用于模擬作戰(zhàn)飛機(jī)、導(dǎo)彈等威脅目標(biāo)，為防空武器系統(tǒng)試驗(yàn)和訓(xùn)練提供逼真的空中靶標(biāo)。隨著技術(shù)的進(jìn)步，現(xiàn)代反艦導(dǎo)彈多采取“超低空掠?！憋w行的突防方式，與之相
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基于ARM9的快速對星裝置設(shè)計(jì)與實(shí)現(xiàn)

基于ARM9的快速對星裝置設(shè)計(jì)與實(shí)現(xiàn),0 引言
大中型衛(wèi)星站均具有相應(yīng)的、完善的天線跟蹤伺服系統(tǒng)，天線伺服跟蹤系統(tǒng)依據(jù)信標(biāo)信號強(qiáng)弱，決定天線轉(zhuǎn)向，驅(qū)動天線旋轉(zhuǎn)，達(dá)到準(zhǔn)確對星。隨著通信技術(shù)和電子技術(shù)的發(fā)展，小型衛(wèi)星站如車載站、便攜站受機(jī)
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μC／OS-Ⅱ在ARM系列單片機(jī)S3C44B0x上的移植

給出在ARM系列單片機(jī)S3C44B0x上移植嵌入式實(shí)時(shí)操作系統(tǒng)μC／OS-Ⅱ的一種方法，介紹了實(shí)時(shí)操作系統(tǒng)μC／OS-Ⅱ和S3C44B0x單片機(jī)的特點(diǎn)，討論μC／OS-Ⅱ在S3C44B0x上移植的可能性，并成功地將實(shí)時(shí)操作系統(tǒng)μC／OS-Ⅱ移植到S3C44BOx上。在移植過程中所做的主要工作就是對μC／OS-Ⅱ源代碼中的三個(gè)主要文件進(jìn)行重新配置和修改。在S3C44B0x開發(fā)板上成功實(shí)現(xiàn)該移植過程，通過測試驗(yàn)證了移植代碼的正確性。
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三線制同步串行通信控制器接口設(shè)計(jì)

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航天工程領(lǐng)域中，星地通訊等遠(yuǎn)距離遙測遙控是嵌入式衛(wèi)星數(shù)管計(jì)算機(jī)重要功能之一，利用三線制同步串行遙測遙控通道對指令和數(shù)據(jù)進(jìn)行收發(fā)操作是通信鏈路的重要環(huán)節(jié)。
目前許多處理器芯片都已集成了
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基于AD7543和FPGA的數(shù)／模轉(zhuǎn)換電路設(shè)計(jì)

設(shè)計(jì)基于AD7543和FPGA的數(shù)／模轉(zhuǎn)換電路，介紹AD7543的主要特點(diǎn)、封裝形式、引腳功能和工作原理，設(shè)計(jì)基于AD7543轉(zhuǎn)換芯片的具體的數(shù)／模轉(zhuǎn)換硬件電路，利用Verilog HDL語言描述AD7543的控制時(shí)序，并給出具體的Veril-og HDL代碼及其仿真結(jié)果。實(shí)踐結(jié)果表明，該設(shè)計(jì)可行，可取代傳統(tǒng)的“CPU+專用的數(shù)／模轉(zhuǎn)換(D／A)芯片”設(shè)計(jì)結(jié)構(gòu)，可進(jìn)一步提高系統(tǒng)的可靠性和抗干擾能力。
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基于FPGA玻璃缺陷圖像采集處理系統(tǒng)

在進(jìn)行圖像采集過程中，重點(diǎn)需要解決采集系統(tǒng)的實(shí)時(shí)性問題。而這里選用的多線陣CCD拼接圖像的采集方法勢必導(dǎo)致在低級算法階段會產(chǎn)生極大的數(shù)據(jù)流，應(yīng)用一個(gè)高速的嵌入式處理模塊則能很好地完成圖像處理的低級算法部分。在此分析了玻璃缺陷采集處理系統(tǒng)的工作過程，對系統(tǒng)內(nèi)存控制做了詳細(xì)的描述，并在FPGA內(nèi)實(shí)現(xiàn)了圖像的低級處理，從而使計(jì)算機(jī)從低級處理的大量數(shù)據(jù)中解脫出來。
關(guān)鍵字： FPGA 玻璃缺陷處理系統(tǒng)