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多時鐘域 文章 最新資訊

FPGA中的多時鐘域設計

  • FPGA中的多時鐘域設計-在一個SOC設計中，存在多個、獨立的時鐘，這已經(jīng)是一件很平常的事情了。大多數(shù)的SOC器件都具有很多個接口，各個接口標準都可能會使用完全不同的時鐘頻率。
  • 關鍵字： FPGA  多時鐘域  

多時鐘域數(shù)據(jù)傳遞的Spartan-II FPGA實現(xiàn)

  • 本文采用FPGA來設計一款廣泛應用于計算機、Modem、數(shù)據(jù)終端以及許多其他數(shù)字設備之間的數(shù)據(jù)傳輸?shù)膶Ｓ卯惒讲⑿型ㄐ沤涌谛酒?，實現(xiàn)了某一時鐘域(如66 MHz)的8位并行數(shù)據(jù)到另一低時鐘域(如40 MHz)16位并行數(shù)據(jù)的異步轉(zhuǎn)換，并且客戶可以根據(jù)自己的要求進行數(shù)據(jù)定義。完成數(shù)據(jù)在不同時鐘域間的正確傳遞的同時防止亞穩(wěn)態(tài)的出現(xiàn)，保持系統(tǒng)的穩(wěn)定，是電路設計的關鍵。
  • 關鍵字： Spartan-II  FPGA  多時鐘域  數(shù)據(jù)    
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多時鐘域介紹

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