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一種基于CPLD實現(xiàn)QPSK調(diào)制電路設(shè)計

作者: 時間:2014-09-10 來源:網(wǎng)絡(luò) 收藏

  3.1 電源模塊

本文引用地址:http://www.bjwjmy.cn/article/262767.htm

  為電路提供5V電壓的設(shè)計實現(xiàn)方案有多種,如采用USB提供5V電壓也可以設(shè)計直流穩(wěn)壓電源。直流穩(wěn)壓電源的設(shè)計要先采用電源變壓器經(jīng)過整流電路然后濾波最后穩(wěn)壓這四部,設(shè)計實現(xiàn)起來相對復(fù)雜。設(shè)計中購買9V輸出電源,將9V電源轉(zhuǎn)化為5V電源。電路由一個7805芯片和2個電容組成,7805的1腳接電源電壓輸入,2腳接地,3腳經(jīng)穩(wěn)壓后輸出5V電壓。C1、C2用來濾出紋波。

  3.2 時鐘信號模塊

  時鐘電路模塊由2個反相器構(gòu)成反饋,配合1個電容和2個電阻使晶振起振,來產(chǎn)生一個4MHz的時鐘。

  3.3 基帶信號產(chǎn)生模塊

  此模塊的作用是產(chǎn)生五種基帶信號(全0碼、全1碼、01碼、7位M序列和15位M序列)。

  3.4 D/A模塊

  模塊出來的信號是數(shù)字基帶信號,需要經(jīng)過D/A轉(zhuǎn)換為模擬信號,在設(shè)計中選用DAC0832實現(xiàn)D/A轉(zhuǎn)換。

  DAC0832輸出的是電流,但要求輸出是電壓,所以電路還必須經(jīng)過一個運算放大器轉(zhuǎn)換成電壓。

  3.5 濾波模塊

  濾波電路在設(shè)計中采用的是一個壓控電壓源低通濾波器。其截至頻率為50KHz,增益為2,K=5.

  4. 信號仿真

  調(diào)制信號的仿真結(jié)果如下:

  當(dāng)輸入0/1碼時,由于寄存器y為2,所以循環(huán)輸出電平為005A7FBF.FFBF7F5A仿真波形如圖3所示。

  

 

  圖3

  當(dāng)輸入15位M序列碼時,由于寄存器y值是變化的,所以輸出電平不是循環(huán)的,仿真波形如圖4所示。

  

 

  圖4

  5. 結(jié)束語

  本次設(shè)計主要硬件模塊有基帶信號產(chǎn)生模塊、調(diào)制模塊、D/A轉(zhuǎn)換模塊和濾波模塊,其中為簡化設(shè)計系統(tǒng)設(shè)計供電模塊采用了5V電池供電,基帶信號產(chǎn)生模塊和調(diào)制模塊是設(shè)計中的關(guān)鍵點和難點,其基于設(shè)計,是一種整合性較高的邏輯邏輯元件。有高整合性的特點,故其有性能提升,可靠度增加,PCB面積減少和成本低等優(yōu)點。


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關(guān)鍵詞: CPLD QPSK 調(diào)制

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